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电源大师告诉你电源设计中PCB的走线要点
8 E+ C9 e0 L* c; N& C7 @关于电源PCB布局、布线、调试问题，作为电子行业的从业人，心中定然都有自己的一套操作习惯。; H$ s$ p0 A/ M7 c# R$ g7 o8 m* v/ a
0 ?1 q; n. X8 a; G% L2 x9 l
电源工程师必须与PCB Layout工程师紧密合作以应对极具挑战的电源设计，一味蛮干并非解决事情的最好方法。
7 z2 C+ W9 I, n5 t: J5 C0 A, ^ W4 x G! M" w$ \9 z# s
在电源设计中，还需注意一下几点：: @- s4 \- [( w% A6 L5 E2 F
# ?7 u7 D7 p4 e7 w在系统设计布局规划上，电源电路应该尽可能靠近负载电路4 d1 X. R) Z" V
# h/ _6 ], `5 p* @ K! T2 Q3 A散热回路应该尽可能靠近电源电路以减少热阻# Q. z4 E0 `$ Y: y) T
# S: K) D: N9 [/ l* d
选择正确的板层数量和铜厚9 \& Q9 P5 H" t5 o7 q( q- M7 m- N
8 D* m9 L' }) m' n" |# {
在有散热对流的板上，注意大尺寸的被动器件（电感，大电容）布局, c' N. L# S, D j4 D8 j
+ _- W% ?$ p: G1 B% i1 I( H不要阻碍芯片和MOSFET的空气对流3 a2 L! T+ o2 M; J2 H$ R" f m0 U
8 V5 p7 w e1 w8 G
在板层堆叠问题和电路板布局及走线问题中，主要采用优劣对比的方式讲解，有对比更易掌握优先方式。/ ~# a( K7 [+ s3 w5 @, q3 p
4 H3 j3 D4 a) m* C: Q P0 {板层堆叠问题
6 ?2 I( T. D j8 W* R' t哪一种板层堆叠设计最优？9 I+ K( ~. F' Y6 |1 K
1 B1 J4 Y9 ]1 [4 Y2 L: s
; g) s* d' V8 N; t0 P2 E, X
p. h; }8 E3 r) w6 b! p6 S
% J5 ~8 [. h4 G/ e" r1 a& p2 G( S* \1 d- ?/ a6 |$ D+ G
• 阻抗基准：
4 a$ u3 ^* P- q C! a( E5 r- |. t: R W5 U3 u. G3 s, g! }
通常选择直流电源或地平面作为交流参考平面。
- y5 |, s: M' K# p2 j
$ X) B1 R1 f9 q+ W- V6 B• 一个基本的准则：
+ ?8 q8 A" L' K( X, q
" N* L G: b2 o1 B1 p4 Q9 p一般情况下，不应分割多层PCB设计的参考平面。# r& ~. C: s7 g. r7 A" K4 D0 T
* T4 K1 V9 ]. y# o8 ~
电路板布局及走线
& M! i- ?8 t J& D/ b g
& z& J* l% E% { A" W8 v# J9 k/ @+ U$ G
6 d7 X o. J# t, h' \9 ^' f
小信号走线不得不在参考层走线
& U. ?4 n0 L" M5 C0 k3 E3 |& z1 S- O4 I+ e c$ Z2 [
请选择对阻抗影响最小的走线而非横跨走线以降低电源参考层的阻抗3 d- v9 c5 T0 C8 r; M
) l* e4 T2 g K
! f9 V( o" t3 Q0 x! T9 g
9 D4 u5 B' c. Q! T0 ?
功率器件铺铜尽可能宽、短
" l4 K6 Q( h9 r7 `7 G% ^8 \) K9 ~, i Y( R% Z* G
层间连接用多个过孔降低阻抗! o5 }9 p2 u0 {
) R' Q& b7 H, B3 L: i* `
功率元件焊盘与铜箔的连接禁止用很细的走线或者十字连接' |* _& T. s) N8 I' B" x2 P
6 f2 D" i. y( D! P尽可能降低走线的阻抗
. e! T4 p N a/ y' N
( E7 g3 g ?0 [+ v! B9 E" C- w铜厚和宽度计算
4 S/ }; Y( _ J B本部分主要涉及计算的公式，配以一个示例，理解起来也更容易些！
+ ?# C J# g1 Y0 _- h: a' Z
7 W" W2 w2 p! B• Copper resistivity (Ohm/cm)：（铜电阻率）" _( ^1 j5 z/ ^# m& Z; Y3 o
' C) q% P, v2 I& ]0 o5 D5 l) s
9 i5 `0 C$ K1 n0 q4 i) Z' H2 p
# }( ?/ P+ E: i* l, @ G9 j
• Resistance of copper（铜电阻）：
# n( m# i( m% f$ M% I& T3 V/ P( O
/ X* b" }! i4 \( s
# X7 U* F6 l. p. F( A
2 I v8 C7 H+ e, K# Z1 h9 V
7 O3 p7 Q8 q' J" b• 范例：
) e: |+ ^4 G4 Y1 n5 m, `4 R6 \9 g
/ y% Q8 x7 E6 ]6 g5 L e" a+ n$ i6 _1 Z+ ]$ ]) d
! y' t2 S: S: ^3 H' N• 总结与建议：2 }% h I5 Y+ B
- K9 f' Z7 p b& g' E+ ]3 ?5 {0.5 Oz铜厚 =0.7mil=17.78uM
2 w& n+ Y* T* R, v7 G: h o; X' u- f% u7 e( |) H
1.0 Oz 铜厚=1.4mil=35.56uM
) C2 p5 _0 K$ b$ o' r# {% c% I x' y, P" Y3 l
2.0 Oz 铜厚=2.8mil=71.12uM8 `8 d7 l* F5 Z; A! n+ ^
* J s. Z8 c' ^4 W1 C) F' Q+ t4.0 Oz 铜厚=5.6mil=142.24uM& z3 }& j0 R6 V# A. f* F
( k$ Z7 O. {$ ?对于所有功率系统设计， 推荐使用2OZ甚至更厚的铜厚; o N6 f! \9 z/ x5 C4 Z
/ ?4 v( K- v1 [: D8 x% l! ~BUCK电路布局及走线- M5 T4 F* Q& f: Z' ^& f: ~0 F
: _0 a7 [5 I, Z
! {7 h% k* N# u4 C$ d
( A3 m/ M$ s" P7 T w. @* z
5 n0 ?+ N) O3 c& t找到连续电流和断续电流的回路1 R* I5 E6 d% `2 w' a
3 Z/ y& J+ L5 J' n特别注意使得流过脉冲电流的回路面积最小，dV/dt的开关点与其他线路隔开# t9 o7 M9 r O# O% r# D" ?
0 t! }" w6 C1 ]; _# K( m7 u! W' OBOOST电路布局及走线
- i% m: N& Z- Q7 a. w! ^) e* X0 k0 W1 f( F" g
4 P+ _+ Z* D0 q' A* Z2 z
' r$ M+ \. L+ Y/ O1 A$ D& c9 d
* E7 A+ ]$ f0 ^$ R2 V& s# I输出侧的脉冲电流回路所围的区域应尽可能小
3 m( w* o3 P( N: l5 y4 J& M, G1 `
1 i. X9 v5 V1 U. C走线注意事项+ S) K _7 g' Y4 ~
• 最敏感的走线
3 g2 D+ l- [( \4 q. i! q' n7 B. i, [& _: m$ z2 v9 Q3 N! J
电流采样(Sense+/-), 误差放大器输入引脚(Vfb), 误差放大器输出引脚(ITH or VComp), SGND3 @) r# F, m, n8 c
' q! j( m2 t: F% H. j: k7 x" F
-Sense+ / - 尽量成对走线，或走差分线
& T, M [/ C5 l5 E6 J" T$ f8 g3 q$ J
走线空间尽量小，滤波电容靠近芯片引脚，滤波电阻靠近滤波电容。 Q5 \6 j7 Q& h3 E0 N* f- M& T; J
2 m$ c0 ^4 h9 ~1 C. @+ ` -其他敏感信号远离噪声大的走线
* p7 N, o7 O- {* Q8 t& \, I8 L# j- k+ M% D! X, C
• 比较敏感的走线& r. x- \: j# b
; V8 s: u% z$ Z
远端输出电压侦测运放的输入／输出 (Vos+/-, Diffout), 同步脉冲输入端 (PLLFTR), 同步脉冲输出端 (CLKOUT)+ M2 F8 c3 s q6 ^
' ]) C4 I# m- D% V& ~/ r4 b -同步脉冲输出端 (CLKOUT) 是一个敏感信号，同时也是噪声较高的信号，与其他的小信号走线分开。& i3 V* M0 O+ W+ \" |# X& Q2 k1 c( |
' c# w( I+ X% J+ L
• 噪声最大的走线 / |' n1 A( o4 m
1 k; _/ `" [" CSW, TG, BOOST, BG
0 c. m" w2 U1 P0 B7 a& U" ~6 B% b h2 x& ?
-与其他的敏感走线分开7 Z; Q% k$ d. C( X7 j7 J: {
: @5 w( S; R' n( D b
-在相邻的两层上避免SW铺铜与敏感走线重叠2 |2 p2 \: ]& l- d4 c: t/ L6 P3 T/ }
: M& b$ q, i. l0 w, N& V7 Y% | -SW和TG走线尽量近的走线或差分线，以降低回路的阻抗
. N; S4 B2 w, b7 S) f. g5 H3 i; V4 a) v
( q( R4 P) J2 B% O; n+ x' q • 功率部分1 k t3 W7 k, S
+ z& H# w6 ]' ~9 F2 e$ P1 y1 z& K# M) \ -功率器件摆放
6 b: R( C. p G
9 v& C x5 z6 I- ]" l: H' B -铺铜规划
1 D: f6 g( X' b7 B7 L
9 _: J1 [4 n9 x% x -找出有电流断续的回路( G0 V$ ~8 n; F r
" y4 a, r, q7 D/ t. K t' Y -去耦电容距离MOSFET近' F* s$ L2 O4 d
2 V* a& w( C4 L8 B3 |, t, G" d- o -大电流走线短、宽，过孔多: q0 C0 y# [" f* B9 W# g
% X5 A8 e; V; V; Y. m8 B7 P
• 控制器部分1 k' t4 A+ A( J3 a4 e
- }( s% f, E$ t, ]
-去耦电容距离芯片近
" z; q" c4 J2 f9 E2 O8 c2 E
$ d( o' p: H; D -SGND、PGND分开
1 ^0 f4 X: H0 n
4 Q L7 o( l' D; p -电流采样电路0 B9 i8 P; e7 q2 H/ \% `1 n0 f
- G4 B N% J. `, e4 e
-敏感走线、噪声高的走线分开$ x, Q$ B9 Q2 ?7 y. p0 U
Z6 q1 G2 m+ k* U
-驱动信号走线' l7 S) v) m- A8 S7 H! E8 H
, p3 U# V. W2 e, {! b$ b( @
-选择合适的线宽6 s, U# {1 M: c# w4 W4 J( I
" |+ d4 F. C3 S( \4 o* D1 \8 r9 x
布局走线分析范例* X9 `4 c C- V/ H
7 f+ c' e( Q: B5 l( j
) {2 K* G% b! Q4 l6 Z
% F& F" A+ m# M4 U5 R0 v) { |
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/1 
发表于 2019-2-18 14:22
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