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某公司高级layout工程师面试题目,看看你会几题

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发表于 2018-12-17 15:38 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 ygcgsa 于 2018-12-17 15:40 编辑
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某公司高级layout工程师面试题目,看看你会几题。. c8 Z: N' f# Y6 ~/ x+ F- d  q$ G: I$ \- l

8 C+ B7 M2 e- e. J是拉线工,还是高级工程师,看看你们平时的积累如何。6 G5 G! n9 a' T7 d$ O1 U
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& f9 [' ~, |) u" E. X1,pcb上的阻抗怎么控制?
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5 [$ O: {- U! ?. K2,信号线的传输速率是多少?. ?4 l( T# i: I& X  O9 x6 R

4 n0 D# H& c* B; b( @8 Q' }3,CMOS器件输入管脚在电路中要如何处理?为什么?. E/ W  v3 [, h6 l2 H* x

- Z1 a1 ]! d0 }) n& f4,TTL电路不能直接驱动CMOS电路的原因是什么?9 g) h" B4 K% ^' _+ m
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5,较长的时钟信号要走带状线的原因是什么?
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6,四片DDR2顶底对贴布局需要注意哪些方面?试讲出其中六点。
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4 ?6 X  z2 h3 Z1 k' K$ e$ G& s7,ODT信号有什么作用?layout应如何处理?! l7 v# w( J) ~& Q
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3 ~7 I& ]3 t- Q/ f( R8,VTT和VREF是否能共用?为什么?$ N6 u/ K$ J& b1 M
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9,DDR3的最高工作频率是多少?# J6 ^* o0 U; v6 `7 e8 P$ P2 [5 B( `1 z+ Z
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& p1 Q& w1 r  k" D9 Q) c10,多片DDR3为什么优先走fly-by拓扑?
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  • TA的每日心情
    开心
    2020-3-16 15:23
  • 签到天数: 7 天

    [LV.3]偶尔看看II

    推荐
    发表于 2020-1-3 16:34 | 只看该作者
    确实是高级layout工程师的问题,有些问题对于只关注layout本身,不关注原理设计方面知识确实还不清楚

    该用户从未签到

    推荐
    发表于 2021-12-30 14:21 | 只看该作者
    学习                     

    该用户从未签到

    推荐
    发表于 2018-12-18 09:42 | 只看该作者
    泛泛而谈,如果事先没关注过,可能答不上来,还不如让面试者当场LAYOUT一下呢

    该用户从未签到

    5#
    发表于 2018-12-18 17:28 | 只看该作者
    不适合面试LAYOUT.

    该用户从未签到

    6#
    发表于 2018-12-19 09:03 | 只看该作者
    看来面试还的加强问题  光干活不行啊
  • TA的每日心情
    奋斗
    2020-1-3 15:00
  • 签到天数: 5 天

    [LV.2]偶尔看看I

    7#
    发表于 2018-12-23 19:57 | 只看该作者
    好多问题不清楚呀

    该用户从未签到

    8#
    发表于 2019-1-18 11:38 | 只看该作者
    求大神的标准答案!

    该用户从未签到

    10#
    发表于 2019-6-28 14:21 | 只看该作者
    这个需要学习一翻
  • TA的每日心情
    开心
    2020-5-19 15:54
  • 签到天数: 1 天

    [LV.1]初来乍到

    12#
    发表于 2019-12-19 13:08 | 只看该作者
    某公司高级layout工程师面试题目

    该用户从未签到

    14#
    发表于 2020-1-3 16:39 | 只看该作者
    答案呢?兄弟
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