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关于CML接口电平的疑问

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发表于 2018-11-26 21:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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) Z4 C: c7 u7 p# W  z! k4 `& r上图为CML接口,左侧为发送端,右侧为接收端,在没有AC耦合的情况下,VOUT+的共模电压为VCC-0.2,  I( l2 h$ ^# P9 }) @) N0 N+ b7 a2 E6 o
但是加上AC耦合电容后,Pspice仿真的情况和理论不一致,8 v# {6 X; P4 b) i7 I
理论中AC耦合后,VOUT+的共模电压为VCC-0.4,R1和R2的直流分量为8mA,VOUT+交流耦合部分的电流为+-8mA' t, S1 `0 A* k+ O4 D! e# g  N
可是实际中SPICE仿真的情况时,VOUT+的共模电压为3.1V;而且VOUT+的交流耦合部分的电流为8mA和0mA;VOUT-的交流耦合电流为-8mA和0 , H( N- ~5 @# k# _* i+ i7 y! G2 G  y
% \; o0 ^9 m! @
是哪里出问题了吗?谢谢~9 }+ k+ g% Y: L. |. R

2 B* S" H5 F' d+ o( p& J( C! T! X0 u# {4 j  y

  |: v+ c& y) B8 A! k; d! i3 u- D) }/ V; _0 C2 N

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3#
 楼主| 发表于 2018-12-3 12:24 来自手机 | 只看该作者
已解决,over

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4#
发表于 2018-12-3 19:27 | 只看该作者
很好学习了

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5#
发表于 2018-12-4 11:59 | 只看该作者
很好学习了
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