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使用2个ADUM4401隔离芯片接SPI,调试发现MOSI信号高电平只有2V

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  • TA的每日心情

    2022-5-11 15:11
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    [LV.7]常住居民III

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    1#
    发表于 2018-8-22 19:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    产品要SPI信号要隔离,采用ADUM4401隔离芯片,2个隔离芯片并在同一个SPI上,在调试时,测量MISO信号高电平只有2V 左右,把其中一路断开测量信号正常达到3.3V。请教一下大神有谁遇到过类似问题没有?原理图见附件。

    QQ拼音截图未命名.png (142.96 KB, 下载次数: 1)

    QQ拼音截图未命名.png
  • TA的每日心情

    2022-5-11 15:11
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    [LV.7]常住居民III

    2#
     楼主| 发表于 2018-8-22 20:13 | 只看该作者
    分析怀疑是输出端有上下拉电阻导致的,手册没有具体内部架构图,无法验证

    该用户从未签到

    3#
    发表于 2018-8-22 21:32 | 只看该作者
    你两个芯片共用一个CS PIN,这样子你觉得合理吗?

    该用户从未签到

    4#
    发表于 2018-8-22 21:36 | 只看该作者
    CS信号要分开。。。。。。这简单的错误
    * I7 Y4 C9 P4 f$ K5 [- @/ H: M, @

    点评

    cs 是改过 了  详情 回复 发表于 2018-8-23 08:09
  • TA的每日心情

    2022-5-11 15:11
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    [LV.7]常住居民III

    5#
     楼主| 发表于 2018-8-23 08:09 | 只看该作者
    myiccdream 发表于 2018-8-22 21:36
    + J8 N( d+ v0 w1 A8 SCS信号要分开。。。。。。这简单的错误
    4 u  p, h) T0 Q1 E  u
    cs 是改过 了9 R  K4 D4 n9 }" J' |: G# p2 Q

    点评

    你做原理图的时候难道没有注意到VE1和VE2这是干什么的嘛? 2个往主机发的管教都是使能, 这不总线竞争才怪  详情 回复 发表于 2018-8-23 08:37

    该用户从未签到

    6#
    发表于 2018-8-23 08:37 | 只看该作者
    本帖最后由 myiccdream 于 2018-8-23 08:50 编辑 ; ]  j6 n8 C* |. N2 D! o" K

    - w6 X& u) H1 b4 @9 Q0 q
    把一个芯片的 VEx 拉低看看。确认一下是不是芯片造成总线竞争了

    该用户从未签到

    7#
    发表于 2018-8-23 11:23 | 只看该作者
    总线接一起在一起的话要确定空闲时的状态是否是高阻态,不是的话会相互影响。

    该用户从未签到

    8#
    发表于 2018-8-26 14:36 | 只看该作者
    有下拉电阻的话可以去实测,看下下拉接多少电平一半

    该用户从未签到

    9#
    发表于 2018-8-31 09:26 | 只看该作者
    你2个隔离芯片的 使能都是打开的,然后隔离的5V上拉,那你输出的MISO就是H,相当于一个芯片把总线拉高的,然后你操作另一个芯片,数据回来的时候,如果是H还好,如果是L,那就肯定只是半幅的电平了,肯定没法通讯了,所以加个IO控制隔离芯片的VE吧,不然逻辑冲突。
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