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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › Allegro画好的PCB天线封装无法放置
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楼主: 六画玄辉
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Allegro画好的PCB天线封装无法放置

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六画玄辉

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16#
 楼主| 发表于 2018-5-2 09:46 | 只看该作者
這侽孓譙悴丶 发表于 2018-4-28 17:53
$ Y% }3 P& T- P: A1.只需要做两个PIN即可，你PCB做了三个PIN，shape焊盘也算一个PIN，然后你两外还放了两个焊盘，总共3个， ...

3 t0 k8 x' V- f: Q$ n您好！我把你这个封装替代掉我之前的，然后改原理图，重新生成新的网表。在Allegro PCB 中place时还是之前那个。我有试过update symbol还是一样。不知道如何把更改的封装更新到PCB中去# Z- \* ?2 y4 e' d3 o

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這侽孓譙悴丶
可以把库里面的封装替换掉，然后把PCB上的封装删掉，再去更新试试！  详情 回复 发表于 2018-5-2 11:09

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這侽孓譙悴丶

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17#
发表于 2018-5-2 11:09 | 只看该作者
六画玄辉 发表于 2018-5-2 09:46
* O0 n5 v# n( x% G+ l您好！我把你这个封装替代掉我之前的，然后改原理图，重新生成新的网表。在Allegro PCB 中place时还是之 ...
% t0 K  x( Y) ~
可以把库里面的封装替换掉，然后把PCB上的封装删掉，再去更新试试！
* n! `* J. h9 [$ `, d4 i

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六画玄辉
我就是这样弄的，会报错。原理图我是改了，封装库的封装也更换了，但是重新导入到allegro PCB中，放置时还是之前的那个封装。我也试过用update symbol也还是一样。  详情 回复 发表于 2018-5-2 11:32

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六画玄辉

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18#
 楼主| 发表于 2018-5-2 11:32 | 只看该作者
本帖最后由 六画玄辉 于 2018-5-2 11:42 编辑
, I# ]2 f' b+ ?+ a+ O9 k
這侽孓譙悴丶 发表于 2018-5-2 11:092 f/ e, l. S" O5 ~! r9 R) m: L( r# ?/ v
可以把库里面的封装替换掉，然后把PCB上的封装删掉，再去更新试试！
6 n( h0 X8 c  x* ?
我就是这样弄的，会报错。原理图我是改了，封装库的封装也更换了，但是重新导入到allegro PCB中，放置时还是之前的那个封装。我也试过用update symbol也还是一样。
5 Z, S5 {: S) ^- g& g

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六画玄辉

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19#
 楼主| 发表于 2018-5-2 12:07 | 只看该作者
本帖最后由 六画玄辉 于 2018-5-2 12:09 编辑 2 z: n. C& L, ?6 `2 f' O1 ]
  |2 L" H# @/ M! c7 V3 ~. y
导入网表时提示封装找不到pin2脚8 I1 L; U) c8 |1 f1 o, \; D& U# A5 W

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這侽孓譙悴丶
检查你原理图器件的pin number是否与PCB封装的pin number对应。从报错提示来看是没有定义2脚，也就是说pin number对应不上，原理图器件的pin number修改成与PCB封装的pin number对应即可，比如你原理图上这个封装有  详情 回复 发表于 2018-5-2 12:16

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這侽孓譙悴丶

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20#
发表于 2018-5-2 12:16 | 只看该作者
六画玄辉 发表于 2018-5-2 12:07- h5 I7 Z1 a& p0 b* [6 |8 [3 T7 z
导入网表时提示封装找不到pin2脚
4 w8 z: F: k: L; O. V9 p$ x
检查你原理图器件的pin number是否与PCB封装的pin number对应。从报错提示来看是没有定义2脚，也就是说pin number对应不上，原理图器件的pin number修改成与PCB封装的pin number对应即可，比如你原理图上这个封装有两个脚，pin number分别是1和2,那么，你PCB封装的这两个焊盘的pin number也必须是1和2，如果是1和3，那么PCB封装上的3与原理图的2就对应不上了，就会提示你截图的那个报错了！
. `  {# k: ?  O; q3 b8 K( e

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六画玄辉
还是弄不来，我确认下原理图是两个PIN，封装是用的你发给我的那个封装，也是两个PIN。但是PCB中还是之前那个我画的那个一个PIN的封装。Allegro PCB不知道怎么同步。AD很容易只要你改了封装都会同步进去，Allegro的数  详情 回复 发表于 2018-5-2 14:06

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六画玄辉

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21#
 楼主| 发表于 2018-5-2 14:06 | 只看该作者
這侽孓譙悴丶 发表于 2018-5-2 12:16# ^1 d: [4 a" X! Y, g9 d. {8 B! H
检查你原理图器件的pin number是否与PCB封装的pin number对应。从报错提示来看是没有定义2脚，也就是说pi ...

  U" X8 `& ?' t还是弄不来，我确认下原理图是两个PIN，封装是用的你发给我的那个封装，也是两个PIN。但是PCB中还是之前那个我画的那个一个PIN的封装。Allegro PCB不知道怎么同步。AD很容易只要你改了封装都会同步进去，Allegro的数据管理方式不知道怎么同步0 i) a: l. b$ X& q

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這侽孓譙悴丶
把原理图和PCB发上来！  详情 回复 发表于 2018-5-2 16:50

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這侽孓譙悴丶

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22#
发表于 2018-5-2 16:50 | 只看该作者
六画玄辉 发表于 2018-5-2 14:06, q9 X" [) E5 p0 X
还是弄不来，我确认下原理图是两个PIN，封装是用的你发给我的那个封装，也是两个PIN。但是PCB中还是之前 ...

0 ~* f* N$ K/ y: [2 n5 Z# D把原理图和PCB发上来！
& l0 |$ \* ~2 f

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六画玄辉
请教下，allegro如何设置快捷键，对布局的时候经常用到的旋转，对齐这些快捷键怎么设置？  详情 回复 发表于 2018-5-3 08:53
六画玄辉
我按照你的方法重新做了一个shape封装，改了下封装名字就可以了，不会报错。  详情 回复 发表于 2018-5-3 08:51

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六画玄辉

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23#
 楼主| 发表于 2018-5-3 08:51 | 只看该作者
這侽孓譙悴丶 发表于 2018-5-2 16:507 z  K$ B: m: S& S# o( n
把原理图和PCB发上来！
) s7 z7 m; o$ k, P0 h- d' L4 [
我按照你的方法重新做了一个shape封装，改了下封装名字就可以了，不会报错。
& D" c8 K; z# H3 e0 A. E: ?

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六画玄辉

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24#
 楼主| 发表于 2018-5-3 08:53 | 只看该作者
這侽孓譙悴丶 发表于 2018-5-2 16:509 \& K  y0 `$ O+ ~$ l6 ?
把原理图和PCB发上来！

% U8 j8 M5 H$ g2 }: ?2 [0 g9 {请教下，allegro如何设置快捷键，对布局的时候经常用到的旋转，对齐这些快捷键怎么设置？8 V3 [3 y6 Q) f$ J# N0 Z) N  I

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這侽孓譙悴丶
快捷键设置个人习惯在cadence\SPB_15.5.1\share\local\pcb\site.env设置，以下是个人自己常用的一些快捷键设置，可以参考一下！前面a是格式开头，中间是快捷键，后面是对应的命令！ [attachimg]138074[/attachi  详情 回复 发表于 2018-5-3 09:30

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這侽孓譙悴丶

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25#
发表于 2018-5-3 09:30 | 只看该作者
六画玄辉 发表于 2018-5-3 08:53
0 u. b; k/ L0 f) h7 S: ]5 S" n+ }请教下，allegro如何设置快捷键，对布局的时候经常用到的旋转，对齐这些快捷键怎么设置？

  J9 U8 d8 h# f. |+ C2 g9 O快捷键设置个人习惯在cadence\SPB_15.5.1\share\local\pcb\site.env设置，以下是个人自己常用的一些快捷键设置，可以参考一下！前面a是格式开头，中间是快捷键，后面是对应的命令！
& I  h5 ^$ u, Y% o; E3 T. Y" i- f' a' j% V2 H
9 C3 a) X/ l8 j2 I: [/ e

8 q1 T/ k8 y- X/ ^0 D4 v" e9 V) b+ b  [/ U

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六画玄辉
谢谢您！我搜索了下你提供的那个文件（site.env），没搜索出来，可能是版本不一样，我用的16.6。另外请教下，出现下图这样的情况要怎么设置：红色那个是在allegro PCB中飞线是一定飞到那个角落，很郁闷，而且布线也  详情 回复 发表于 2018-5-3 10:59

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六画玄辉

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26#
 楼主| 发表于 2018-5-3 10:59 | 只看该作者
這侽孓譙悴丶 发表于 2018-5-3 09:30- q0 i/ t$ p& }7 T' R9 A
快捷键设置个人习惯在cadence\SPB_15.5.1\share\local\pcb\site.env设置，以下是个人自己常用的一些快捷 ...

, m* S( r0 \/ `$ v' b# l谢谢您！我搜索了下你提供的那个文件（site.env），没搜索出来，可能是版本不一样，我用的16.6。另外请教下，出现下图这样的情况要怎么设置：红色那个是在allegro PCB中飞线是一定飞到那个角落，很郁闷，而且布线也是布到那个角落里，而不是最近的。绿色那个是我做封装时设置的原点坐标。
  O7 E7 [+ Y3 N* k* q6 k# g* `4 d + F5 `9 K+ O1 `$ M& Z4 c

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mia0830
tools--utilities 里面有个env variables ，看你的env 路径设置的是什么就能找到那个文件了。set envpath 的这一行  详情 回复 发表于 2018-5-9 19:05
這侽孓譙悴丶
1.site.env从15，16和17都一样可以用的！ 2.走线连接到那个角落是因为你天线封装的shape焊盘的原点设置到了那个角落去了，修改下shape symbol的原点，然后更新封装即可！  详情 回复 发表于 2018-5-3 11:27

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发表于 2018-5-3 11:27 | 只看该作者
六画玄辉 发表于 2018-5-3 10:59; t/ D! C/ M7 A5 s$ Y/ ~' q
谢谢您！我搜索了下你提供的那个文件（site.env），没搜索出来，可能是版本不一样，我用的16.6。另外请教 ...
2 z2 A# d, ?: a+ M$ w% a
1.site.env从15，16和17都一样可以用的！& e6 h# |$ ^4 k+ X9 c
2.走线连接到那个角落是因为你天线封装的shape焊盘的原点设置到了那个角落去了，修改下shape symbol的原点，然后更新封装即可！8 }) B$ c: B' n/ b7 m

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六画玄辉
你好！我设置了shape焊盘的原点（包括top层 ，paste top层以及封装的原点），但是在updare symble时（更新时选择更新shape）就出现这样的情况，不知道你有没有出现过，下图是我update symbol是点击的选项和更新后PCB  详情 回复 发表于 2018-5-6 10:21

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六画玄辉

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28#
 楼主| 发表于 2018-5-6 10:21 | 只看该作者
這侽孓譙悴丶 发表于 2018-5-3 11:27% q+ X% x% ~/ [, k6 P
1.site.env从15，16和17都一样可以用的！
: R, f, s4 x; R2.走线连接到那个角落是因为你天线封装的shape焊盘的原点设置 ...
( S' P2 J- R( J8 B" {
你好！我设置了shape焊盘的原点（包括top层 ，paste top层以及封装的原点），但是在updare symble时（更新时选择更新shape）就出现这样的情况，不知道你有没有出现过，下图是我update symbol是点击的选项和更新后PCB封装的结果
& }- T' G# c) K3 M4 V

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mia0830

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30#
发表于 2018-5-9 19:05 | 只看该作者
六画玄辉 发表于 2018-5-3 10:591 P" T) o1 K( D8 J3 b& r8 _
谢谢您！我搜索了下你提供的那个文件（site.env），没搜索出来，可能是版本不一样，我用的16.6。另外请教 ...
' o8 L( k+ M# \4 w/ x
tools--utilities 里面有个env variables ，看你的env 路径设置的是什么就能找到那个文件了。set  envpath   的这一行
& U! x% F  Q! s0 [* I- [8 i

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