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[Cadence Sigrity] 求教:SystemSI 仿真DDR,controller和DDR的电源出现异常趋势。

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发表于 2017-11-22 10:45 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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新手请问一下:使用DDR仿真中发现的问题:
% S1 k3 Z7 v: b) J) L2 F1 U使用PowerSI 提取了S参数,我提取了电源和DDR DQ进行仿真,发现如果仿真bit的运行时间小与100ns左右没有什么问题,但是当大于100ns后发现controller与DDR处的电源异常上升或者下降。所以就出现仿真出来的DQ向下或者向上移动的状况,如果仿真bit多的话,就看到了一条带尖峰的直线,这个尖峰能达到1e300的电压值。情况是无论仿真使用idea电源还是VRM都有这个问题,只有我把VRM和他的连接删除,然后仿真才是正常的。
! R: n* k, {! T( w3 N2 {% P/ r8 h附图分别为0 F5 G& ~, f" ?* o/ `# Z

+ U  W& I0 r5 }/ S; P) C+ P想问一下这个电源S参数提取有什么问题么?大概是什么问题导致的。" k! q: \7 q' |+ N9 ~; }2 ^

6 _( A3 o' Z6 x8 _/ U谢谢!7 _! X0 m4 C; x7 N

DDRDQpower.PNG (27.12 KB, 下载次数: 0)

DQ信号异常上升,VRM电源正常,PCB处VRM(噪声小的灰金色)DDR与controller(棕色和橙色重叠)处电源

DQ信号异常上升,VRM电源正常,PCB处VRM(噪声小的灰金色)DDR与controller(棕色和橙色重叠)处电源

DQ.PNG (18.45 KB, 下载次数: 0)

DQ信号异常下降

DQ信号异常下降

捕获.PNG (15.59 KB, 下载次数: 0)

仿真时间长,尖峰把开始正常仿真结果冲掉了

仿真时间长,尖峰把开始正常仿真结果冲掉了

该用户从未签到

3#
 楼主| 发表于 2017-12-11 09:30 | 只看该作者
最后发现:电源部分提取全部或者部分使用了50ohm的ref,全部改为1ohm后,就没有这个现象了。
  M; ~1 |, L# s3 f具体原因暂时没搞清楚。

点评

请教下,controller的模型怎么获取么  详情 回复 发表于 2018-1-25 16:39

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4#
发表于 2018-1-25 16:39 | 只看该作者
莠秀山水 发表于 2017-12-11 09:30' X8 Z" E+ k" _; L
最后发现:电源部分提取全部或者部分使用了50ohm的ref,全部改为1ohm后,就没有这个现象了。
, S& o/ K$ ^% {. G2 }具体原因暂时 ...
. Z; Q1 n, N- [4 E( Q2 ^+ B! Y
请教下,controller的模型怎么获取么9 o/ Q9 K5 t. x& Z0 c% n

点评

可以询问相关 Controller 厂家,如果没有的话,可以考虑直接使用SystemSI 自己生成的。  详情 回复 发表于 2018-4-9 14:34

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5#
 楼主| 发表于 2018-4-9 14:34 | 只看该作者
Simentic 发表于 2018-1-25 16:39
( U5 S: F: v: F! L请教下,controller的模型怎么获取么
5 h: Q4 j. o7 F5 ?) Z0 @
可以询问相关 Controller 厂家,如果没有的话,可以考虑直接使用SystemSI 自己生成的。7 N, [0 o/ a! W" N0 X' @
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