Sigrity做DDR SSO噪声分析仿真，选在的PCB板设置Setup bus group出现问题。

clovep · 发表于 2017-11-8 16:40

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Sigrity做DDR SSO噪声分析仿真，选在的PCB板设置Setup bus group中Controller page选择期间后，下一步无法看到对应模型。请大牛帮忙分析下原因；谢谢！

wjy870825 · 发表于 2017-12-18 21:15

等回复，学习学习

L☆√￠‰ · 发表于 2017-12-20 10:04

你前面是不是已经设置过一次BUS了？下面显示有网络了？

把下面的全删了，重新设置就可以看到了

zjt289198457 · 发表于 2017-12-30 08:46

问题看的不是太明白啊！！

gaiwu · 发表于 2017-12-31 22:26

支持楼主

chuchengyong · 发表于 2018-1-23 09:50

cqrxcqrxcqrxcqrxcqrxcqrx

chuchengyong · 发表于 2018-1-23 09:50

:):):):):):):):):):):):):):):):):):):):)

lature · 发表于 2018-1-23 11:01

等我走到这步看看

EDA_sudarlik · 发表于 2018-1-24 17:06

加模型要手动添加文件所在的路径

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[Cadence Sigrity] Sigrity做DDR SSO噪声分析仿真，选在的PCB板设置Setup bus group出现问题。