2017年8月19日公益PCB评审报告节选

EDA365QA

1.  电感走线没加粗.

8 k" u. W1 I4 {: I% ]

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2.  DQGATE没等长.
5 V" h9 M0 }0 J8 v6 {  {6 R

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3.  422,485,CAN没走差分.

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4.  网口的隔离最好所有层切一致.
7 B; H# C3 H; E9 W/ D
- S( k' {+ M: r# x- U

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5.  电感放到变压器分隔处做上下隔离，中间不要穿铜.

* c6 h( _. ~6 t2 c7 @

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6.  变压器中心抽头没加粗.

4 X6 i! v4 c$ ^! z# }

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7.  电源输入隔离不要有重叠.

0 j8 ]& ]& @3 K1 {6 U: Y

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8.  1.2V上面的铜多余，下面的铜宽度不足.

" E8 O9 f2 X3 i4 C$ `8 i

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9.  尖铜切掉.
. o( F2 G4 T: y/ J

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10.  RST没有参考面.
2 k# R: {4 T+ y1 {: l* `+ P
& y3 C9 _6 Z. a

紫菁

支持

10929390

飞梦

过来看看，学习学习！

qilinwang66

fengyu6117

EDA365QA 发表于 2017-8-21 09:03
% v/ \" `0 B! X6 \& ]7 y2.  DQGATE没等长.

DQGATE是什么信号，DDR4的吗？没注意过
0 T  G! z7 y- _