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2017年7月19日公益PCB评审报告节选

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1#
发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  音频模拟线加粗走类差分.3 c( }% q, m* v& Y
3 I1 u# P, E  D: O1 a5 i7 T7 \

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发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:32
+ Y5 Q5 g9 H  V6 @$ n, a请问这条如何理解? pcb小白求教
" @5 M3 j. D0 Q; }: P4 {3 X* r& u
1.平面铜只有一个VIA,肯定的说这块铜没有作用.
9 `( i) y( u/ x7 e- O/ ~! i8 w1 K2.电源被VIA隔小了,电源通路太细.
  n. e& n7 q6 p* Q) T: F

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发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:58/ D4 \8 k+ E6 x9 [
10.  平面铜只有一个VIA,电源被VIA隔小了.

5 g4 y2 j" ]7 }请问这条如何理解? pcb小白求教
2 }* u$ h  e- B2 m6 u0 c# j( m! t

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 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.
* g2 m; j/ R: P! Z! X. Y! x0 n! j9 Q 3 y# _& q& }! G2 a0 c5 k5 ?9 J

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2#
 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线.
4 V- s) [9 @8 o( E# f5 J: E 8 O+ }6 f4 z. G9 Q: {: I) m9 g

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3#
 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.
8 G/ U( _, M4 S6 T% a# y5 f9 \
7 C+ A+ x- g  q1 i  b

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4#
 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.$ W4 P) |' o3 G* L
- S4 f, V& G, g

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5#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.3 n0 N: S/ b4 B" `

0 v% F/ v1 o) M! ]' c

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6#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.
% R- \/ ?; f  Z& r  k! t 1 w: N( b& l9 P% v! s

点评

啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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8#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径.
* P) k$ }  ~6 a4 k * q# T) L8 _4 e! b* q: w

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9#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区.
% P8 z0 q0 _  Q) I2 o# j 2 T; z6 u4 B9 K  h: {& Z. H

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10#
 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了.: Y9 Z& k% _' J, `8 q! u7 w

) }$ k( W% c8 A( S4 o% @! }  u6 s- ?

点评

请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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13#
发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊7 z9 k, g* M8 w$ x
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