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2017年7月19日公益PCB评审报告节选

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1#
发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  音频模拟线加粗走类差分.3 G4 ^; P8 w9 w# M7 m) g( M
! B4 E( m/ f  t, k/ G

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发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:32
: U7 N* u% }6 x! k请问这条如何理解? pcb小白求教

, Q/ K- z% U% e  [" Z1.平面铜只有一个VIA,肯定的说这块铜没有作用.1 g- M& s9 ]6 S9 T0 x
2.电源被VIA隔小了,电源通路太细.
. M, J2 @2 e+ e+ U. r- @

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发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:58
) e! F) A5 D" D# Y7 t+ ]8 t10.  平面铜只有一个VIA,电源被VIA隔小了.

" V# S9 A+ W$ \! s2 B9 {请问这条如何理解? pcb小白求教! x3 z2 o/ m5 |% m, ]2 X

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 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.4 W/ h: r8 e. D
2 ~5 A2 b- u* [! H0 ?

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2#
 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线.
' H7 G' r* B! W: Q* I
, I! X$ }* d+ p/ X& g/ `

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3#
 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.
- ^, ~# k& X# V* u( B9 W3 n : d! ]" W) J& r) R5 f3 j

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4#
 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.
: t0 M& G0 |! H, S1 l& J
7 t( O  i. w# x  e

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5#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.
: ~) K9 B' f; E, G3 z$ | + z1 ^1 g. k1 Q

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6#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.
( X( j3 J6 |/ s" I7 _, x& ?
: b& A2 J9 ]$ ]$ U. z9 P# r! \

点评

啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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8#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径.
- g0 u5 L7 B/ Q) K
% Z5 H5 B4 t6 R7 F: W, ~6 F

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9#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区.0 \$ a. `% C3 o
( E2 e# c. R! B

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10#
 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了.
% a8 ^& G( {6 v/ o" a: p% F/ Z1 w ) R: w& _5 U2 a$ t7 e

点评

请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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13#
发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊
0 n( i: ?; S) w8 ~; N
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