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2017年7月19日公益PCB评审报告节选

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1#
发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  音频模拟线加粗走类差分.
7 x9 V* j* o# h  P! l. H
- a, G: q& P/ ~: K+ N7 m

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推荐
发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:32
4 K4 A! Y2 `3 H3 S) t请问这条如何理解? pcb小白求教
0 b/ i# c- f7 h1 k
1.平面铜只有一个VIA,肯定的说这块铜没有作用.
3 y" N  s3 {6 o" ?/ ^2.电源被VIA隔小了,电源通路太细.

/ T1 q) C2 Y! J# o7 p& E- m; T& r! O1 ]

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推荐
发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:58& Y2 c: j/ X' v$ o
10.  平面铜只有一个VIA,电源被VIA隔小了.

3 |0 N0 R" ], E% _5 D请问这条如何理解? pcb小白求教
0 C2 }; J+ S0 f; g+ }' d

点评

pcb
1.平面铜只有一个VIA,肯定的说这块铜没有作用. 2.电源被VIA隔小了,电源通路太细.[/backcolor]  详情 回复 发表于 2017-7-25 09:28

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推荐
 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.
- \% a6 M. e* L- ?; P , T/ z3 H9 K: f9 @) f

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2#
 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线., E) i, V, Z9 {7 m
$ m2 @9 s1 C( f: Y1 b2 [& t

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3#
 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.8 `2 A9 s3 ~- }0 g& i% ?  @6 q
% g8 R& Q9 _9 P! Z' Z

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4#
 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.+ ~8 @- T$ y- r. Y' k, M& f4 K% T
8 U$ H- v0 M' l: |2 F

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5#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.
# [, S% @: A1 }2 f' U
# K9 b! U) V  U' J/ ^

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6#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.
, A* L" t1 m0 H7 b4 A! b! O & C& M6 y0 n. i# D

点评

啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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8#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径., o1 y5 H$ |/ p( @6 l1 u* E
) I  e* w+ f- z

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9#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区.$ W) Z( @4 W3 q) }' R5 G! \
+ j* s. q. b1 j9 |; ]$ h

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10#
 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了.
9 Y( N4 K+ R, K! I6 F0 {) B1 d' k
* Y1 I/ t& a, y$ l6 L

点评

请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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13#
发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊
8 ]- U* C. E1 G' R+ ^& g7 _: u" h1 Y
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