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[HyperLynx] 关于pin和die上的波形问题。

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发表于 2016-9-6 12:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 color_ 于 2016-9-6 12:03 编辑 # `$ ~- T, D& p! p/ ~( q: l

3 P- H. `) `( V: I" r) \在输出一个ddr2 800 的波形时,pin上和die上波形相差很大,pin上波形出线非单调(有回沟),而die上的波形则没有,% }4 M. h# N. W: H3 c
修改走线对回沟没明显改善。5 E& M' i, j' N% F1 C" ]

6 x3 @1 X& z0 ]. Z单根数据线波形。
2 G  @, i) L" o7 z3 Q5 [% W- |( b- ~5 B" Z) L4 \- |& i
pin上的波形
% y& }. H6 C" F& P- X# ~" R3 @
# e8 N# d: g( G. l+ o' n. p$ e. K& c5 A2 u* X) S

' e. a& i' S+ C5 Tdie上的波形3 H' E; Q+ X; X5 T) t6 R
. }4 y3 H3 F2 w" ]5 n' @
6 ?; h+ d+ [1 j, G, {. H, H! n
想了解一下,是否一般以die上的波形还是已pin上的波形来判定信号是否合格。
9 w$ K, ]$ X; A6 E$ q5 X3 d& _  C5 Z, ?5 @- E; @$ E; a9 V3 {$ n
然后就上升(下降)沿上产生回沟是因为封装的原因吗?
4 a2 d' [' }$ A5 X! [$ U
  • TA的每日心情
    开心
    2022-11-1 15:51
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    [LV.6]常住居民II

    2#
    发表于 2016-10-13 12:17 | 只看该作者
    我觉得是要看die上的波形, 因为最终的信号是在die上面进入内部电路。也有人说只要pin上面的波形符合标准就可以,pin的die芯片公司设计保证可行的,我不是很同意。

    该用户从未签到

    3#
    发表于 2016-10-14 18:20 | 只看该作者
    PIN仿真用在要求不高的场合,要求高的话,需要在模型中加上一句语言,DIE的仿真就会很准了,因为在要求不高情况下,PIN和DIE的仿真相差不大的

    该用户从未签到

    4#
    发表于 2016-10-14 18:23 | 只看该作者
    在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,

    点评

    能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。  详情 回复 发表于 2016-10-17 16:42
    了解了,感谢大神指导。  详情 回复 发表于 2016-10-17 11:15

    该用户从未签到

    5#
     楼主| 发表于 2016-10-17 11:15 | 只看该作者
    ytmgadw 发表于 2016-10-14 18:235 w9 Y: j1 k8 L$ I! I! g9 v
    在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,
      q) k5 _& [6 {7 e4 B
    了解了,感谢大神指导。; ~4 F! ~% W) q& q0 P* }5 v2 k+ T, J

    该用户从未签到

    6#
     楼主| 发表于 2016-10-17 16:42 | 只看该作者
    ytmgadw 发表于 2016-10-14 18:23
    0 c5 A3 \& P5 P: ]在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,
    9 V4 y1 Z- ~# }! D$ M6 c
    能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。# W) W* C& L: g# u( y( X) z

    该用户从未签到

    7#
    发表于 2017-2-20 14:38 | 只看该作者
    DDDDDDDDDDDD
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