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[HyperLynx] 关于pin和die上的波形问题。

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1#
发表于 2016-9-6 12:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 color_ 于 2016-9-6 12:03 编辑
1 B2 I7 r5 A& ~7 o5 t* L+ K% V# ~, h5 n- D$ P) v+ Q4 S
在输出一个ddr2 800 的波形时,pin上和die上波形相差很大,pin上波形出线非单调(有回沟),而die上的波形则没有,7 a; H6 X+ S- d1 c7 O
修改走线对回沟没明显改善。7 @- O9 {/ f' D* l

6 M; C& k) w% N单根数据线波形。
" V& b; U8 ?3 Q5 h" R& B) w& k( T0 x: O5 u( D; J  K- }/ ]
pin上的波形: r7 A+ w: l2 m- l" F8 c

. M2 B7 l& I0 F% T0 f% }0 F# l
. P+ f9 `4 h2 {: o8 h6 y: u
# V" j1 L5 O' v4 i& [$ h' ydie上的波形; p1 @7 H% [8 L" Y
- k! g0 p5 M. ?2 s
  U$ W+ L8 b! b9 ]( }8 v+ G$ n
想了解一下,是否一般以die上的波形还是已pin上的波形来判定信号是否合格。
& N2 o+ W4 y( z! [5 T- h/ ?) v5 K3 L* u/ O$ |( R9 z9 D" y
然后就上升(下降)沿上产生回沟是因为封装的原因吗?2 I+ Y- @( \8 u) O
  • TA的每日心情
    开心
    2022-11-1 15:51
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    [LV.6]常住居民II

    2#
    发表于 2016-10-13 12:17 | 只看该作者
    我觉得是要看die上的波形, 因为最终的信号是在die上面进入内部电路。也有人说只要pin上面的波形符合标准就可以,pin的die芯片公司设计保证可行的,我不是很同意。

    该用户从未签到

    3#
    发表于 2016-10-14 18:20 | 只看该作者
    PIN仿真用在要求不高的场合,要求高的话,需要在模型中加上一句语言,DIE的仿真就会很准了,因为在要求不高情况下,PIN和DIE的仿真相差不大的

    该用户从未签到

    4#
    发表于 2016-10-14 18:23 | 只看该作者
    在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,

    点评

    能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。  详情 回复 发表于 2016-10-17 16:42
    了解了,感谢大神指导。  详情 回复 发表于 2016-10-17 11:15

    该用户从未签到

    5#
     楼主| 发表于 2016-10-17 11:15 | 只看该作者
    ytmgadw 发表于 2016-10-14 18:23
    ; K6 I7 [# q" L在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,

    1 V% N& D* m4 z0 B了解了,感谢大神指导。# H! [2 b' {) e/ _1 U, T0 A% v! q

    该用户从未签到

    6#
     楼主| 发表于 2016-10-17 16:42 | 只看该作者
    ytmgadw 发表于 2016-10-14 18:23
    7 n. d! b' K+ @6 B1 k$ D+ u在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,

    * T7 ]: l  N- W, O* k能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。
    5 A. `) k" }6 a! F  O8 z) u

    该用户从未签到

    7#
    发表于 2017-2-20 14:38 | 只看该作者
    DDDDDDDDDDDD
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