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EDA365电子论坛网»电子社区 › 研发技术版块 › 硬件设计讨论 › 74AHC32 的逻辑图，最后加了两级的非？
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74AHC32 的逻辑图，最后加了两级的非？

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Quantum_

该用户从未签到
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1#
发表于 2016-8-29 21:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
如下图.  为何， 74AHC32 的逻辑图的最后加了两个非。, A; X. |% R+ B1 O: D
1. 不加， 逻辑上也正确。
# l; J7 S, i5 b; R- k$ X2. 为了增加延迟吗？* [' {2 i/ u7 m; p+ f
3. 还是为了驱动TTL?
+ Z8 L& R3 F. I& J# U
; C( e* }6 {; j( L! r6 V. y1 R谢谢！

OR.png (11.62 KB, 下载次数: 1)

OR logic Diag

OR logic Diag

点评

支持！: 5.0
超級狗
支持！: 5
可以送我 2TB 的硬盤嗎？^_^  发表于 2016-8-30 11:19

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超級狗

该用户从未签到
3#
发表于 2016-8-29 23:36 | 只看该作者
jacklee_47pn︰. p8 j2 Z/ z  |  q
讚 !
) h5 Z6 s; A4 A) j. c! M7 W
( H8 R2 M5 d# c; [, x4 s
看！5 ]/ G, r9 H" ]6 t

+ }+ b( c4 P5 @" y& y) C
2 R- K' a* B  X9 n3 c* {' R* C+ g* u1 I) o3 q- Y  l, ]
沒有啦！我是叫大家看內容。
1 t1 D* j7 x2 h1 L) ^$ c3 e4 r& {" I- K4 B( g4 F$ J1 |

点评

jacklee_47pn
也對！ 要用力看，努力看，好好看！ ^_^  发表于 2016-8-31 07:49

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hliu0129

该用户从未签到
5#
发表于 2016-9-21 17:07 | 只看该作者
4楼这个图片，比楼主的问题亮得多。个人认为是同步时序。

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