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发表于 2016-4-26 11:05 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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R_时序逻辑电路设计.pdf

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R_异步时钟域的亚稳态问题和同步器.pdf

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解决初学者疑惑VHDL、Verilog,System verilog比较.pdf

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3#
发表于 2016-4-26 11:40 | 只看该作者
不错,谢谢分享!

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4#
发表于 2016-4-28 14:45 | 只看该作者
积累积累再积累!!!
% L$ r0 q( t, }/ ^0 L* F$ N感谢楼主!

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发表于 2016-4-28 14:51 | 只看该作者
积累积累再积累!!!* D8 {  Y% `0 F7 b( l0 m2 _2 J- G+ i% W* L# C6 k
感谢楼主!
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