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磁珠放置位置问题

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1#
发表于 2016-1-7 21:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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图中IC的3.3V电源为模拟电源,对噪声十分敏感,LDO产生的3.3V只为IC这个模拟电源供电,且LDO和IC的距离也比较近,请问磁珠放在A点合理还是B点合理?
2 l9 g1 [& _2 B, e$ ]$ b  t

QQ图片20160107214801.jpg (137.57 KB, 下载次数: 7)

QQ图片20160107214801.jpg

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发表于 2016-1-13 09:58 | 只看该作者
我说下放B点的害处:  一,增大了电源阻抗。后级IC如有突发电流时,IC的供电波动比较大,不够好。   放LDO输入是恨好的方案

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 楼主| 发表于 2016-1-8 17:23 来自手机 | 只看该作者
MStrong 发表于 2016-1-8 17:00/ k1 P& ]6 m& M. i2 S% U1 W* j0 h
必须是B点
& l, f2 n+ s- Y4 n, h6 g2 t+ s
理由呢?

点评

同意 负载是 SoC,FPGA 等,建议在B点  详情 回复 发表于 2016-1-18 16:01
噪聲要儘早在源頭就做阻擋,後面再擋的話,有時後會擴散到其它地方去。 B 點後的 IC 如果 CPU 、FPGA…… 這類高速器件,有時候 B 點也需要再多一顆磁珠。 因為這些器件,本身就很容成為干擾源。 :lovelin  详情 回复 发表于 2016-1-9 12:58

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发表于 2016-1-9 12:58 | 只看该作者
本帖最后由 超級狗 于 2016-1-12 18:59 编辑
0 M: ~8 p" f, _' I6 A' c$ P
xiaoyu19890210 发表于 2016-1-8 17:23
2 m+ A; l% d/ r3 Q: ^+ Q$ @理由呢?

2 P* V7 D: D5 m: A噪聲要儘早在源頭就做阻擋,後面再擋的話,有時候會擴散到其它地方去。# P3 v8 z8 t# a7 g; M

/ C, }, T7 X0 J% X! nB 點後的 IC 如果  CPU 、FPGA…… 這類高速器件,有時候 B 點也需要再多一顆磁珠。
5 l2 g0 T, J) L
6 K9 h2 F) Q! L, Y  W因為這些器件,本身就很容成為干擾源。
3 p; r& N: E0 W' q" Q! X, g% v7 K! Q% g/ P! F3 J" ^4 T' H3 z
  {% @7 V) ?' l% s
9 q" F% p$ S1 L# C; R5 l' V

点评

支持!: 5.0
支持!: 5
学习了,讲得很好  发表于 2016-1-12 18:03

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4#
 楼主| 发表于 2016-1-8 11:48 来自手机 | 只看该作者
12345liyunyun 发表于 2016-1-8 11:12( `. O$ d2 c9 G8 k2 `
B点
5 K$ W$ V2 J* K* R+ o- E: X; b
能说说理由吗?
' q" W0 ]4 D1 _0 ^' ~# \

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6#
发表于 2016-1-8 13:34 | 只看该作者
不A,难道你要B?

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7#
发表于 2016-1-8 15:44 | 只看该作者
A点滤出进口端高频杂波信号 LDO电源为线性输出

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8#
 楼主| 发表于 2016-1-8 16:31 来自手机 | 只看该作者
fallen 发表于 2016-1-8 12:523 X$ J! d' Q1 q) f2 k' s
显然是A点
+ v: s2 n# n/ i& X/ g/ ?4 E& ]; `1 Y& u
我也觉得应该放A点,不敢肯定,能说放A点的好处以及放B点的害处吗?

点评

优先在前端滤掉,然后LDO稳压,即使有问题也可以有多种选择。  详情 回复 发表于 2016-1-9 23:56

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11#
发表于 2016-1-9 12:49 | 只看该作者
A 點優先,噪聲砍得不夠多的話,B 點再放一顆。
+ E/ i# I$ J7 C* D& ~8 t: M$ p* i5 V& e! a) W) {: N& U

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13#
发表于 2016-1-9 17:13 来自手机 | 只看该作者
真的不错哦

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14#
发表于 2016-1-9 23:56 | 只看该作者
xiaoyu19890210 发表于 2016-1-8 16:31, I& a- @2 l4 Z6 @
我也觉得应该放A点,不敢肯定,能说放A点的好处以及放B点的害处吗?
) P9 O! ], m$ h7 e9 ]' G" X5 }
优先在前端滤掉,然后LDO稳压,即使有问题也可以有多种选择。
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