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PWR(R-PDSO-G28)封装问题

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发表于 2015-2-10 13:58 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在TI的一些芯片里,封装下面带着热风焊盘,外面的引脚相对好画点,但是里面的热风和via怎么规划呢?请指导一下,如下图,这种封装怎么画起来比较容易呢?4 b8 w! z& I- w( v5 t) }2 l" y

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2#
发表于 2015-2-10 15:17 | 只看该作者
同样的东西发两次,表太水噢亲,这个上面写的让你see note D

点评

就是看了没太明白,然后不确定  详情 回复 发表于 2015-2-11 08:16

该用户从未签到

3#
 楼主| 发表于 2015-2-11 08:16 | 只看该作者
kevin890505 发表于 2015-2-10 15:17" |$ Q2 p. ]0 m2 L: K& _) [' l
同样的东西发两次,表太水噢亲,这个上面写的让你see note D
. O: }  ]1 s4 D! R& A7 t
就是看了没太明白,然后不确定
, n- D( Y9 ?9 P& D  a

点评

就是一个铺铜的贴片封装,中间放了一大块铜皮 ,这块铜皮是要接地的(到目前为止,还没发现中间的焊盘接电源或信号) 这块铜皮上可以放孔,也可不放。 TI关于芯片的封装尺寸,都很直观的,要是这个都搞不定,你的  详情 回复 发表于 2015-2-11 13:18

该用户从未签到

4#
发表于 2015-2-11 13:18 | 只看该作者
waterbaby2012 发表于 2015-2-11 08:16- u* y/ W) @. Y
就是看了没太明白,然后不确定
# |+ P2 p9 b3 D( _: I! g4 l* X
就是一个铺铜的贴片封装,中间放了一大块铜皮 ,这块铜皮是要接地的(到目前为止,还没发现中间的焊盘接电源或信号)9 \; A3 O9 z% s8 b# H& T
这块铜皮上可以放孔,也可不放。
5 N0 v: j/ P+ f& x) x8 n/ `: j; CTI关于芯片的封装尺寸,都很直观的,要是这个都搞不定,你的工程制图课程算是白学了。
3 C" F- Q5 j! w% d* l5 C$ K3 G
( }9 E  b4 Q- R$ r! ^

点评

没用过多层板,最近想学学这块,接地的话必须要打孔才行吧,或者埋孔,比如我6层板的话,第2层和5层为GND,那么应该需要打个孔进去吧?或者说是直接在top层跟芯片的引脚连接起来,这样应该也可以吧?谢谢指导哈:lo  详情 回复 发表于 2015-2-13 09:11

该用户从未签到

5#
 楼主| 发表于 2015-2-13 09:11 | 只看该作者
北漂的木木 发表于 2015-2-11 13:18
! i5 w- [& {$ p# q: n" w$ {就是一个铺铜的贴片封装,中间放了一大块铜皮 ,这块铜皮是要接地的(到目前为止,还没发现中间的焊盘接 ...
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没用过多层板,最近想学学这块,接地的话必须要打孔才行吧,或者埋孔,比如我6层板的话,第2层和5层为GND,那么应该需要打个孔进去吧?或者说是直接在top层跟芯片的引脚连接起来,这样应该也可以吧?谢谢指导哈3 D2 {4 T9 ~( j
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