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楼主: snsArvin
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DDR3仿真

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31#
 楼主| 发表于 2015-2-5 08:57 | 只看该作者
Colin_SI/PI 发表于 2015-1-27 18:18+ @' ~- H. I& Q3 I6 ?/ J6 j
DDR3的时序参数是基于标准负载测试的
  [# L( p# B. |" l
谢谢,关于slew rate和建立保持时间的关系,我还是不太明白:为什么slew rate越大,需要的建立和保持都会变大?$ n* V- ^4 _: O  E. {. X, \2 s

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32#
 楼主| 发表于 2015-2-5 09:31 | 只看该作者
shark4685 发表于 2015-1-5 16:444 d7 D; m: ]( p
slew rate越大,相当于信号上升沿约小,所以时序上余量相当于变大了,对应标准就严格。

/ h" n4 L$ V5 K$ q% s% \) Y! V版主,还得麻烦您下,这个问题我还是没太想明白。
' D9 s- w$ f$ l* h# aslew rate越大,相当于信号上升沿越小,这好理解9 R( u6 S3 f* R9 x
但是,时序上升余量变大,这怎么理解?余量大了不是更好么,怎么会要更严格的标准?
: a' }0 i7 X/ ?4 O" E; Q谢谢!!!" r! {( y0 q9 P1 d3 S/ s; ?( Z

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33#
发表于 2015-2-21 10:09 | 只看该作者
好詳細..感恩

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35#
发表于 2016-8-19 15:14 | 只看该作者
学习了 谢谢
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