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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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1#
发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准
( v, r. C; K( G3 ^" i哪位大师可以给参考资料
; D+ ?1 U$ M8 ^! Y# d* I  j

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推荐
发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:02
- M/ V. }. w/ |& U; Y( C# e  n' P我公司的某PCBA 发到 I....公司做测试。
5 V) t! U  T5 _/ B7 k) Z他们反馈的信息是. % U1 g9 e* U; S3 g" m
--Find a problem during return loss tes ...
$ p. Z4 H4 \! ]6 X3 e  U- p2 W
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?
3 v$ [6 ?1 ?9 {1 uReturn Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。
% f3 _. ^+ R3 Z4 u! v& C& `  o& N
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!
6 _0 `5 ?5 ~/ s* ^RL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。8 b* C" \) ~& l. d$ k) \

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4#
发表于 2014-11-22 09:36 | 只看该作者
先参考协议
" P: S" [; b5 R; C# }5 A4 E再根据走线长度来定,关键还是接收端可接受level

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5#
 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36' k5 Y# F5 F  s; s6 a/ j1 W' F  e
先参考协议
7 H+ [( t3 {# J# g再根据走线长度来定,关键还是接收端可接受level

! A9 Y! l* {/ g+ g$ k2 _虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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6#
发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:08
2 a  p" L1 [! P6 m* O0 v+ `  ]虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...
/ `, r3 R- I" n5 f! i( g5 Z
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。( p0 y2 \8 Y) o, g& s6 @' ?! V

点评

那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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7#
 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03
; f$ D: K, r$ r因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

1 a& u' s0 O, T) [3 U7 U我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况6 \) ^/ Q2 B  ^6 f  [

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8#
发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03
$ n! h, n( a3 q( i) `% G因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...
: f, a7 j1 Z" {  ?# l# d, |
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?- U4 {1 P; Z# v% W0 T

点评

建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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9#
发表于 2015-11-1 10:32 | 只看该作者
964008794 发表于 2015-10-31 23:362 B( Y+ g: B& A+ B8 T
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?

2 G" F; J/ m% H" K8 \$ o% Y) y建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

点评

我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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10#
发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:32
3 H# }% P+ Z# ~% q建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...
' L3 L8 Q$ L2 A  e6 v6 @
我公司的某PCBA 发到 I....公司做测试。
# X+ X- p; \# q5 r他们反馈的信息是.
- t0 Q' @8 |. a. \! p% n--Find a problem during return loss test on T..3 connectors.
: J9 J( p: _7 S此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。
% R9 w! p3 \0 N: v我的问题是:
! u9 {* c* _! R6 d1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?
8 t6 o5 y4 f; F4 {* A4 o& N2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!$ x6 N% N7 Q8 p! \- ?

# x: h) f  Q* ]& s! {' m5 v. c+ I. F5 h! g% X$ o* ^+ m

- v+ h+ `& D2 v% Q% p* M3 ~* s( X

点评

1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10

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12#
发表于 2021-9-17 11:18 | 只看该作者
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