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Pspice仿真中分段线性信号源设置问题

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发表于 2014-10-10 17:30 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问大家有谁用过Pspice中的分段线性信号源(VPWL)模块,我现在碰到这样的问题:发现VPWL模块只能支持10个分段,也就是时间只能是从T1~T10,超过了之后就是无效的。但是在实际的仿真中需要的段多于10段,这样的话该怎么样设置?或者说是这个模块最多只能支持10段??0 o# Y2 B' d, _1 \9 h) ?, Y5 B/ }
希望有用过的解答一下。9 ]  s! K- x/ e9 T' S  S4 `
* Y3 N8 l. l5 j8 P0 k

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2#
发表于 2014-10-11 21:22 | 只看该作者
不要用 Proprtity 的設定.
; p/ I; r; \* R改採用分段模擬出需要的波形檔 , 然後組合貼再一起 , 存成一個文字檔
) `: I$ c8 _# L3 i3 D再代到 VPWL 裡面即可.

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3#
发表于 2014-12-12 14:24 | 只看该作者
procomm1722 发表于 2014-10-11 21:22  p, z# \$ o+ v
不要用 Proprtity 的設定.# r9 H( T* A9 f* w/ E. Q
改採用分段模擬出需要的波形檔 , 然後組合貼再一起 , 存成一個文字檔
4 ^& t7 d+ N' k' ~8 L) S再代到 V ...
! ^8 p: P8 o- Y. s0 l
你好,有详细的资料吗?谢谢了。
7 X- q! e! ?# g# p; `! J
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