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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › 电源滤波不够充分，会对抖动产生直接影响吗？

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[仿真讨论] 电源滤波不够充分，会对抖动产生直接影响吗？

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发表于 2021-2-4 11:02 | 只看该作者回帖奖励

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电源滤波不够充分，会对抖动产生直接影响吗？

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TA的每日心情

	无聊 2021-5-13 15:58

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[LV.5]常住居民I

7^#

发表于 2021-2-5 10:29 | 只看该作者

只能说有可能会，具体要看电源内部的处理方式

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6^#

发表于 2021-2-4 17:25 | 只看该作者

本帖最后由 qianxizhiyun 于 2021-2-4 17:27 编辑

chip内部IO在翻转的时候，会从电源轨上吸收电流，由于封装、平面、Ball等的寄生电感，会造成电源轨上电压的波动，可以称之为noise或ripple，这种现象叫做SSN。power noise会影响IO buffer输出的delay和slew rate，会造成jitter，电源影响的jitter可以称之为PSIJ（power supply noise induced jitter）。所以从PI的角度，是要控制power rail的ripple的，对应的一些IP的spec里也会明确给出ripple的range。

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5^#

发表于 2021-2-4 13:26 | 只看该作者

特别是芯片中含有倍频功能，本身相位噪声较大

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4^#

发表于 2021-2-4 13:25 | 只看该作者

信号线的匹配对抖动产生直接的影响

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TA的每日心情

	开心 2020-8-5 15:09

签到天数: 1 天

[LV.1]初来乍到

3^#

发表于 2021-2-4 13:14 | 只看该作者

电源滤波不够充分，时钟参考源太冲太大也会增加抖动成分

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TA的每日心情

	开心 2020-8-5 15:09

签到天数: 1 天

[LV.1]初来乍到

2^#

发表于 2021-2-4 13:13 | 只看该作者

抖动特性绝大部分取决于输出芯片的特性

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