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Net wire has multiple net name

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1#
发表于 2014-7-19 21:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在使用AD10的时候出现以下编译错误
+ G* P1 O0 R! i" a5 r/ U% gNet wire has multiple net name(Net label SRAM_A0. Sheet Entry U_SRAM_InteRFace SRAM_A0(passive))
+ L8 J, `" w8 Q( QWire SRAM_A0# G" p( E6 X. I! s
Net label SRAM_A0
( f7 R7 N3 j& ~4 z0 JSheet Entry U_SRAM-Interface SRAM_A0(passive)
( |4 e; v! o  B: T: Q* |0 w+ V* ]7 ~4 N5 C9 V" _' T$ |" I# U$ k
sheet symbol的图纸
, x" B7 F. ]9 D$ B$ a
$ Z$ c6 [0 x# U. D. e8 f) L& g+ t! M& P, @: d
总的sheet的图纸
3 j9 w9 n& R- V2 \/ G" o3 ]
8 y! s! w: a7 v% ?3 L) v+ I$ _
5 d* u$ u& B) @& m$ V4 I为什么我所有的net name都是sram_a0,他还是说我在一根线上有多个net name。而且仅仅是wARM,导入到PCB还是sram_a0, 不影响PCB layout
2 L5 m1 t3 i' Z$ [$ Z( J很纠结,因为一编译message满是这种错误,也不知该如何解决。很烦

该用户从未签到

2#
 楼主| 发表于 2014-7-19 21:37 | 只看该作者
仅当我将project->project option中的Net identifier scope更改为: \8 o7 J3 J. g7 Y0 b5 C
Global (net label and port global)* d- n. [+ l) i, ]
编译错误会没有,但是这非我所愿,很纠结
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