Net wire has multiple net name

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在使用AD10的时候出现以下编译错误
* k) J1 T# ~  {! _7 DNet wire has multiple net name（Net label SRAM_A0. Sheet Entry U_SRAM_InteRFace SRAM_A0(passive)）
0 v+ S& I9 V: u8 `4 M$ T2 xWire SRAM_A0
2 E3 Q# O- u8 y% Q+ J; M. oNet label SRAM_A0
Sheet Entry U_SRAM-Interface SRAM_A0(passive)

sheet symbol的图纸


/ N- h. {- K! \1 U- p总的sheet的图纸

6 H+ w$ Y2 b3 }
& p0 d. V  x* k8 R( B& }  Y为什么我所有的net name都是sram_a0，他还是说我在一根线上有多个net name。而且仅仅是wARM，导入到PCB还是sram_a0, 不影响PCB layout
% _' `( G* Z0 [5 Q3 e很纠结，因为一编译message满是这种错误，也不知该如何解决。很烦

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仅当我将project->project option中的Net identifier scope更改为
Global (net label and port global)
6 `8 U* U& U0 e, ~2 W1 A  n编译错误会没有，但是这非我所愿，很纠结