Net wire has multiple net name

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在使用AD10的时候出现以下编译错误
) Q9 l9 b! ?9 P0 o# x. uNet wire has multiple net name（Net label SRAM_A0. Sheet Entry U_SRAM_InteRFace SRAM_A0(passive)）
Wire SRAM_A0
Net label SRAM_A0
Sheet Entry U_SRAM-Interface SRAM_A0(passive)
* m' r8 F# [: s- H2 P4 C
& j" W2 x! ]6 T  m/ @$ S# Tsheet symbol的图纸

+ V8 J  @5 Y! o3 R; j) Y
# Q* T. Q/ j3 b. V总的sheet的图纸

; V+ _( g1 c, r: G; G
为什么我所有的net name都是sram_a0，他还是说我在一根线上有多个net name。而且仅仅是wARM，导入到PCB还是sram_a0, 不影响PCB layout
很纠结，因为一编译message满是这种错误，也不知该如何解决。很烦

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仅当我将project->project option中的Net identifier scope更改为
$ r$ {% }- f2 F! g, wGlobal (net label and port global)
) Y+ g0 w- n% D. N0 s* o编译错误会没有，但是这非我所愿，很纠结