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Net wire has multiple net name

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1#
发表于 2014-7-19 21:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在使用AD10的时候出现以下编译错误# [1 }, O& {  _+ i2 u5 y
Net wire has multiple net name(Net label SRAM_A0. Sheet Entry U_SRAM_InteRFace SRAM_A0(passive))- ~1 r/ _1 T! c
Wire SRAM_A0) E6 l$ X! D! `" z9 h" ~$ v' e: U
Net label SRAM_A0- S2 u) }; ~' e! Q: I) w: h4 s# _
Sheet Entry U_SRAM-Interface SRAM_A0(passive)
& j. r$ g% C2 F" i% ^4 a, k  o
  k  N+ G0 U, {sheet symbol的图纸! j- B6 E4 v7 x3 }( I
7 n7 f+ O) k) @3 K% }$ ], M

! ]6 V; X% v& y0 N总的sheet的图纸
( r; `4 g  b6 T1 @: H% P5 ~0 i9 m9 ]
, ~0 Y. V7 {: b3 K
$ i0 u$ d8 y6 _, p- f* t. g为什么我所有的net name都是sram_a0,他还是说我在一根线上有多个net name。而且仅仅是wARM,导入到PCB还是sram_a0, 不影响PCB layout$ J* E0 k( D+ k1 Y8 v9 @# t! c! m
很纠结,因为一编译message满是这种错误,也不知该如何解决。很烦

该用户从未签到

2#
 楼主| 发表于 2014-7-19 21:37 | 只看该作者
仅当我将project->project option中的Net identifier scope更改为& j& x" x- s) p; P8 [9 T) f5 i
Global (net label and port global)
  U6 h' G6 i% e" A编译错误会没有,但是这非我所愿,很纠结
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