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Net wire has multiple net name

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1#
发表于 2014-7-19 21:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在使用AD10的时候出现以下编译错误
5 C( Z! n2 I- `Net wire has multiple net name(Net label SRAM_A0. Sheet Entry U_SRAM_InteRFace SRAM_A0(passive))
4 f4 @" N0 d3 }4 w8 m- yWire SRAM_A0" x* n$ I6 G! ?! N
Net label SRAM_A0, d9 ~' }7 ]5 Q- z5 J! u
Sheet Entry U_SRAM-Interface SRAM_A0(passive)
5 ?5 j3 c4 b! b( f
3 b# I; J0 ?! k2 i$ a5 @8 B8 u( Ksheet symbol的图纸1 N/ G, M: ]  s6 B6 f. U' e
, v) _  Y* j/ u& U! V" E
/ b3 Q8 T' |2 @
总的sheet的图纸
# S8 L6 |, I# Z3 i9 ~ 2 n4 F9 W: T& s9 F8 p3 l: g

) Y# ]1 s$ D$ X3 }为什么我所有的net name都是sram_a0,他还是说我在一根线上有多个net name。而且仅仅是wARM,导入到PCB还是sram_a0, 不影响PCB layout
( b8 Q0 g& i7 ~很纠结,因为一编译message满是这种错误,也不知该如何解决。很烦

该用户从未签到

2#
 楼主| 发表于 2014-7-19 21:37 | 只看该作者
仅当我将project->project option中的Net identifier scope更改为
  v6 g: T  v+ A, U. CGlobal (net label and port global)
6 N; I9 n' f, R# g) o编译错误会没有,但是这非我所愿,很纠结
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