Net wire has multiple net name

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在使用AD10的时候出现以下编译错误
Net wire has multiple net name（Net label SRAM_A0. Sheet Entry U_SRAM_InteRFace SRAM_A0(passive)）
Wire SRAM_A0
1 o, L' j1 f8 ~& ^% ~, _Net label SRAM_A0
  Z/ Z6 y" n" M- N) U2 I1 LSheet Entry U_SRAM-Interface SRAM_A0(passive)
. x  i* A: h; O
sheet symbol的图纸
/ t- D3 d, D& A0 @/ u- C. d
8 G* k* l7 |$ B: p7 u
总的sheet的图纸


. T5 @0 K' @1 S为什么我所有的net name都是sram_a0，他还是说我在一根线上有多个net name。而且仅仅是wARM，导入到PCB还是sram_a0, 不影响PCB layout
6 K( h* M0 I9 B+ m# g+ M) e1 }9 m很纠结，因为一编译message满是这种错误，也不知该如何解决。很烦

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仅当我将project->project option中的Net identifier scope更改为
1 r# q8 i" C/ |) m! ?Global (net label and port global)
/ Q, }9 X& L, g# n- k' i5 [4 q编译错误会没有，但是这非我所愿，很纠结