请教相同信号过孔为什么不报DRC？

daisy_ldh · 发表于 2012-12-5 09:10

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我从pads文件导到allegro里头，但是相同信号的过孔放在一起不报CC，比如说GND与GND过孔就不报CC，这是为什么？我看了别的图的设置，没什么特别的？有哪位遇到过？

gl2050 · 发表于 2012-12-5 09:16

同名DRC没打开

daisy_ldh · 发表于 2012-12-5 09:17

什么意思呢？怎么设置？虚心求教！

gl2050 · 发表于 2012-12-5 09:25

daisy_ldh 发表于 2012-12-5 09:17
+ T3 u4 d! t; q8 u6 J2 ^7 C7 [6 f什么意思呢？怎么设置？虚心求教！

孔与孔的DRC是V/V，C/C是shape和shape的DRC。

daisy_ldh · 发表于 2012-12-5 10:14

我说错了呵呵，应该是V/V，可是按照你的设置，还是不报VV，选择TRUE/FALSE都不报错，怎么回事?

gl2050 · 发表于 2012-12-5 10:19

选 TRUE
database check 一下或update一下
或你DRC报错里面没开

daisy_ldh · 发表于 2012-12-5 13:20

我开始的设置是anlysis/anlysis modes/via全勾选，后来按照你说的方法开TRUE，跑DRC，可是不报错.后来我再回到anlysis/anlysis modes/via中，发现勾选的全没了，奇怪，然后我又全勾选，跑DRC，就出来报错V/V了，什么情况？

daisy_ldh · 发表于 2012-12-5 13:40

再后来是那个图死机了，想复现已经无法做到了，现在还是报错VV。

daisy_ldh · 发表于 2012-12-5 13:41

还是不报错V/V

gl2050 · 发表于 2012-12-5 14:00

anlysis/anlysis modes/via里面要把相关选项勾上，同名DRC打开
再看规则设置里面有没有问题。
database check 一下或update一下

daisy_ldh · 发表于 2012-12-5 14:33

哈哈，我明白什么意思了，开始的设置是anlysis/anlysis modes/same net spacing modes/via全勾选，后来按照你说的方法开TRUE，跑DRC，发现不报VV，然后我就把下方的same net spacing/options/在右侧选FALSE（实际上在执行这一步时，好像会把anlysis/anlysis modes/same net spacing modes这里头的东西全清空），再选TRUE，然后重新再anlysis/anlysis modes/same net spacing modes/via中勾选same net thru via to thru via，当然anlysis/anlysis modes/same net spacing modes/下面的东西都是基本上要勾选的。谢谢你了，终于明白怎么回事了，豁然开朗啊！

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