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cadence:capture生成allegro网表时的一个问题求教!

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1#
发表于 2022-1-29 14:25 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
#1 Error [ALG0014] Conflicting values of part name found on different sections of "U2".
+ ~, K$ }8 H/ P2 f( [0 C6 {Conflicting values: DMD_36_DMD_IC_DMD & DMD_31_DMD_IC_DMD
6 }" }- m* G2 K0 |Property values of "Device","PCB FootPrint", "Class" and "Value" should be identical# [, h$ e+ m7 t/ }! g
on all sections of the part.0 H* ~/ I# e2 l0 Q; w* y4 X
在导出网表的时候出现这个错误,我看了封装名也不长,只有三个字母,求高手赐教该怎么解决?
% _/ N5 J& ?" n$ C$ X

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2#
发表于 2022-1-29 15:10 | 只看该作者
你是不是把U2变成AB两部分了,但是2个部分的器件名不同。8 a; w9 o( j+ V1 s
器件名要求一样,U2A U2B的part name
$ _. a* D. R5 ?7 t

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3#
发表于 2022-1-29 15:32 | 只看该作者
再看看别人是怎么说的
2 m% }- k( G! c) D3 ~& j4 Y+ h4 F' m

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5#
发表于 2022-2-9 17:22 | 只看该作者
查找下这个看下行不行: 这个封装有几个部分,然后这几个部分并没有统一value,造成不一致,所以无法导入(有可能是某个Part改动过,然后就变了VALUE)
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