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[HyperLynx] run ddrx batch simulation 问题

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该用户从未签到

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1#
发表于 2020-8-19 22:38 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 sj2002dd 于 2020-8-19 22:40 编辑
, [2 Z2 t+ o3 I  P# u, r
, a( K' [, J( F0 B7 g在进行ddrx batch设置时,出现pin mismatch,但是在做单个信号仿真时确实没有问题,请问是怎么回事,是哪里出问题?$ ]) h3 H9 o. w  d- A

$ B( p5 ]9 l0 ^. O! U4 D8 w

1.jpg (75.64 KB, 下载次数: 3)

1.jpg

该用户从未签到

2#
发表于 2020-8-20 09:19 | 只看该作者
可能不能并行处理吧!
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    3#
    发表于 2020-8-20 12:14 | 只看该作者
    应该是IBIS文件里面的Pin编号与PCB上的不一致

    该用户从未签到

    4#
     楼主| 发表于 2020-9-22 19:17 | 只看该作者
    我对比了IBIS模型和datasheet,管脚的对应关系是正确的. L* w% i# ]' W1 M* p+ K
    是因为红框画出来的+和-不一致导致的吗?但是象U9.J1对应的ddr0_ckn就是负极性,为什么会显示+(如红框框出来的地方)4 b3 s4 ^  Y5 h& N
    , d; i' |  L; D4 C- P  M% C- ~
    3 Z& E1 ?& O. p

    该用户从未签到

    5#
    发表于 2020-11-30 10:18 | 只看该作者
    iBIS里有没有差分对设置
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