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EDA365电子论坛网»电子社区 › 研发技术版块 › 硬件设计讨论 › alerta 5AGXBA5 原理图设计问题
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alerta 5AGXBA5 原理图设计问题

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afande
  • TA的每日心情
    开心
    2020-1-19 15:16

    • 签到天数: 1 天

    [LV.1]初来乍到
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    1#
    发表于 2014-6-7 15:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    alerta 5AGXBA5 原理图设计的时候VERFB?AN0没用的时候，忘记接地或对应的电源了。 8 ?- M6 F0 a+ |8 d0 t8 z. z" F
    板子已经做出来了，这样会有什么影响？？？ . ]0 r. O8 \# f0 K. y
    谁知道的出来说下，谢谢！ ! e7 c$ f" i% W3 G  G  O' F4 Q
    如果有问题就不去贴主芯片了。一个主芯片几千块啊。& O7 d0 u! j. u% W1 k6 X

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    zgq800712

    该用户从未签到
    2#
    发表于 2014-6-9 08:45 | 只看该作者
    你应该看过altera的原理图 或说明的。VERFB这个接DDR如DDR DDR2等多要接这个。你所在的那个bank对应的VERFB没有DDR就不用接。" \" s  k7 t5 G& k) G' Y
    你那个系列的FPGA没有用过，CYCLONE的是可以不接的或当IO用。

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    afande
  • TA的每日心情
    开心
    2020-1-19 15:16

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    [LV.1]初来乍到
    3#
     楼主| 发表于 2014-6-9 12:36 | 只看该作者
    zgq800712 发表于 2014-6-9 08:45  b/ H/ ~, D. J
    你应该看过altera的原理图 或说明的。VERFB这个接DDR如DDR DDR2等多要接这个。你所在的那个bank对应的VERFB ...

    6 ?& F9 `6 ]" |2 ]我是用SDRAM不用DDR   9 A, e  A/ C' I* Y' s: \+ Q" l
    我看里面说：不用的时候，接对应的电源或地；# R0 \& O& m/ @3 w  c' M) ^
    但是我板子做回来了，没接，
    3 U4 e/ ~) ?' ~8 r$ C1 k行吗？？？

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    zgq800712

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    4#
    发表于 2014-6-10 18:48 | 只看该作者
    afande 发表于 2014-6-9 12:36" ^. n* p& ]1 q
    我是用SDRAM不用DDR   4 `. G" W+ `$ i2 G, z& j7 E* `
    我看里面说：不用的时候，接对应的电源或地；
    0 B( h9 Y8 C9 j但是我板子做回来了，没接，
    5 A6 l1 T' k% h/ U7 G& e& S
    试试吧，不行可以搞成弱上拉。

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    afande
  • TA的每日心情
    开心
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    [LV.1]初来乍到
    5#
     楼主| 发表于 2014-6-11 07:52 | 只看该作者
    zgq800712 发表于 2014-6-10 18:48
    0 ^5 Q. Q: f( _试试吧，不行可以搞成弱上拉。

    , Q$ t  u. C% L' k( S可以用软件去配置这几个IO口吧？？？" g0 |. C; O- J9 M* Q
    这些口可以配置成 高电平 低电平 或高阻: c% U; O5 o) d: P9 O
    那我配成地电平，应该就可以了吧？？？
    , ^( l% K' A1 E3 K! ?0 k大神这行吗？？

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    Newtonfifthlaw

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    6#
    发表于 2014-6-11 11:17 | 只看该作者
    LZ你用Arria V 跑SDRAM是不是有点大材小用？

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    afande
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    [LV.1]初来乍到
    7#
     楼主| 发表于 2014-6-11 12:35 | 只看该作者
    Newtonfifthlaw 发表于 2014-6-11 11:17
    0 F, A- U8 i4 G. i/ [# H+ \7 u6 X+ MLZ你用Arria V 跑SDRAM是不是有点大材小用？
      M2 Q; V: _) t3 `
    呵呵 ，是有点浪费，软件那边说DDR3的没办法做。4 [- J% d! y8 @5 W- `% y- a
    我这个问题您知道可以吗？？？
    % A- [+ M) l9 O% Q可以用软件去配置这几个IO口吧？？？
    - _" q! G/ P7 E" r. f8 |; e这些口可以配置成 高电平 低电平 或高阻+ q4 ?$ k6 c: a$ E5 Y
    那我配成地电平，应该就可以了吧？？？4 x1 E2 ?( x8 z2 ~. r; R  Q" Z
    大神这行吗？？

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    Newtonfifthlaw

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    8#
    发表于 2014-6-11 19:53 | 只看该作者
    没有用DDR的就将其普通IO就好了

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    afande
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    9#
     楼主| 发表于 2014-6-11 21:24 | 只看该作者
    Newtonfifthlaw 发表于 2014-6-11 19:530 b8 u, A( b: i. r
    没有用DDR的就将其普通IO就好了

    ' E! F+ S, r1 X+ r- N' b8 B! m设计说明中，有说 如果不用这些口，要接对应的电源或地，那现在悬空可以吗？？？？

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    Newtonfifthlaw

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    10#
    发表于 2014-6-12 10:27 | 只看该作者
    我没有用过 Arria V 的东西，Cyclone 的东西是可以这样接的。
    $ x  v& A0 X3 ^* s在pin connection guideline 里面是这么说的：If VREF pins are not used, the designer should connect them to either the VCCIO of the I/O bank in which the pin resides or GND。
    0 ~7 E0 R0 k# h' p8 A实在是不放心那就在打一版PCB吧

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    afande
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    11#
     楼主| 发表于 2014-6-12 12:32 | 只看该作者
    Newtonfifthlaw 发表于 2014-6-12 10:27
    4 C/ A' r' B' _1 c我没有用过 Arria V 的东西，Cyclone 的东西是可以这样接的。. S, V: A0 u" j6 S% @
    在pin connection guideline 里面是这么说的 ...
    / D& ]7 d) |! }3 t0 F: \
    板子贴好了 到时候调试看看

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    38447448

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    12#
    发表于 2014-6-12 13:06 | 只看该作者
    没那么多事儿，而且人家用的英语单词是should，又不是must。
    2 c9 A, l0 U. A1 h这种只是厂家为了保证做出的产品可靠性更高而已，可有可无。

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    afande
  • TA的每日心情
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    2020-1-19 15:16

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    13#
     楼主| 发表于 2014-6-12 13:26 | 只看该作者
    38447448 发表于 2014-6-12 13:06
    & x  [5 x* c* F' X5 J4 P' Z$ |( A没那么多事儿，而且人家用的英语单词是should，又不是must。
    . E5 O& g  T; M+ O这种只是厂家为了保证做出的产品可靠性更高而 ...
    $ T7 L  G/ L- E/ F4 x2 V! h

    5 I2 y& z( ?  T# \) q% a# R大神 那就说，其实用的话还是可以的？？- ~9 y$ A; l6 Y; N' O

    & r. E  b" ~! c; ^* J找到安慰了，呵呵

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    38447448

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    14#
    发表于 2014-6-12 14:14 | 只看该作者
    看英文呗，should啊should，不是must。功能不受影响，但是稳定性要自己测试了。

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    timerc

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    15#
    发表于 2014-6-12 16:27 | 只看该作者
    直接问Altera的技术支持看看

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