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allegro 差分线DRC相关问题求救

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1#
发表于 2014-5-19 15:49 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 holic 于 2014-5-19 15:52 编辑 . f+ z! M2 C  z. i, b
2 W! n! X2 Z& x  s  G
为什么我一对差分线布成这个样子update drc都不报错,求救

3.jpg (86.03 KB, 下载次数: 2)

3.jpg

4.jpg (59.26 KB, 下载次数: 4)

4.jpg

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2#
发表于 2014-5-20 16:02 | 只看该作者
差分线没定义成差分线# U5 F! h9 s. X0 L

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3#
 楼主| 发表于 2014-5-20 16:42 | 只看该作者
yitong7601 发表于 2014-5-20 16:02
1 W  W! P$ n; T3 k' o; j& o; Y差分线没定义成差分线
* {; _( C; H7 p, k9 s
定义了的,差分线变成那个样子是我故意调成那个样子的,但是调成那个样子了确没有报错

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4#
发表于 2014-5-20 16:54 | 只看该作者
表层区域设有禁止布线区吗

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5#
 楼主| 发表于 2014-5-20 16:57 | 只看该作者
yitong7601 发表于 2014-5-20 16:54
0 ]7 Z: X4 }8 [! z: l' ?表层区域设有禁止布线区吗

( P/ L  v) ]2 W没有

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6#
 楼主| 发表于 2014-5-20 16:59 | 只看该作者
还有在用delay turn调整差分线等长的时候不能动态显示Phase,只有在布差分线的时候才显示SPhase

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7#
发表于 2014-5-21 12:16 | 只看该作者
如果没禁补区,两条走线应紧挨在一起

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8#
发表于 2014-5-21 12:20 | 只看该作者
打开规则管理器Electrical Modes,下面Propagation delay和All differential pair checks
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