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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › Simulation is failed!
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[Cadence Sigrity] Simulation is failed!

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Dandy_15

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1#
发表于 2013-11-12 14:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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同样文件，同样的操作方法，在ASI16.62中能仿真，在ASI16.61中就不行，为什么呢？
2 V" F. v' l- ^8 Z. u  u3 z) _ASI16.62:64bit WIN7+ w' F  v0 w- c! E5 ]3 T
ASI16.61:32bit XP9 z* ?( O1 S3 s, ]. R" |

6 f$ x0 S2 y  m* G; o% d! N: C提示：
0 M. {8 M0 Y2 C* o1 [( C  ?Simulation is failed!0 m) u' ?  O1 ]( Q5 N: x

! ]9 k7 u6 D! f% CNET Simulation Error:! Z- K% H# W+ q
Error 2029: "File" not specified for IBIS model "BEAD.EndPartialCkt"% _9 V0 u4 l" ]+ _5 }" K. ~% }; G
$ `/ V! r  ^. R. t; I

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Dandy_15

该用户从未签到
2#
 楼主| 发表于 2013-11-13 16:28 | 只看该作者
9 ]+ a1 g/ M3 T9 p2 r
问题已经解决了，用TXT格式打开.sdp文件，修改网表。
; R  s" U& N/ j将BEAD.EndPartialCkt改为.EndPartialCkt就可以了

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