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设计规范-没拿事板子找渣!

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1#
发表于 2013-9-5 15:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 Julia_E365 于 2013-9-5 16:15 编辑   j6 \# N9 W- l+ {& F$ O3 a

( R% v% f7 O# j  T# w9 d! d8 s设计规范问题,或者有些人没受过专业培训,一直都是这样做,又或者公板就是这样做的,习惯了就没在意了,看看,有没有自己的影子?3 M! c( W) N9 G& {: u* K: q" }; R
  1、本来可以摆均匀、整齐的元件没却参差不齐。这样的情况有很多。原因有二:格点太小,而且没设置大小格点,不方便对齐;垂直方向不均匀,因为布局很随意。0 Y) a; z: c8 g- J
       
1 x' h, x2 v0 {; G! m" v) [- t6 p$ |( i" T( b
       
" G) T' I  K- z2 x        1 d) v3 B1 `+ r7 i6 `
        2、空间允许,孔为什么要打得这么乱呢,而且有些离电容管脚太近了;小元件铺铜越过管脚并在两脚之间打孔有什么好处吗?在我的概念里是绝对不允许的。
( S* _+ a3 H% q5 _' S       
* `8 k( e( Z& N% {) V* c$ Z& D, }
; N3 ~8 c; `# [6 b2 L        3、这也是天线!第二个图中好好的一块铜就这样被镂空了。打孔时稍微注意一点就可以避免的问题,把孔打整齐,拉开孔的间距很难吗?
8 C2 r) Z" V: ]! A        [img]8 z( |" V! [1 @% B) J) w4 ?

# ?7 ^) S' S, r/ D        4、铺铜很随意,以致孔只有一部分在铜上(这种情况在一块板内竟然非常多!)。
2 V4 `2 t& e9 F* q        8 H) K- R& l5 v  u6 `4 o
. H" j# _0 \1 |" E5 @
        5、既然铺了铜,为什么还要连线呢?也许这样做也没什么问题,但给人的感觉很不规范。
3 J# \/ A, M6 r) ^        ' `8 O* `1 {. ~, d
4 J/ Y1 y1 w3 _) F
        6、铺了铜却不打孔。- I7 r" s- M9 T1 I' U7 `) K" U! t
        6 h$ x. V8 e; Z; r
        & l. {% a- T1 r" Y8 W
        7、锐角走线;两地孔完全不必这样挤在一起。
- U& p$ |  b2 x0 b3 `) |& [1 D        ' m& k  K' }" G" S

0 B  q9 |3 d5 G: d        8、走线问题
1 g7 @0 Y* m& a" P, t& _  _        改成下图那样会不会好很多?(非得在焊盘里拐一下不可吗?)
2 J: V' ~0 Z0 c        ) \4 o( B3 G# s) ]% P6 X6 }% a
) [) e+ B/ e! e7 X; k
       
: t! H2 x' \9 k7 W: x! c6 ~, A
& ?8 p% A3 h6 W+ C$ i! r        已经养成很随意走线的坏习惯,做完了也不去修一下。
/ d: ^  N( [# n       
/ X! @3 M  C5 g6 U1 ]/ i        , k% f: P- h+ ]6 b  {
        9 p, \& f- F: a# M& M1 }

& l3 \# |% {# O9 l6 o  r% E4 d. ?        怎么看都感觉很别扭啊!4 c3 {' O, c. u
        : |1 T# i  n: r3 e' C. Z& v

8 w- i- V7 i: x       
+ F: G* V: O! o! f6 V8 X" Q+ ]8 V
, t( P1 U  |! v' H1 D" y5 `: b        9、这是一块大铜皮,0402电阻就这样被铜皮包围着,焊着可能出问题。( P( G6 ?0 H9 C0 U) _" C
       
/ f$ ~/ |! }5 f9 l( r/ z" F0 f% r% V, e9 M6 d
        10、平面层两块同间距只有0.18mm,有那么大的空间,为什么铜与铜的间距非要这么近不可呢?BGA里面为为了保证阻抗连续性,局部间距泪点可以理解,很多地方铜与铜的间距不到0.2mm,何解?
; W. s5 w: A' E* Q% q( b       
8 E4 M# O4 ~9 Q4 C2 O  M3 v1 {+ t8 u( E3 ^# s+ }  f
        11、有空间就把孔打到10mil以外吧,挤在一起干吗呢?: ^# X- T5 n2 M/ x- h; r; [
        - d$ {* `8 Z) ?4 _6 P* c- c5 T

. S& [3 D4 j6 b        12、这是拉线时没选Replace etch的结果。8 I! Z/ c9 {: m
       
, g) ^. G" J8 y; b$ U  W& X) H. c3 v9 ^7 n' ~& J/ ]
        13、这种情况应该走钝角。
7 d% N2 Q. N% P( D2 K6 J       
, F" z$ w& _& E1 M& ?+ X. r9 M# U- x; E. G, u- ~: j& a
        14、电源先经过电容再到芯片,没错,但电容的位置可以变的嘛,不至于把线走得这么难看吧。
' E4 _' R/ d8 U. Q& b! O- f8 T        " O  r0 ]1 }7 Q$ M+ C

) P8 I% W, x9 D3 R- a        15、复位信号间距太近了,有空间为啥不拉开点呢?4 B' ?+ o2 t/ Z9 Z6 _
        ( j* c0 `! k, b) p& ]! g2 Y7 O

; A8 l- L3 i0 \8 z        16、有空间应该拉开点间距;对于高速信号,拐弯会引起反射,能不拐弯就不拐弯;右边拉开点间距并且远离一点安装孔吧。- ^; ^! T7 ~# J+ b7 S  O
       
6 g# N) D3 o! j
- j+ P! Y4 K& y, W        17、把下边那个孔往左移一点,紫色的线就可以少拐4个弯了!
% F& u4 ]5 G5 f0 q3 i        . x1 v8 G. d; z5 D
7 o$ d$ F& F! m
        18、这两个地孔有必要打那么远吗?2 t6 j" s( a3 U) {1 D7 v
       
2 P' ~. V0 u& {- X6 \0 `, Z4 P+ x( y& \5 U- y1 h
        19、滤波电容基本上都没有按先大后小的顺序来布局,很多线还少拐几个弯,还可以短很多的。

点评

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支持  发表于 2013-9-5 17:03
支持!: 5 反对!: 1
  发表于 2013-9-5 15:52

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 楼主| 发表于 2013-9-6 09:46 | 只看该作者
pmp_mcu 发表于 2013-9-5 21:44
5 E+ E7 k1 L& @1 T. ?, N. w这个图这样做是对的。不能只看表面。PCB layout是黑色艺术。

8 E, |& ?$ U" I/ Q/ @对比一下,塾优塾劣?. |4 _  o. |% I7 s/ w

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发表于 2014-11-25 20:44 | 只看该作者
Julia_E365 发表于 2014-11-25 18:24& N) r" O# z$ q) x1 ]: M: P
当客户指出这些问题的时候就晚了,这些虽然是细节,但给人的感觉就是不够专业。
0 Q  ?: ]; Q- i3 v! k
呵呵,不同类型的单板不同的规范,有些新手做的可能不到位,但是不能一棒子打死。要给他们鼓励,严格是好的,但是要有尺度,那些新人也是有自尊的,我觉得我手下的新人,虽然现在细节处理不到位,那个是需要实战经验的,将来他们或许会比我强的,所以得尊重新人。/ e9 d- X: _9 Y* w9 z' p% W
还有就是每个人包括客户,大家的想法不一样。有时候你做的再完美,那也只是在你眼,客户看起来或许未必是那样的。既然做设计就不要怕客户提意见,客户和你,关注的点不同,有时候你所关注的,客户或许并不太在意;要明白客户在意的点,和你设计的单板的类型并注意该类型的设计中有哪要点,这个要优先处理好,尤其是项目进度比较紧急的时候。优化是无止境的。
) m) }8 O# D& ]* ~
  • TA的每日心情
    开心
    2019-11-20 15:15
  • 签到天数: 1 天

    [LV.1]初来乍到

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    发表于 2013-9-6 21:59 | 只看该作者
    Julia_E365 发表于 2013-9-6 09:46. P: f* N5 ~& h: X/ a; Q5 W* z
    对比一下,塾优塾劣?
    " [8 X3 L" m: N. B
    左侧第一对差分也许是为了进行对内等长才不做到齐头并进 无法判断一定是错的
    3 b" n$ t6 C4 s  ?. f下方那对差分楼主的做法是对的,应该要避免差分锐角走线的产生
    9 M" J# V! ]4 D$ ^8 V- Q0 ?右边的差分个人认为楼主的做法没有原图中的好,两差分线之间的耦合距离比原图中要差一点,原图更接近via处才分开,楼主的耦合距离偏大,对信号的影响更明显
    ' U" ]1 E5 Z: |1 V: z. w9 h个人拙见 见笑了

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    3#
    发表于 2013-9-5 16:11 | 只看该作者
    嘿嘿,谢谢楼主的指导,这些其实都是很容易忽视的细节,如果都能养成习惯,Layout出来的东西必定少很多问题

    该用户从未签到

    4#
    发表于 2013-9-5 16:34 | 只看该作者
    都是些很细节的东西,对于我这种有轻微强迫症的人来说,做不到反而很难受啊

    该用户从未签到

    5#
    发表于 2013-9-5 17:06 | 只看该作者
    LZ已经是高人了...

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    6#
     楼主| 发表于 2013-9-5 17:21 | 只看该作者
    fsq2011 发表于 2013-9-5 17:069 z; P' i5 W2 F4 o: C/ ?# x8 G
    LZ已经是高人了...

    # M, e% R& H: ?5 T! M3 a不及你啊{:soso_e113:}

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    7#
     楼主| 发表于 2013-9-5 17:25 | 只看该作者
    抛砖引玉罢了,望高手出来指点呀。

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    8#
    发表于 2013-9-5 17:29 | 只看该作者
    个人认为画PCB就和审美一样,画出的PCB就代表着审美观。

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    9#
    发表于 2013-9-5 17:36 | 只看该作者
    好像自己之前画的板子啊,要严格要求,细节决定成败,

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    10#
    发表于 2013-9-5 19:29 | 只看该作者
    看来layout心思不在板子上,以连通为目的,PCB美观和内涵边lay边漏。跟规范没关系,规范不可能什么都要求。对于第二个问题,对于大封装的电容,建议在两pin之间成对打孔,VCC和gnd的互感会减小总的环路电感,对于电源要求宽频低阻抗是有好处的。作用有多大,It depends。这不算坏习惯

    该用户从未签到

    11#
    发表于 2013-9-5 20:10 | 只看该作者
    3345243 发表于 2013-9-5 19:29
    : J# m3 @, h) O' \" J0 T. _/ [/ Z看来layout心思不在板子上,以连通为目的,PCB美观和内涵边lay边漏。跟规范没关系,规范不可能什么都要求。 ...

    + `; _6 L! r: h! {: L* ^, M为什么能减少环路电感?

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    12#
    发表于 2013-9-5 21:44 | 只看该作者
    这个图这样做是对的。不能只看表面。PCB layout是黑色艺术。

    untitled.png (96.86 KB, 下载次数: 2)

    untitled.png

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    14#
    发表于 2013-9-6 11:36 | 只看该作者
    就一般而言,楼主是对的,但是某些高频的pcb处理,很多时候就是乱七八糟的,美观不一定就性能好,在layout概念上,只要符合EMC,信号完整性【包括电源完整性】、安规等guide后,再考虑美观;追求完美是对的,但不要过分,楼主不算重呵呵;我的观点:我们现在所绘的是一板一眼的西洋画,其实有时国画的意境更为深远呵呵

    该用户从未签到

    15#
    发表于 2013-9-6 11:43 | 只看该作者
    看了看感觉还是有一定的指导意义的  赞同性能至上,兼容美观的观点
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