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关于DFA?

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1#
发表于 2013-8-26 14:23 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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近来公司切实执行DFA设计,要求在建立封装的时候在DFA层面加入相关信息,如器件实体大小?很困惑这个实体大小指的是看得的实体大小吗?用不用考虑管脚的?这个大大地影响了布局。请教高手!!!!

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2#
发表于 2013-8-26 16:20 | 只看该作者
应该要考虑管脚的

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3#
 楼主| 发表于 2013-8-27 08:36 | 只看该作者
navy1234 发表于 2013-8-26 16:20
) |+ g- C9 o+ L( T/ T8 K应该要考虑管脚的
' d- }3 _" Z5 Q3 _1 I4 C
噢 那常规的器件DFA要求的间距是多少呢?有没有相关的资料说明。或是说不同的公司要求不同?

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4#
发表于 2013-8-27 09:04 | 只看该作者
推荐如下:* G" q# l; @/ s  I, d
1.小(矮)器件不能放置在大(高)器件中间;(以2.0mm为依据判断)
- v/ M- v( V5 F0 Q/ C2. PLCC、QFN、QFP、SOP各自之间和相互之间间隙≥2.5 mm;
' Q7 ?1 o7 C) `) h7 `$ f3.QFP、SOP与Chip 、SOT之间间隙≥1 mm;! H# n. J! I, B/ X$ R" r. f
4.PLCC、QFN与Chip、SOT之间的距离≥2mm;# }/ L; n9 D, d0 U( s, {; W
5. BGA外形与其他元器件的间隙≥3mm,推荐5 mm;
6 c! ~/ `& T; D7 T' Y6. PLCC表面贴脚座与其他元器件的间隙≥3 mm;, Z) a- f9 B6 d% V0 Z+ o0 {# I
7. 表面贴片连接器与连接器之间应该确保能够检查和返修, 一般连接器引线侧应该留有比连接器高度大的空间。
  L( ?2 l8 N" W0 V0 \1 J, n

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5#
 楼主| 发表于 2013-8-27 10:37 | 只看该作者
navy1234 发表于 2013-8-27 09:04
/ l: x) {0 @$ }* I4 @! I推荐如下:; K( \, \  J0 e" {: h7 |. T
1.小(矮)器件不能放置在大(高)器件中间;(以2.0mm为依据判断)) X1 z+ b1 ?; O. N( I5 m$ G
2. PLCC、QFN、QFP、SOP各 ...
! H, a$ M, `% Y) J6 \
嗯,谢谢了{:soso_e163:} ,考虑PIN的话,对于结构限制多,板子小,密度大的板子挑战性就大了。。。
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