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DDR参考电压被拉低,求大神解析

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1#
发表于 2013-8-1 21:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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一个板子挂了四个ddr3,vref电压这个0.75v的电压在DDR跑起来之后变成只有0.2v,有些变成1.0v,代码在6 v3 S- J( R9 N6 w) e* N
另外一个项目的板子验证过是ok的,实在不理解为什么?
  s; B" U1 U' r+ w: Q8 D    把vtt这个电压和vref这个电压飞线连接起来,ddr测试程序ok!,但是不明白vref怎么会被拉低?求大神指教。
+ g5 @0 h; u* \5 z! O( a7 l+ L

8[BOM}~}HQ)DED)7_Y~~{_G.jpg (95.14 KB, 下载次数: 14)

8[BOM}~}HQ)DED)7_Y~~{_G.jpg

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发表于 2014-5-23 14:18 | 只看该作者
个人见解:$ {; _. k8 K9 b3 o
1、首先TPS51200的Vo和REFOUT是作为输出使用,楼主的画法有问题;8 Q4 W1 f" o% Z" I# W& m
2、TPS51200给出的参考设计一般只针对1PCS的DDR来设计的。REFOUT引脚的电流输出能力有限,多片的DDR使用可能超出了REFOUT引脚的载流能力导致电压下降;
/ l' E( w3 e0 m' Q- c* {解决方法:
. V1 H- \4 ?8 f$ G* l多片DDR3的电源设计方案可以这样:TPS51200的REFOUT引脚不使用,直接通过合适电容下拉到地;DDR3的0.75V_VTT使用TPS51200的VO输出,而DDR3的VREFCA和VREFDQ引脚使用1.5V经过磁珠和电容滤波后供给。

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发表于 2014-6-8 13:25 | 只看该作者
问题可能在FPGA上,TPS51200的VREF驱动4片DDR不可能有问题,我用过这个芯片驱动二十几片DDR都没问题的,可以尝试VTT和VREF不直接飞线,中间串个小电阻,如果电阻上有一定压降,可以算出VREF的电流是否太大了

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 楼主| 发表于 2014-6-21 09:31 | 只看该作者
coffindidi 发表于 2014-6-8 13:25
. W& Y2 Y, o% E问题可能在FPGA上,TPS51200的VREF驱动4片DDR不可能有问题,我用过这个芯片驱动二十几片DDR都没问题的,可 ...
$ Y4 e& L- P$ y$ l
可以驱动20个啊。学习了。
- K! z$ S9 G9 S: n2 J1 [6 R  b我的板子因为信号质量问题后来改版了。

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2#
发表于 2013-8-3 12:57 | 只看该作者
Vref的电流很小,仔细量一下芯片管脚,看看有没有被烧坏的吧

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3#
 楼主| 发表于 2013-8-3 22:10 | 只看该作者
part99 发表于 2013-8-3 12:57 * a* m+ q( h  w8 V; O# p% f) R# W$ g
Vref的电流很小,仔细量一下芯片管脚,看看有没有被烧坏的吧
4 [" q* G' F! f! x
没有,5块板子都是一样的情况,把VTT和vref飞线连接起来就什么问题都没有。

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4#
发表于 2013-8-4 01:59 | 只看该作者
你用不是用分压的吗?VREF=2/1VDQS,好像是

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5#
发表于 2013-8-4 03:31 | 只看该作者
是你的C115太大了,把它移走试一下吧。, F& F" c7 l) e: r0 V. c5 l0 ]/ {. G
电容不是越多越大越好,有时间看看datasheet。

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6#
 楼主| 发表于 2013-8-4 10:20 | 只看该作者
part99 发表于 2013-8-4 03:31 % p! K; Y8 S' R+ V, W( v- i
是你的C115太大了,把它移走试一下吧。9 j! R/ J9 c! ~
电容不是越多越大越好,有时间看看datasheet。

+ F+ K& ]) q: Q, @" r去掉了,也不行。

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7#
发表于 2013-8-4 10:43 | 只看该作者
mylive 发表于 2013-8-3 21:20 ' T$ e8 C* Z8 [2 q
去掉了,也不行。
) P: o, L! Q1 O
你把CPU和DRAM那部分的图也上传过来吧。

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8#
发表于 2013-8-5 08:59 | 只看该作者
R106改成100K试试,参考设计是100K的

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9#
发表于 2013-8-5 10:43 | 只看该作者
学习了                        
  • TA的每日心情
    郁闷
    2025-4-28 15:02
  • 签到天数: 13 天

    [LV.3]偶尔看看II

    10#
    发表于 2013-8-5 11:02 | 只看该作者
    lz请把图完整贴出,否则没法分析,只能猜。

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    11#
    发表于 2013-8-5 11:39 | 只看该作者
    楼主的DDR_Vref 是U22输出的吗,U22是否是提供DDR_VTT和 DDR_Vref 的电源芯片?8 o& o& w$ e' F# F
    我之前做的DDR_Vref 要么是用DDR_VTT分压产生,要么是从CPU自动输出,没有像楼主这样做过。3 Z& c5 S! n% f, J6 ~

    + O' E# d& w$ q% I5 y4 U, }另上DDR_Vref 电流很小,应该不存在电流不足被拉低的可能性。

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    12#
    发表于 2013-8-5 11:44 | 只看该作者
    L12作为一个磁珠在电源的输入端,是否怀疑过?

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    13#
     楼主| 发表于 2013-8-5 21:23 | 只看该作者
    风吹摇摆 发表于 2013-8-5 08:59 ( k. G8 O# K  W/ C% i
    R106改成100K试试,参考设计是100K的
    9 P; L/ X0 j* D/ L8 y9 m
    换了。不行。

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    14#
     楼主| 发表于 2013-8-5 21:26 | 只看该作者
    part99 发表于 2013-8-4 10:43 6 L+ L6 V7 I7 E5 D1 Z+ Z- p
    你把CPU和DRAM那部分的图也上传过来吧。

    : h, ^7 p5 h7 K3 _CPU是用xilinx的spartan6 150t,目前不方便上传。

    该用户从未签到

    15#
     楼主| 发表于 2013-8-5 21:29 | 只看该作者
    sandyxc 发表于 2013-8-5 11:39
    + t1 L% L6 M: ~' ]1 {% R0 ~" f3 Q楼主的DDR_Vref 是U22输出的吗,U22是否是提供DDR_VTT和 DDR_Vref 的电源芯片?& ?  X) r6 @) k8 y2 ]' r( i# s
    我之前做的DDR_Vref 要么是 ...

    1 {3 ]7 o* y6 d4 X; ]参考设计就是这么弄的。VTT及VREF都是这个芯片产生的,另外一个项目也是这么接,唯一的不同是这个  q1 N" E  T5 e: C
    板子挂了四个DDR,另外一个是三个DDR。
    & J+ P" K+ [6 J3 R0 N6 ^9 |CPU能输出VREF???

    点评

    CPU也有VREF引脚的,貌似不是输出,是输入  发表于 2013-8-6 07:59
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