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allegro等长设置问题

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1#
发表于 2013-8-1 09:54 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
1金币
等长设置好后,显示的长度与实际长度不一致,请问这是什么原因呢???{:soso_e183:}
3 W( S8 A+ ?4 u9 }# K

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去掉下图中的Z Axis Delay即可不包括过孔长度
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    2#
    发表于 2013-8-1 09:54 | 只看该作者
    去掉下图中的Z Axis Delay即可不包括过孔长度& m6 I& x1 ]3 |5 }: n9 _% H

    点评

    支持!: 5.0
    支持!: 5
    谢谢指教。最好说明版本。  发表于 2013-8-6 20:07

    该用户从未签到

    3#
    发表于 2013-8-1 21:27 | 只看该作者
    什么是显示长度,什么是实际长度啊

    该用户从未签到

    4#
     楼主| 发表于 2013-8-2 09:19 | 只看该作者
    李明宗伟 发表于 2013-8-1 21:27
    - Z$ w/ Y# q; `: {% U4 v9 a什么是显示长度,什么是实际长度啊

    8 Q5 g: r1 Z* H/ X% [show net 的时候显示如下,为什么会出现BOTTOM/BOTTOM,Zall=32 MIL,不知道哪边设置错了- @# _2 [& T$ z  `* ~+ ^& _1 d
    # t! n  b2 |, W; f4 E; l$ X2 p
    ' p# p  N* |# a, W) h# W
      Net Name:            XM1_DATA15+ w5 ^1 _& ~6 A
      Member of Bus:       XM1-D13 Q6 E4 f2 \$ t6 R5 E& P

    ) m- ]( x2 q* |. m$ T0 d( d  Pin count:              2
    % x1 t+ }/ `0 ?0 E  Via count:              4# F- d* `8 y# j4 d) I
      Total etch length:      903.28 MIL  
    : X7 Q' w- ?0 ?2 w) V' p0 Y  Total manhattan length: 430.73 MIL
    : k' i  S' o' j0 O& X! A# I' r  Percent manhattan:      209.71%6 |9 o+ H) o! V/ y7 F8 o2 ^
    7 p% y3 |4 R" L2 r' T; j
      Pin                     Type      SigNoise Model        Location! h) p) V4 a. d1 x' @" F6 [
      ---                     ----      --------------        --------* T, u! h2 m2 F1 ^+ e; z0 B' Y+ L
      U4.B9                   UNSPEC                          (-1516.62 685.41)9 d, u3 v) y' Z) b
      U1.C17                  UNSPEC                          (-1184.58 784.10)
    % o* b0 G" Z7 u
    6 l* [& h+ p( |/ U- ^- O  No connections remaining1 l2 X, u2 c( ?0 C7 L$ n0 u
    + D4 T! t9 C+ `; P: \" I
      Properties attached to net
    7 y% u( C7 W& [) o7 S+ G( F9 U    BUS_NAME          = XM1-D1% O+ Y+ }/ \0 K9 z  N- P
        ELECTRICAL_CONSTRAINT_SET  = XM1_DATA8
    ; a7 A# {' N3 E) Q) |% k2 s
    * U/ m- j/ N' b- e; i& X% q0 i8 `" e  Electrical Constraints assigned to net XM1_DATA15
    ' i- X- s1 {) y  _8 J* b( F, s    relative prop delay: global group XM1-D1 from U1.C17 to U4.B9  delta=0.00 MIL  tol=20.00 MIL/ o* b8 [6 W6 P  O) a

    * I5 Z7 N% A+ [* M& n' q' j3 X  Constraint information:* ~3 l: H- k+ @7 D
        (RDly) U1.C17 to U4.B9  min= 919.3 MIL  max= 959.3 MIL  actual= 935.28 MIL                   target=  (XM1_DATA12) U1.C18 to U4.D15 t- M+ w' `4 h. t, R; b) j
                (-1184.58,784.10) pin U1.C17,UNSPEC,BOTTOM/BOTTOM
    8 Z) G8 `# G" s) P$ a            (-1184.56,784.10) via GND07/BOTTOM
    4 ^% `5 Q! ~' X. @0 a1 L: b4 l      18.13 MIL cline GND07+ ^! I2 y& I8 u, ?
                (-1197.38,771.31) via GND02/GND07
    ; C9 I; ^2 c$ \( r- U! N      639.6 MIL cline ART060 X9 O: C1 f' ^
                (-1368.74,567.43) via GND02/GND07
    . P( \: I( z; P6 n: j; y+ i      30.94 MIL cline GND07( A9 P$ R' Q) ]: g' o  X
                (-1393.13,581.82) via GND07/BOTTOM
    . s9 A5 B9 c$ O& I9 e1 C/ R      214.59 MIL cline BOTTOM
    4 z  }/ \% }0 w2 T3 H/ R            (-1516.62,685.41) pin U4.B9,UNSPEC,BOTTOM/BOTTOM,Zall=32 MIL
    " S7 i5 c, m) n2 |2 b1 S3 p' _& g  Member of Groups:* s0 A  ?! o6 X" d8 Q+ o2 p
        BUS             : XM1-D1
    1 b/ C2 y8 t4 W1 O

    该用户从未签到

    5#
    发表于 2013-8-2 09:28 | 只看该作者
    加我QQ739537967,给你看看

    该用户从未签到

    6#
    发表于 2013-8-2 21:58 | 只看该作者
    Total etch length和Constraint information中的不是同一概念;Total etch length只是走线长度,而Constraint information中的线长还会包括过孔等信息,是综合考虑的延迟。

    该用户从未签到

    7#
     楼主| 发表于 2013-8-5 09:37 | 只看该作者
    李明宗伟 发表于 2013-8-2 21:58
    ( w+ i" C! i. T4 `8 G2 qTotal etch length和Constraint information中的不是同一概念;Total etch length只是走线长度,而Constrai ...
    % E' c; b7 h; {2 B9 A
    那怎样才能在Relative Propagation Delay的Length栏显示的是Total etch length,而不是Constraint information的长度呢?

    该用户从未签到

    8#
    发表于 2013-8-5 17:18 | 只看该作者
    Relative Propagation Delay,如你所见,约束的是延迟,就是我之前所讲的包括过孔在内的所有因素导致的延迟;而如果你只是想约束走线长度的话,可以设置Total Etch Length,不过它不是相对约束。

    该用户从未签到

    9#
     楼主| 发表于 2013-8-6 09:45 | 只看该作者
    李明宗伟 发表于 2013-8-5 17:18
    ; b, n% G! Q/ m& FRelative Propagation Delay,如你所见,约束的是延迟,就是我之前所讲的包括过孔在内的所有因素导致的延迟 ...
      ]/ c$ x. z2 G( C3 e5 L' ~
    请问具体要怎么做?在哪边修改?

    该用户从未签到

    10#
    发表于 2013-8-6 09:55 | 只看该作者
    过孔的长度也算到里面去了,如果通孔板,你看下相差是不是就是板的厚度

    该用户从未签到

    11#
     楼主| 发表于 2013-8-6 10:27 | 只看该作者
    jiaoweiyong 发表于 2013-8-6 09:55
    / j2 G' w) C) T8 z; e, p3 L# v: U过孔的长度也算到里面去了,如果通孔板,你看下相差是不是就是板的厚度
    # `5 J5 M: Y" b  p" ^* a4 f
    我要怎样设定,才能不把过孔算在里面呢?{:soso_e183:}

    该用户从未签到

    12#
    发表于 2013-8-6 11:48 | 只看该作者
    tanghui1987510 发表于 2013-8-6 10:27
    5 }; |3 E% g2 O9 X) v我要怎样设定,才能不把过孔算在里面呢?
    / A, I7 Z% u" ^% Q+ _2 `5 B0 `
    直接查询不就可以了吗?显示的是走线的长度。

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    13#
    发表于 2013-8-6 11:50 | 只看该作者
    忘记了

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    14#
     楼主| 发表于 2013-8-6 12:45 | 只看该作者
    dzkcool 发表于 2013-8-6 12:21
    9 B1 a2 e% |3 G  y去掉下图中的Z Axis Delay即可不包括过孔长度

    & l9 `0 L) a6 [$ `1 j{:soso_e183:} 正解,感谢!!!
  • TA的每日心情
    开心
    2024-7-11 15:39
  • 签到天数: 1 天

    [LV.1]初来乍到

    15#
    发表于 2019-8-8 09:37 | 只看该作者
    设定可以把表层的走线x0.9再记入长度吗
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