一个关于串接电阻的作用问题，求大神指教

pipiliang

我看到周立功的以太网接口电路的时候，由于FPGA的数据、地址线要和以太网芯片RTL8019AS相连，但是以太网芯片的供电电压为5V，而FPGA的IO口却只有3.3V，文献上就说因为这个原因，于是在数据、地址以及控制线都串接一个220ohm的电阻，这个电阻的作用是什么啊？望大神给个详细讲解！多谢

bluskly

限流。这个说法我觉得比较靠谱的。有时候对于3.3V和5V电平信号连接的时候，有人就不用电平转换电流，直接串联一个电阻来限流！

pipiliang

bluskly 发表于 2013-6-8 11:30
% s1 S+ o& m+ G限流。这个说法我觉得比较靠谱的。有时候对于3.3V和5V电平信号连接的时候，有人就不用电平转换电流，直接串 ...

% `- ]3 u# Q0 L+ V, p恩，是的哦，懂啦，谢谢啊，应该就是对5v电压起一个降压的作用！

zgq800712

" o+ Z+ c% T* o' |不想用芯片，又不想换3.3V的芯片，串联电阻就是这个办法。

: c4 N' m9 O& a; c/ t严格说这种接不好，哈。

( e) ~# w1 r" h7 W# g% o4 A5 S
% U' z: \* k; U9 Z有些FPGA他有个内部二极管钳位的，PCI钳位  可以把它开起来，在接下限流电阻，5V输入，到FPGA就4.3V了。

pipiliang

zgq800712 发表于 2013-6-8 13:44
6 O: \3 R2 t4 V- t) ]2 G% K6 }不想用芯片，又不想换3.3V的芯片，串联电阻就是这个办法。

4 Y$ B8 t; ^# E8 X" q* P8 z  N& Y严格说这种接不好，哈。

7 C( e. C; N  ]( `这个对于我有点高深，谢谢你的指教，我再去研究研究，我还不知道有个二极管钳位

zgq800712

pipiliang 发表于 2013-6-8 14:06
这个对于我有点高深，谢谢你的指教，我再去研究研究，我还不知道有个二极管钳位

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4 W/ {. Q* v0 ?/ V6 }$ S+ y5 F

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- P, {, i6 R1 d: J, N" H& [; D) d
: C$ y7 H% W* U( t: t8 Q# ]看上面这个题你就知道，输入电压高了对器件寿命是有影响的。
2 s" G/ J) C& h
0 w3 R" b7 Y; e3 y! N
This 10-year period
assumes that the device is always turned on with 100% I/O toggle rate and 50% duty
cycle signal. For lower I/O toggle rates and situations in which the device is in an idle
state, lifetimes are increased.

pipiliang

zgq800712 发表于 2013-6-8 14:18
看上面这个题你就知道，输入电压高了对器件寿命是有影响的。

& O  p& U- A; t搜噶，懂啦，谢谢啦！学习了

zgq800712

4 f, _9 q3 e. v


再来看看上面这个图 FPGA 开启内部弱上拉电阻的阻值。
$ m# F: i0 ]1 M# K4 y$ k$ v0 m' F可以看到3.3V下， 最小7K 典型25K 最大41K ，
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如果和FPGA连的那个芯片可以设置为开漏输出，或内部弱上拉或外接上拉电阻10K,47K，
FPGA和芯片之间串联一个数百-数K的电阻
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& d' |8 H, |& P按这个算到FPGA PIN上的电压按分压算，算出来看看是多少？ 在PIN 定位到有PCI钳位二极管的bank中，这样就万无一失了。

mengdie_198599

不知道，这么理解可以？PCB设计中的阻抗匹配问题。
6 m" H$ I1 p) QCPU和FPGA链接时，比喻地址线，数据线，控制线，信号在传输过程中，都会有干扰。
如果一个信号的边沿非常陡峭，容易产生过冲。串联电阻与信号线的分布电容以及负载输入电容等形成一个RC电路，这样就会降低信号边沿的陡峭程度。