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谈一谈我做过的DDR1/2/3的板子的经验

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1#
发表于 2013-3-26 10:35 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我做过的有DDR内存的工业板大大小小有十几块,有自己做layout的,也有别人做layout自己光画图的;有DDR2-400的,也有DDR3-1600的;有一个芯片的,也有4+1(ECC)个芯片的;谈一谈我的一些经验吧。1 M! C3 H2 T. K5 ?7 `& k8 Y
1. 关于重要性,我个人认为,电源>时钟>数据线>命令控制线;1 p' ^$ P' s  H3 C, T
2. 电源部分,包括如何让VDDR电源的返回路径最短,VTT如何放置,退耦电容的放置等等;
  n5 ]$ R0 W5 D2 m, H5 O5 u7 M3. 时钟线的处理,重要的是拓扑结构和终结,另外,保持和时钟线的距离也很重要;* t3 B  b7 c. `/ _
4. 8位11根数据线一组的等长和线距;
7 ^: @7 V2 S+ k: ~5. 控制命令线拓扑结构和VTT终结。8 V6 g9 T# w4 U/ ^# B
  I2 @: R% Q, [0 o& L. h
有时间再写多一点吧。

点评

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支持!: 5
支持!!  发表于 2013-3-30 09:58

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meng110928 + 5 期待后续!
tdlthm + 5 赞一个!
wpc4208211 + 10 支持!

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该用户从未签到

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发表于 2013-3-28 09:07 | 只看该作者
其实不管是8位还是16位的,DDR的资料介绍里面都是很详细的,一般PCB工程师根本就没有过多的去好好理解资料,而是过多的去找一些别人的经验,然后就盲目的去走线了,当然有别人的经验是好事,不过最好还是能够真正的理解器件本身的资料重要的,做过DDR2,DD3板子的,不论你走线的拓扑,线距,等长,时钟电源这些事如何处理的,后期调试最好能跟着硬件去测试下自己画得板子,看看到底实际跑起来是怎么样的?频率越高的板子必须要做仿真和测试。

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meng110928 + 5 支持!

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 楼主| 发表于 2013-3-28 08:00 | 只看该作者
liangjiatian 发表于 2013-3-27 11:04
3 E* K  q" h3 `& e哎 丢人啊!没搞过这块!不太了解啊!请指教

, g& K) V0 E" C3 r不好意思。一般来说,内存或cpu附近会有via,如果没有放测试点,可以就近的via测,测试点要放在接收端,比如,时钟,命令地址线,放在内存一侧,cpu读,数据线的测试点要在cpu一侧,cpu写,数据线放在内存一侧。另外,地要尽可能的短。
  • TA的每日心情
    开心
    2019-12-7 15:02
  • 签到天数: 8 天

    [LV.3]偶尔看看II

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    发表于 2013-10-24 08:45 | 只看该作者
    113788067 发表于 2013-10-22 15:025 q: f! m" _7 \$ s* O6 ?
    LZ说DQ DQS这些线不要做等长控制。如果真不需要的话为啥所以芯片厂商都把这一条设为最重要注意的地方?
    7 ^; l# G, h  h+ l5 u虽 ...
    " m, N( P7 z! J! P" l
    jitter 一般都是IC设计引起的,和走线没有关系,走线影响的是skew 就是所谓的时钟偏移  基本上如果jitter出现问题主要是还是设计的问题 和layout没关系

    该用户从未签到

    2#
    发表于 2013-3-26 10:50 | 只看该作者
    这类经验确实要多写写啊,能给上些实际操作经验更给力哦

    该用户从未签到

    3#
    发表于 2013-3-26 11:48 | 只看该作者
    VREF要重点加粗,数据等长做5MIL,时钟1MIL,其它20MIL

    该用户从未签到

    4#
     楼主| 发表于 2013-3-26 14:59 | 只看该作者
    lrd 发表于 2013-3-25 22:48
    / A0 Q6 U# [' |. w9 {4 J7 yVREF要重点加粗,数据等长做5MIL,时钟1MIL,其它20MIL

    7 u* x. Y: `) y: a* C2 TVref其实不耗电,走普通的信号线就可以。数据时钟线等长也没必要那么苛刻,我试过跑ddr1600的时候,特地让一条数据线延长1000mil,结果没问题。但延长到2000mil的时候,数据开始出错。
    1 S$ E- X" H- G( Q1 c网上流传的一些秘诀其实是害死人,而且大部分layout工程师也无法接触到ddr的测试,所以容易导致ddr很难布线。( X2 }5 v# [' @
    后面我会更多地谈一谈布线和测试的结果。

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    参与人数 2贡献 +20 收起 理由
    wpc4208211 + 10 支持!多讲讲实际布板和测试后的差异
    chensi007 + 10 很给力!

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    该用户从未签到

    5#
    发表于 2013-3-26 16:00 | 只看该作者
    强烈关注,希望楼主继续分享
  • TA的每日心情
    无聊
    2020-3-10 15:29
  • 签到天数: 1 天

    [LV.1]初来乍到

    6#
    发表于 2013-3-26 17:08 | 只看该作者
    好好学习下0 z' Q# c5 P( d

    该用户从未签到

    7#
    发表于 2013-3-26 22:52 | 只看该作者
    part99 发表于 2013-3-26 14:59
    . w; G7 U- c& i- E1 h' cVref其实不耗电,走普通的信号线就可以。数据时钟线等长也没必要那么苛刻,我试过跑ddr1600的时候,特地让 ...
    . r" o. W& n# c6 _
    等长不等长还要看时序的余量。还有时序余量不足,大批量生产会出问题。会挑DDR.
  • TA的每日心情
    郁闷
    2025-4-28 15:02
  • 签到天数: 13 天

    [LV.3]偶尔看看II

    8#
    发表于 2013-3-27 08:31 | 只看该作者
    part99 发表于 2013-3-26 14:59
    - c' \- h  ], }% C; fVref其实不耗电,走普通的信号线就可以。数据时钟线等长也没必要那么苛刻,我试过跑ddr1600的时候,特地让 ...
    3 G2 U' `  K9 l0 G& ~* v3 {
    赞同,并我的经验数据线相差半周期的1/10没问题。1/1600=625ps,它的1/10=62.5ps,相当于大约450mil,按照lz的情况那应该时钟和数据选通的抖动比较小的情况。

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    9#
    发表于 2013-3-27 08:48 | 只看该作者
    你们DDR是如何测试?有什么专业仪器?还是板上跑

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    10#
    发表于 2013-3-27 09:02 | 只看该作者
    MARK

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    11#
     楼主| 发表于 2013-3-27 09:25 | 只看该作者
    liangjiatian 发表于 2013-3-26 19:48 4 e: F3 b7 J& w2 ~/ ~8 }  Y
    你们DDR是如何测试?有什么专业仪器?还是板上跑
    7 e# d  r+ {' f& b
    测试用安捷伦的示波器,带抖动分析,眼图,ddr抓图的软件,按照JEDEC的标准来一项一项跑。

    该用户从未签到

    12#
    发表于 2013-3-27 11:52 | 只看该作者
    part99 发表于 2013-3-27 09:25 7 e& {  ^" P- O9 m: V8 W9 B# O: p' h
    测试用安捷伦的示波器,带抖动分析,眼图,ddr抓图的软件,按照JEDEC的标准来一项一项跑。
    * T: j% N& S. x$ ]' ]9 r
    但是板上 没测试点 如何测试?
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    发表于 2013-3-27 12:01 | 只看该作者
    / M" j; D- L' r) e$ R" O9 S
    MARK

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    14#
     楼主| 发表于 2013-3-27 18:05 | 只看该作者
    本帖最后由 part99 于 2013-3-30 15:49 编辑 7 T+ G$ T# m! m
    liangjiatian 发表于 2013-3-26 22:52 ( U& l: R% L# q2 s7 b! D
    但是板上 没测试点 如何测试?

    9 W. f5 {/ X) i7 K! O0 ]  \' \# s  H+ A# l# J1 ~7 c
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    [LV.4]偶尔看看III

    15#
    发表于 2013-3-27 23:26 | 只看该作者
    求指导,
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