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为JIMMY出DDR3的教程铺路。

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  • TA的每日心情

    2019-11-20 15:11
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    [LV.1]初来乍到

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    1#
    发表于 2013-3-21 11:56 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    本帖最后由 jimmy 于 2014-1-24 10:08 编辑
    2 Y  P0 w4 ~4 f. Y* @/ N0 Q$ n& k( W8 ]" l4 E# z3 j3 l$ ~, M
    RT,先为JIMMY老大的教程普及基本常识。我想应该有很多人知道数据,地址,控制,命令等等,但好像不能对号入座。哪这里先给出一份名词解析,方便大家。有不对的地方,欢迎指出。
    , y4 H" o5 y2 s- v' `Clocks----时钟; T5 |/ n5 T: p4 a
    CKP CKN -----DDR differential clock outputs-----DDR时钟差分5 \7 C2 X3 ?+ S8 M5 O5 S7 w2 i

    . _9 F( I3 `3 W9 t# |& l+ z9 J( F: JData ---数据: A- e% `* s: G+ }  Z

    . s9 Y& O- J% hDQ -----数据BUS总线
    ' K8 _2 e% T. h( j) ?! \) x! W/ y' @' O7 v8 _
    ECC------自检纠错总线
    , m" T9 j* p* h+ L$ j* \: P7 U, ]* p$ t. i' _
    DM-------Data mask pins 数据屏蔽6 d7 k$ Q( i" @" }
      R9 \  i% R% u" V* a
    DQS------Data strobe pins 数据选通(差分)
    ! C) w) ?% l# y3 l- Y  J8 a: \' E$ p  t1 g3 b, P% ~# I
    Address/Command---------地址/命令3 o; b4 e+ V4 z  k4 F- x$ c# `
    A------Address bus ----------地址BUS总线. Z: |( c6 g1 T9 b

    ( u8 m8 K3 \( U1 W% M" u' \5 DBA ----Bank address --------本体地址(不确定)- j4 H4 i0 w8 m: ^2 z% Q
    . A3 z: n. R( G* |" _5 T" v3 Z
    RAS----Row address strobe---------行地址选通
    / L5 d: S9 E  M) s$ h+ i
    . ?4 x2 a$ ], ?$ s" kCAS----Column address strobe-----列地址选通7 f# }% d  s6 d  Y( x! Y2 m/ F

    + ?9 B* i! J3 V# UWE-----Write enable------------------写入使能* K) ]5 s$ T, j$ i, O8 Y, }: _
    + ?  V% B4 Q2 r& V. n; A' I
    Control----控制* N$ }0 S& r& W  x, N' M$ G
    ODT-------------------------------------片内终结3 }. ]1 b5 A" U7 M, ~* w

    ! L) R: Z0 H1 a, D6 }4 [8 \CKE ------Clock enable----------------时钟使能
    ; p+ Z- _% X, Y' M8 @; K" Q! DCS--------Chip selects-----------------片选
    ! A7 A4 x& ^; c' L  U' }/ f
    ( t8 v8 R1 V4 q8 `4 k0 M: a) s* Z5 b6 e9 B, W- @1 i
    DDR3视频在随书的光盘中有免费赠送!请大家关注新书。
    $ B; o( m( _7 r% Q* j
    1 y+ P% _( d3 m" e8 p" ]! x! c* N+ N购书地址:http://item.taobao.com/item.htm?id=36666373212
    " I# [7 w+ }8 P8 }6 P/ A2 Z5 l' K& q( ]

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    支持!: 5
      发表于 2014-1-26 12:22

    评分

    参与人数 1贡献 +10 收起 理由
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    该用户从未签到

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    发表于 2014-2-8 17:10 | 只看该作者
    DDR3跟DDR2在走线等长方面有哪些不同的要求

    该用户从未签到

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    发表于 2015-4-16 09:58 | 只看该作者
    真的真的要大大的赞一个

    该用户从未签到

    推荐
    发表于 2014-1-25 14:15 | 只看该作者
    感谢一下,是好东西
  • TA的每日心情

    2019-11-20 15:11
  • 签到天数: 1 天

    [LV.1]初来乍到

    2#
     楼主| 发表于 2013-3-21 11:56 | 只看该作者
    本帖最后由 wpc4208211 于 2013-3-21 11:58 编辑
    $ J! r6 J1 c6 d  ~& {& @7 A4 {3 O  E6 \& I2 v
    Feedback-反馈7 X' z' Q# {* R% B9 W- H( E
      L; t: P* j* e" j5 h( d- [, L
    SYNC_OUT---DRAM DLL synchronization output-----同步DRAM的DLL输出
    ' x* }- Y( V; Q" b, H3 i! _* o9 [SYNC_IN------DRAM DLL synchronization input-------同步DRAM的DLL输入' O% b5 d3 y0 R& u) ~$ N

    ; u* E$ L7 Q7 C( ~& \% b1 |- DPower-电源
    % c: M. |7 U5 Y0 |
    1 c% d2 t% d$ ^! u; ?VREF----Voltage reference for differential receivers---采样电压
    ( ~5 p: q: B9 E( m6 MVTT---Termination voltage-----------------------------------端接电压, s) g( N+ _4 T

    点评

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    支持!: 5
      发表于 2014-1-26 12:23

    该用户从未签到

    3#
    发表于 2013-3-21 11:59 | 只看该作者
    铜球

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    4#
    发表于 2013-3-21 12:43 | 只看该作者
    继续
  • TA的每日心情
    无聊
    2025-7-9 15:34
  • 签到天数: 89 天

    [LV.6]常住居民II

    5#
    发表于 2013-3-21 15:22 | 只看该作者
    做DDR的应该都有内部规范,发个过来
  • TA的每日心情

    2019-11-20 15:11
  • 签到天数: 1 天

    [LV.1]初来乍到

    6#
     楼主| 发表于 2013-3-22 20:04 | 只看该作者
    yangjinxing521 发表于 2013-3-21 15:22 / ~; `9 f1 p( v. A- S" P
    做DDR的应该都有内部规范,发个过来

    1 Q2 m4 Y7 S8 D; a给你一个DDR3的文档好了,我帮JIMMY普及的是对应的新手。不是老鸟。你这样的老鸟按理说不需要的。

    DDR3.rar

    953.91 KB, 下载次数: 838, 下载积分: 威望 -5

  • TA的每日心情
    无聊
    2025-7-9 15:34
  • 签到天数: 89 天

    [LV.6]常住居民II

    7#
    发表于 2013-3-22 22:21 | 只看该作者
    wpc4208211 发表于 2013-3-22 20:04
    8 j$ }( m7 q/ ]5 u, w0 \& K; c给你一个DDR3的文档好了,我帮JIMMY普及的是对应的新手。不是老鸟。你这样的老鸟按理说不需要的。
    0 c; P' P- L0 i5 K& J
    我也没做过DDR3的板子。LAYOUT DDR3和新手差不多啊。。。

    该用户从未签到

    8#
    发表于 2013-3-23 09:09 | 只看该作者
    {:soso_e179:}{:soso_e179:} 对于我们新手 是很好的资料了  非常感谢!!

    该用户从未签到

    9#
    发表于 2013-3-23 10:17 | 只看该作者
    太好了

    该用户从未签到

    10#
    发表于 2013-3-23 16:55 | 只看该作者
    受教了

    该用户从未签到

    11#
    发表于 2013-7-5 17:20 | 只看该作者
    很好,适合新手
  • TA的每日心情

    2019-11-19 16:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    12#
    发表于 2013-7-5 23:53 | 只看该作者
    这几天正在学习DDR知识的,加上以前看的资料,感觉懵懵懂懂。1 }9 \; C" z) t) C$ Z+ ?4 ?: S& R
    比如说下面这个DDR2的内部解析图:我一直没搞明白它的列地址线用到了多少根,行地址线是13根吧?那它的总容量应该是行地址数(2的13次幂)X列地址数(2的多少次幂)X8(banks),这是存储单元的总数吧?然后再X16(位宽)才得到的多少Mbit吧?
    # _. i+ `1 j7 @, ~0 Z! j# |虽然有些人说没有必要了解它里面的结构,但我还是想搞明白点。* K+ ~4 t* z$ T7 u

    D9R9F@FFM7OB@W@A9BM~_[H.jpg (97.57 KB, 下载次数: 2)

    D9R9F@FFM7OB@W@A9BM~_[H.jpg

    该用户从未签到

    13#
    发表于 2013-7-6 09:11 | 只看该作者
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