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为JIMMY出DDR3的教程铺路。

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  • TA的每日心情

    2019-11-20 15:11
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    [LV.1]初来乍到

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    1#
    发表于 2013-3-21 11:56 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    x
    本帖最后由 jimmy 于 2014-1-24 10:08 编辑 + r$ R% W5 Y/ q% g
    8 g; d/ e8 d# N  s5 y+ R
    RT,先为JIMMY老大的教程普及基本常识。我想应该有很多人知道数据,地址,控制,命令等等,但好像不能对号入座。哪这里先给出一份名词解析,方便大家。有不对的地方,欢迎指出。) D1 Z  ~- t- _3 f
    Clocks----时钟) K# ]" y. P3 l; ^
    CKP CKN -----DDR differential clock outputs-----DDR时钟差分
    4 v% R1 i0 L3 o  Z3 j
    5 o6 V  W3 x& R/ KData ---数据. H  }1 D* k+ }

    1 B. S2 [5 u' m( o( \DQ -----数据BUS总线
    ( g* m9 K, T$ O* Z: W/ D* m' x6 x( T  X0 I7 ]! l/ s4 e
    ECC------自检纠错总线- `8 E9 s& g; k# s; S1 c1 r* }, l- S. ~
    / i8 u8 p+ [) @% j  G
    DM-------Data mask pins 数据屏蔽! g* I% H+ G) q4 E0 ]; j
    / m  _( _' i' l; |: I
    DQS------Data strobe pins 数据选通(差分)6 c2 O1 }2 [4 w% \" _/ u. X! W
    ) _" u! f& p; g
    Address/Command---------地址/命令
    5 F' W" @; w0 |* F' bA------Address bus ----------地址BUS总线" C" a: w- m+ y( n( k' P! C
    1 R6 E" S# X7 C6 ?  c5 S) D# @
    BA ----Bank address --------本体地址(不确定)  Y, d& M1 V: p( r/ G5 b

    9 ?3 \- J, D2 I7 E7 X4 qRAS----Row address strobe---------行地址选通
    # f, H& R4 j, f4 O2 }
    " W* Y2 c& W. X0 j, B9 U, W/ `/ j( fCAS----Column address strobe-----列地址选通7 {; S. b# H3 z
    0 p% q. A* G# O+ H7 a: m
    WE-----Write enable------------------写入使能9 G( t* C% t4 p1 A
    . ^4 S9 n! l* j) Z+ |
    Control----控制2 I; k4 D/ h* |: H
    ODT-------------------------------------片内终结
    8 b  C* T" t- C# D
    6 I9 v  s4 x3 U8 F/ n! _5 Z$ ECKE ------Clock enable----------------时钟使能% W+ V9 a; k! o% `( S. Y  t6 G/ _
    CS--------Chip selects-----------------片选  B5 i! }- T) s/ J
    " k# ?  I$ }! G* q: [

    1 `5 A# D( G' GDDR3视频在随书的光盘中有免费赠送!请大家关注新书。
    $ Z8 l  L: l8 C( Y/ T" q3 L
    # L; f# ~3 M" g* w购书地址:http://item.taobao.com/item.htm?id=36666373212, W6 V/ E  T& P5 X/ J
    3 X0 q1 u) s& Z9 _

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    支持!: 5
      发表于 2014-1-26 12:22

    评分

    参与人数 1贡献 +10 收起 理由
    jimmy + 10 赞一个!

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    该用户从未签到

    推荐
    发表于 2014-2-8 17:10 | 只看该作者
    DDR3跟DDR2在走线等长方面有哪些不同的要求

    该用户从未签到

    推荐
    发表于 2015-4-16 09:58 | 只看该作者
    真的真的要大大的赞一个

    该用户从未签到

    推荐
    发表于 2014-1-25 14:15 | 只看该作者
    感谢一下,是好东西
  • TA的每日心情

    2019-11-20 15:11
  • 签到天数: 1 天

    [LV.1]初来乍到

    2#
     楼主| 发表于 2013-3-21 11:56 | 只看该作者
    本帖最后由 wpc4208211 于 2013-3-21 11:58 编辑 : X7 E& o) G; p1 X

    ! O, v- f6 a! l/ f* r  `Feedback-反馈
    # y4 T9 ?( t1 c- s. q' K( J
    + P+ H3 y+ X0 e3 ^& g3 A$ k$ x) a4 h: sSYNC_OUT---DRAM DLL synchronization output-----同步DRAM的DLL输出
    , X' t( `  W' y/ x! S" M% K4 eSYNC_IN------DRAM DLL synchronization input-------同步DRAM的DLL输入
    0 u8 ~; u: C) R2 i! P9 q% V! s* L" L$ ~
    Power-电源$ Y, [' ~0 a+ C8 L( P! o

    ' A( G2 G. i1 J" X- G, {" zVREF----Voltage reference for differential receivers---采样电压4 L- ?. V$ j6 s( L  T! q! v  s! |
    VTT---Termination voltage-----------------------------------端接电压
    4 y. Y+ X! B2 ]3 d2 |

    点评

    支持!: 5.0
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      发表于 2014-1-26 12:23

    该用户从未签到

    3#
    发表于 2013-3-21 11:59 | 只看该作者
    铜球

    该用户从未签到

    4#
    发表于 2013-3-21 12:43 | 只看该作者
    继续
  • TA的每日心情
    奋斗
    2025-9-29 15:28
  • 签到天数: 114 天

    [LV.6]常住居民II

    5#
    发表于 2013-3-21 15:22 | 只看该作者
    做DDR的应该都有内部规范,发个过来
  • TA的每日心情

    2019-11-20 15:11
  • 签到天数: 1 天

    [LV.1]初来乍到

    6#
     楼主| 发表于 2013-3-22 20:04 | 只看该作者
    yangjinxing521 发表于 2013-3-21 15:22
    ! h1 o$ W+ M3 O8 Z/ P做DDR的应该都有内部规范,发个过来

    / ^' @* B" H) v0 v# c给你一个DDR3的文档好了,我帮JIMMY普及的是对应的新手。不是老鸟。你这样的老鸟按理说不需要的。

    DDR3.rar

    953.91 KB, 下载次数: 838, 下载积分: 威望 -5

  • TA的每日心情
    奋斗
    2025-9-29 15:28
  • 签到天数: 114 天

    [LV.6]常住居民II

    7#
    发表于 2013-3-22 22:21 | 只看该作者
    wpc4208211 发表于 2013-3-22 20:04
    . n1 l+ u& f! v) n- j, P( U- p给你一个DDR3的文档好了,我帮JIMMY普及的是对应的新手。不是老鸟。你这样的老鸟按理说不需要的。

    4 _2 c7 ?( i, s9 h. ~! `% A% w, s我也没做过DDR3的板子。LAYOUT DDR3和新手差不多啊。。。

    该用户从未签到

    8#
    发表于 2013-3-23 09:09 | 只看该作者
    {:soso_e179:}{:soso_e179:} 对于我们新手 是很好的资料了  非常感谢!!

    该用户从未签到

    9#
    发表于 2013-3-23 10:17 | 只看该作者
    太好了

    该用户从未签到

    10#
    发表于 2013-3-23 16:55 | 只看该作者
    受教了

    该用户从未签到

    11#
    发表于 2013-7-5 17:20 | 只看该作者
    很好,适合新手
  • TA的每日心情

    2019-11-19 16:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    12#
    发表于 2013-7-5 23:53 | 只看该作者
    这几天正在学习DDR知识的,加上以前看的资料,感觉懵懵懂懂。
    ; o' i$ Z; j5 X- |比如说下面这个DDR2的内部解析图:我一直没搞明白它的列地址线用到了多少根,行地址线是13根吧?那它的总容量应该是行地址数(2的13次幂)X列地址数(2的多少次幂)X8(banks),这是存储单元的总数吧?然后再X16(位宽)才得到的多少Mbit吧?
    4 t7 K; I0 {$ M# q虽然有些人说没有必要了解它里面的结构,但我还是想搞明白点。- R: M: k8 ^- |* G

    D9R9F@FFM7OB@W@A9BM~_[H.jpg (97.57 KB, 下载次数: 4)

    D9R9F@FFM7OB@W@A9BM~_[H.jpg

    该用户从未签到

    13#
    发表于 2013-7-6 09:11 | 只看该作者
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