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IIC电平为什么会被拉低?

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1#
发表于 2013-2-27 09:02 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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我现在在调试一板子,3组IIC共用一组硬件IIC,接有3.3V上拉(standby后依然有电),在standby状态下,只要触摸IC的IIC在通讯,另两组IIC的IC均不供电,但这种条件下,IIC的电平被拉低至1.14V,导致触摸按键无作用。

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2#
发表于 2013-2-27 09:17 | 只看该作者
应该是上拉电阻的阻值大了,换个小的试试……

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3#
 楼主| 发表于 2013-2-27 09:19 | 只看该作者
386019920 发表于 2013-2-27 09:17
: n4 H0 `1 I" @5 c: ~  ]应该是上拉电阻的阻值大了,换个小的试试……
) Q1 s% p4 o5 d% ]8 \
上拉电阻本来是10K的,我换了个4.7K的上拉,依然不行

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4#
发表于 2013-2-27 09:45 | 只看该作者
licvin 发表于 2013-2-27 09:19 " V6 z* r9 Y" ]$ w( A
上拉电阻本来是10K的,我换了个4.7K的上拉,依然不行
6 x; b4 E0 @& s+ Z# n
IIC的电平被拉低至多少?

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5#
 楼主| 发表于 2013-2-27 10:01 | 只看该作者
386019920 发表于 2013-2-27 09:45 & U  u" K7 U$ q  N3 y; S# q8 O
IIC的电平被拉低至多少?

+ _0 F; v7 ~, U上拉电阻接1K,电压被拉低至1.16V。

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6#
发表于 2013-2-27 10:09 | 只看该作者
除非有芯片被击穿,否则不会被拉低。你说的是I2C在通讯的时候,直流电压测量是1.16V吧,说明有信号和时钟在走,这是对的,用示波器一看就知道什么回事了。

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7#
发表于 2013-2-27 10:23 | 只看该作者
查一下另两组接口的资料。仔细看看。曾碰到过类似的问题。最后是更新了另外一组的代码就搞掂了。那一组的IIC在不上电或没复位的状态下是低的。

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8#
 楼主| 发表于 2013-2-27 14:25 | 只看该作者
reval 发表于 2013-2-27 10:23
/ |% b) H! d; G) w3 [" K查一下另两组接口的资料。仔细看看。曾碰到过类似的问题。最后是更新了另外一组的代码就搞掂了。那一组的II ...

1 N( c" j- q3 N; T3 `; x- T我也这么认为,所以有跟软件工程师沟通过,但他们说另两组在不通讯的时候,是设置为1的。用示波器测试过波形,CLK,DATA波形都是正常的,就是电平有3.3V变为1.14V。

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9#
发表于 2013-2-27 14:43 | 只看该作者
明显的被软件当作IO在操作

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10#
发表于 2013-2-27 16:11 | 只看该作者
另外两组IIC 的IC 有没有供电?如果没有供电,会将电压下拉。

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11#
发表于 2013-2-27 16:18 | 只看该作者
可能发原理图上来,大家参考一下,也可以拆掉不同的组,很容易搞掂

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12#
 楼主| 发表于 2013-2-27 17:51 | 只看该作者
reval 发表于 2013-2-27 16:18 . U5 }- ^$ }' ?3 u: [
可能发原理图上来,大家参考一下,也可以拆掉不同的组,很容易搞掂

2 _7 b# {7 Q+ u2 q, r去掉另外两组IIC,依然无法正常通讯,所以我在想,是不是需要三组IIC同时通讯,才可以正常运行?!按理说,各组IIC是互不影响的。在standby下,只有触摸IIC WT5700正常供电。

QQ截图20130227175358.jpg (39.29 KB, 下载次数: 0)

QQ截图20130227175358.jpg

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13#
发表于 2013-2-27 23:54 | 只看该作者
本帖最后由 超級狗 于 2013-2-28 00:12 编辑
) `/ h" R7 u* `; l! U* u: z+ o* X" _# n8 W9 l& f: m! z
I2C 的雙向架構是由兩個部份所構成,送的部份是一個 Open Collector 或 Open Drain 線路;收的部份則是一個 CMOS Input線路和前述的 Open Collector 或 Open Drain 線路並接在一起。
) o6 \( |% u  ~& A# _* L" T
) ], i. {5 w: [' y$ T+ R; J, q6 P當你不給電時,Open Collector 或 Open Drain 的電晶體(Transistor)Gate 沒有電壓,電晶體有可能處於半開或全開的狀態。
4 O" o; J; D5 z) o4 V& G* B; x9 S* O. l2 C3 |
另一方面 CMOS 線路沒電時,電晶體(Transistor)Gate 沒有電壓,電晶體也是可能處於半開或全開的狀態。
. @5 a" R) [. S+ T5 _  s1 \7 Z
) T8 v# B, \6 T. M如果你的問題是其它 2 個 I2C Device 給電就不會發生,那就應該是漏電把電位(Voltage Level)拉低的。
. R6 O8 _) R' W. j9 {6 f3 E) P3 K9 U# u/ ]1 @0 @6 W
任何 IC 如果沒特別說明不給電時 I/O 腳位是高阻抗(Hi-Z 或 High Impedance)狀態,都有可能會透過 I/O 接腳造成漏電。
. E: A( m( ?9 i( w/ W9 E3 ^/ F+ h4 Z+ @) x/ A: Y+ h; \
如果你的設計為了省電,會有部份系統斷電(Partial System Power Off)的需求,一般我們的解法是去找一顆有電源隔離(Power Isolation)Buffer 或 Level Translator 把 Bus 兩端的 Device 隔開。
$ |3 p. {+ l. L5 R; ~, j; F  I4 F! ~7 e
所謂有電源隔離(Power Isolation)的 IC,是這種 IC 會個別吃兩端系統的電源,當任一邊的電源消失時,IC 所有的I/O 接腳都會變成高阻抗(Hi-Z 或 High Impedance)狀態,這樣就可以防止漏電的情況發生。6 E0 |; ^- q* I0 x8 H  i# f9 ?

# N/ r' ~/ v6 i. [& H詳細您可參照TI I2C Level Translator TXS0102 的 Datasheet!2 _$ k. \/ o+ h& b2 t  K0 E
7 _7 y& C& J* Z. N( v( n) o
http://www.ti.com/lit/ds/symlink/txs0102.pdf; L2 h' w% C& j; \

5 [1 {0 r" G( m$ k{:soso_e176:} $ N2 y( w$ t1 S( j, ~" F
3 {% [( b' E6 ]  ~" K) W% Y

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14#
发表于 2013-2-28 00:10 | 只看该作者
如果你所謂的去掉 2 組不供電的 I2C 是把 33R 電阻拿掉,但其它 2 個不給電的 Device 還是有其它接腳和 MCU 或其它有電的 IC 相連,這樣還是有可能有漏電的危險。2 Q2 ?  H3 q/ I5 W+ T# v

2 ?5 P& A( T3 S0 @漏電造成 IC 不完全或是不正常的工作!, d* @# H/ y* t9 S% W& u  }2 ^
1 q# L* }3 K1 d
其實你只要用電錶量其它 2 顆不供電的 IC 上的電源或 I/O 接腳,只要能量到一些類似 0.3V、0.6V 這種微弱的電壓,那就表示有漏電的狀況發生了!! \( L, o: t9 F. @3 F4 z
0 I2 A- Y) ]; ]% n
漏得嚴重的還可能會量到超過 1V。( O% p3 O4 I4 O. l
  h# O1 r* K0 ]' }$ a" \5 c

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15#
发表于 2013-2-28 07:15 | 只看该作者
按楼主的意思是取掉其它两组的电阻,在STANDBY状态下,IIC电压还是低的。那就去查程序吧。
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