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CPU不工作

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1#
发表于 2012-12-24 23:12 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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CPU与FPGA的公共电源为1.8VIO,由一路开关电源供电。FPGA还有一个CORE电压为1.1V。
% b2 g3 L$ m/ _: k- ]0 `% k- @* ?  z现在的情况是CORE必须后于1.8V的IO上电FPGA才可以正常工作。于是在CORE上面加了个延时,50ms吧,于是系统开始正常跑了。频繁断电上电后,会出现CPU不工作的情况,测量电压输出正常。再加大延时,100ms吧,比50ms的情况好多,但是频繁上电以后还是出现同样现象。: @5 P: X$ m; H0 ?  g
CPU采用PMIC,FPGA CORE用PWM,他们的source是一样的。/ N" d4 f+ z/ w6 C/ D3 `# v* `  P
延时电路是用FDS4395加上RC延时撘的。电流需要流过PMOS。
1 _" Q- |, Y9 P9 n& @: N当CPU不工作以后,将FPGA CORE的1.1V取下,CPU马上正常工作4 C! B4 v: O0 H" S2 X8 Z8 i4 v
现在的疑问是,FPGA的与CPU仅仅是电源的输入是一样的,怎么FPGA会影响CPU呢,奇怪。
) v" a- k% a7 M$ u( u- x也请大家指点。
/ f! F* H' T" `3 w# ~谢谢先

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2#
发表于 2012-12-25 07:43 | 只看该作者
"频繁的断电上电" =>不知道中間的間隔的時間夠不夠使 CPU 所有电压放到 0.7V 以下? 怕是速度太快,造成開機的 RESET 失效。用示波器看一下 RESET 信號的電平正不正確?可能要設計一個關機的時候加速放電的電路。
0 J$ M5 e" h) B2 x
- r$ I, a1 z4 D- W"FPGA的与CPU仅仅是电源的输入是一样的,怎么FPGA会影响CPU呢"  =>  FPGA 可能是有漏電行為,造成 CPU 開機的 RESET 失效。或是 CPU 軟件在等待  FPGA 回答,所以拖住  CPU  動作。
5 W+ ~- a- h, F6 x1 r; W4 q/ s

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3#
发表于 2012-12-25 09:29 | 只看该作者
验证下,如果不进行频繁的上下电,是否工作正常,或是上下电间隔时间大一点会不会出现相同现象?

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4#
 楼主| 发表于 2012-12-25 14:34 | 只看该作者
jacklee_47pn 发表于 2012-12-25 07:43
( ~/ o/ w8 o) c3 G"频繁的断电上电" =>不知道中間的間隔的時間夠不夠使 CPU 所有电压放到 0.7V 以下? 怕是速度太快,造成開機 ...

. c9 W5 r. b) Q3 y; c间隔时间是有个1~2秒,你说的CPU电压到0.7V以下reset正常有什么参考理论吗,我想知道下他的原理。
; d" O, a# z9 QFPGA的漏电行为一般是什么原因造成的呢,
/ F* \8 \" J/ r* a  F2 i! L+ i这个系统CPU的启动与FPGA无瓜葛,FPGA基本上相当于一个NOR flash,我CPU按时去读他的数据就可以了。
5 Q- [4 W% g+ }$ ]还有一个现象是,我不给FPGA加CORE电源,那么CPU每次都是正常启动的。
头像被屏蔽

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5#
发表于 2012-12-25 14:42 | 只看该作者
提示: 作者被禁止或删除 内容自动屏蔽

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6#
 楼主| 发表于 2012-12-25 14:54 | 只看该作者
edajf 发表于 2012-12-25 14:42 4 z6 l( G0 N0 _9 r1 l* \! b6 [
FPGA哪里接了大电容么?如果接了大电容,开机关机电还没放完,导致上电时序又变了,上电时序可能导致CPU起不 ...
+ N/ K  x$ W  L& Q/ f2 R
因为FPGA的CORE必须要晚于IO上电,CPU才可以起来,所以在CORE的输入上飞了一个延时电路,用RC控制PMOS通路慢慢打开,电容10uF,电阻1M,(最初是100K,300k,820k,1M 以为感觉延时大点CPU就不那么容易当掉)。
' ^( m: f7 Z% N7 `" n0 t5 i现在又想起另外一个关键的地方,为什么FPGA的CORE晚于IO(也是CPU的DDR电源),CPU就会起不来呢。目前还没有做一个仔细的测量,仔细测量一下再与大家讨论@~@

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7#
发表于 2012-12-25 15:10 | 只看该作者
legendarrow 发表于 2012-12-25 14:34
- l) ]6 M: @& n/ G' C$ _) |间隔时间是有个1~2秒,你说的CPU电压到0.7V以下reset正常有什么参考理论吗,我想知道下他的原理。
( n  u; _& ]- f' rFPGA的 ...

0 ]; V( U/ K4 g. @( K0 h5 C0.7V 這是經驗值,真正要看你的 CPU 和 RESET 電路來決定。
3 `7 F6 v# \- k
/ K3 I+ @2 b- y: G3 ]( }- f5 o  Y* C如果 CPU 只使用 RC 來做開機 RESET,一些單晶片 (例如 8751) ,你可以試試看,開機關機速度過快 CPU 會不動,甚至於會發燙。因為矽半導體的電位差最小是 0.7V。當 CPU 沒有放電乾淨並且 RESET 失效的時候,Program Counter  (PC 寄存器) 是不會乖乖地從 RESET 指定地址開始 (我不說從 0x0000H,是因為不是所有的 CPU 都是 0x0000H 開始)。開機如果不是從 RESET 指定地址開始,有機會進到不對的無窮迴圈,或是造成機器錯誤的動作。8 E- B; i' _( ~8 S

4 [# T7 O" X1 r/ a如果 CPU 有使用專屬的 RESET IC ,那就要看 RESET IC 的特性。除了開機 RESET 之外,是不是有監看電壓瞬間掉落到某程度,然後會重新發出 RESET 信號。而這個監看電壓掉落的值是多少? 當你快速開機關機,有沒有低於這個監看電壓?# [; r; K0 S: ?$ k! R$ }6 C8 M

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8#
 楼主| 发表于 2013-1-5 17:30 | 只看该作者
jacklee_47pn 发表于 2012-12-25 07:43
6 x7 j# B% z2 l"频繁的断电上电" =>不知道中間的間隔的時間夠不夠使 CPU 所有电压放到 0.7V 以下? 怕是速度太快,造成開機 ...

' `" J& H! {% ^& P' h: d确认是放电未放完导致的,只要掉电与上电的时间很短,CPU就无法启动,稍微长点(2s左右)就没有问题了。
* |9 ^, y. H+ o7 u9 e# C现在在想做一个加速放电电路,没什么思路,有经验的还请指导下。

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9#
发表于 2013-1-6 11:31 | 只看该作者
jacklee_47pn 发表于 2012-12-25 07:43
5 u7 C6 b+ ~/ m+ W* Z' r* i"频繁的断电上电" =>不知道中間的間隔的時間夠不夠使 CPU 所有电压放到 0.7V 以下? 怕是速度太快,造成開機 ...

! j) A  l. i' X! g2 y' ?: O4 o又学习了。。

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10#
发表于 2013-1-6 12:24 | 只看该作者
问题解决了没,要不你把延时再加大

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11#
发表于 2013-2-18 13:09 | 只看该作者
保险起见,电容搞小一些吧

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12#
发表于 2013-2-19 16:19 | 只看该作者
在电容上并个二极管试试。
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