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本帖最后由 超級狗 于 2025-4-8 08:19 编辑
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随着数据速率超过Gb/s水平，工程师必须能够识别和解决抖动问题。抖动是在高速数据传输线中导致误码的定时噪声。如果系统的数据速率提高，在几秒内测得的抖动幅度会大体不变，但在位周期的几分之一时间内测量时，它会随着数据速率成比例提高，进而导致误码。新兴技术要求误码率(BER)，亦即误码数量与传输的总码数之比，低于一万亿分之一(10-12)。随着数据通信、总线和底板的数据速率提高，市场上已经出现许多不同的抖动检定技术，这些技术采用各种不同的实验室设备，包括实时数字示波器、取样时间间隔分析仪(TIA)、等时取样示波器、模拟相位检波器和误码率测试仪(BERT)。为解决高数据速率上难以解决的抖动问题，工程师必需理解同步和异步网络中使用的各种抖动分析技术 本文重点介绍3 Gb/s以上新兴技术的数据速率。低于3 Gb/s的实时示波器可以捕获连续的数据流，可以同时在时域和频域中分析数据流；在更高的数据速率上，抖动分析要更具挑战性。本文将从数字工程师的角度，介绍应对SONET/SDH挑战的各种经验。 抖动分析基本上包括比较抖动时钟信号和参考时钟信号。参考时钟是一种单独的黄金标准时钟，或从数据中重建的时钟。在高数据速率时，分析每个时钟的唯一技术是位检测和误码率测试；其它技术则采用某种取样技术。 如图1所示，眼图是逻辑脉冲的重叠。它为测量信号质量提供了一种有用的工具，即使在极高的数据速率时，也可以在等时取样示波器上简便生成。边沿由‘1’到 ‘0’转换和‘0’到‘1’转换组成，样点位于眼图的中心。如果电压(或功率)高于样点，则码被标为逻辑‘1’；如果低于样点，则标为‘0’。系统时钟决定着各个位的样点水平位置。 9 L# Y/ ^6 |) X
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发表于 2025-4-7 16:20