运放输入共模电压问题

再见海贼王

再见海贼王 发表于 2024-12-31 11:40
" ~7 Y4 {5 ]' P我邮件问的和帖子一样，由于一些原因，原邮件不方便贴出；Ti回复的译文如下：（我感觉就是在给我科普） ...

; D+ Q* y! h2 h1 S) r2 [# T”Ti确实告诉我超过了范围会出问题“；至于如何设计确保不超过，以及我的计算和参数不一致问题只字不提，甚至不愿指出我理解的参数范围错误。国外巨头尚且如此，guochan的可想而知了；总之感谢各大佬的指点，不过到现在为止我还是不知道我的计算方式哪里出问题了，还是说这个真的没法估算我的思路走偏了，继续啃书ing。

huo_xing

再见海贼王 发表于 2024-12-31 09:58
是这样的，因为VP和VN是在芯片内部无法直接测量；通过你的点播后我是这样想的VREF/2经过电压跟随器可以等 ...

芯片内部功能估计FAE都不会知道。如果实在要搞命名去问原厂。

再见海贼王

huo_xing 发表于 2024-12-31 13:42
芯片内部功能估计FAE都不会知道。如果实在要搞命名去问原厂。

确实如此，我本意不是想弄清楚内部原理，我只想知道如何判定这种运放电路设计时会不会出现共模超标问题！

bazhonglei

看手册上提到的共模电压是指SPx和SNx，器件厂家没必要在手册给你标出器件内部运放的共模电压，这个-0.15V到0.15V的共模电压和手册上的差模电压-0.3V到0.3V相对应，均指器件的SPx和SNx引脚，并不是指运放的正输入端和负输入端的共模电压！

超級狗

再见海贼王 发表于 2024-12-31 09:14
( l, D; g/ F3 d感谢解答，那如何在实际应用中确保输入共模范围不超过参数要求造成失真或者损坏芯片呢。

樓主應該再往下看一點的！

3 c2 \$ s- N* x9 }5 B% h  c2 ~

kevin890505

& `8 m; x! o4 I" Z7 h3 U
1,DS的Vcom共模，个人理解是SP/SN引脚的对地电势，即就是±0.15V，不能超出此值，这个不是因为会坏，主要是内部运放会进入非线性区，放大比例就不对了(DS后面有说明)，一般用来采样电流电阻两端的电压也不会太大，手册写的没问题；
, g( ^9 t$ s  D! G! n$ P% D2 j; ?- Y) O2，（VP+VN）/2=(VREF/2+VREF/2)/2=VREF  这个是怎么来的没看懂，Vref是用于给输出端的静态工作点偏置，有可能也给运放供电(没仔细看DS，猜的，不然SO也不会和Vref挂钩，Vref电流也不会有2~3mA这么大)，和Vcom无关；
  M/ Z3 D0 b5 K$ I* k2 r3 a* b/ s+ M3，这是一个普通的差分放大电路，只不过输出静态工作点从0V加了Vref/2的偏置罢了，楼上有人说了这个Vcom不是运放的vcom是这个引脚的vcom，个人感觉你应该是把这两个混了，你计算了Vref分压以后推出来的电压是内部运放引脚的，比如从这个芯片角度看，SN引脚的电压始终是0V；
4，参考手册42和44页的图，对于SP和SN的电压，以及和SO/VREF间输出的关系已经说的非常清晰了。
5，你可以用TINA-TI搭一个一样的电路，仿真一下就很直观了

超級狗

+ A0 p" i) I* f3 p& b- q1 j
詳見附圖中 Common Mode Input Voltage Range 的標示！
- t) E" e3 @! S( e5 V+ N
' x3 X# J4 a1 J3 ~* L1 N
1 H4 H# t4 O6 W. Z8 y& Z! B- p


6 Q, s7 q& z0 V6 H) q# s. W4 [

再见海贼王

bazhonglei 发表于 2024-12-31 22:59
看手册上提到的共模电压是指SPx和SNx，器件厂家没必要在手册给你标出器件内部运放的共模电压，这个-0.15V到 ...

非常感谢，也就是手册给的共模输入电压范围，与运放引脚输入共模电压范围是两回事；这样说确实合理了。

再见海贼王

超級狗 发表于 2025-1-1 01:14
. g" B1 A$ U" I; o% B6 A9 W; q樓主應該再往下看一點的！

我确实没有看的这么细；最近正好在看运放的，所以第一时间就往这方面想了，
/ S$ h7 Z# d* _& K

再见海贼王

kevin890505 发表于 2025-1-1 01:22
1 k1 E$ l+ \1 v; g1,DS的Vcom共模，个人理解是SP/SN引脚的对地电势，即就是±0.15V，不能超出此值，这个不是因为会坏，主要是 ...

% t  k# ~, o, s7 h( I感谢版主大大，我误以为规格书说的共模，指的是内部引脚的，自然而然想到VREF偏置对引脚引起的共模电压，这个确实是我自己理解没到位

再见海贼王

超級狗 发表于 2025-1-2 08:20
詳見附圖中 Common Mode Input Voltage Range 的標示！

% J4 Y7 J# g/ l* q: g, ^感谢狗班竹，新年快乐！
5 t9 U( A( W  T  }

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狗哥因该是在台湾，