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[Cadence Sigrity] SPEED 2000 DDR 仿真 如何建立VRM问题

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  • TA的每日心情
    开心
    2025-6-23 15:02
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    [LV.6]常住居民II

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    1#
     楼主| 发表于 2024-9-27 17:56 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    各位老师,我再进行DDR仿真时,设置BUS Groups时,网上的资料有VRM的勾选,但是我的没有,请问这一步如何建立呢?
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    1.jpg (95 KB, 下载次数: 7)

    1.jpg
  • TA的每日心情
    慵懒
    2024-12-11 15:45
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    [LV.4]偶尔看看III

    推荐
    发表于 2024-9-28 21:59 | 只看该作者
    在这里,先建一个Model Definition,再建New Component并连接到相应的网络。
    $ r( J( H# }9 J7 s* V9 b

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    无标题.png

    点评

    确实是这个流程,已学会,谢谢老师。  详情 回复 发表于 2024-11-16 12:24
  • TA的每日心情
    擦汗
    2025-7-13 15:01
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    [LV.6]常住居民II

    3#
    发表于 2024-10-21 21:39 | 只看该作者
    定义一个模型,在定义一个器件,赋SPICE网表就行
  • TA的每日心情
    开心
    2025-6-23 15:02
  • 签到天数: 111 天

    [LV.6]常住居民II

    4#
     楼主| 发表于 2024-11-16 12:24 | 只看该作者
    y_d21 发表于 2024-9-28 21:59
    3 s; `$ j; M( ?9 [在这里,先建一个Model Definition,再建New Component并连接到相应的网络。

    & e  }9 h2 P: W2 ]/ i确实是这个流程,已学会,谢谢老师。
    6 |9 \. A/ j8 `( {! G
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