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[Cadence Sigrity] DDR SI

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1#
 楼主| 发表于 2024-6-12 08:38 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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用Sigrity仿8GbD的LPDDR4,厂商只给了4Gb的IBIS和一些EBD文件,8Gb是两个4Gb组成的,8Gb和4Gb的有效引脚不一样,请问各位大佬这种情况如何去仿DDR的数据和地址控制信号?EBD文件怎么使用呢?

该用户从未签到

2#
发表于 2024-6-12 11:27 | 只看该作者
我是小白,同问同问
  • TA的每日心情
    开心
    2023-11-28 15:11
  • 签到天数: 1 天

    [LV.1]初来乍到

    3#
    发表于 2024-6-14 14:09 | 只看该作者
    你打算用哪个仿真软件进行仿真?
    : ~6 p) G3 g1 y1 x2 `. R# {

    点评

    SYSTEM SI,SPDGEN也可以只是不知道怎么加载  详情 回复 发表于 2024-6-14 15:20

    该用户从未签到

    4#
     楼主| 发表于 2024-6-14 15:20 | 只看该作者
    hewin666 发表于 2024-6-14 14:09
    ! u* @6 D5 d, }' c9 j6 ]你打算用哪个仿真软件进行仿真?

    5 a1 E  t- ?$ ]6 TSYSTEM SI,SPDGEN也可以只是不知道怎么加载

    该用户从未签到

    5#
    发表于 2024-8-7 16:44 | 只看该作者
    进来看看,学习一下,是不是layout的尽头是SI仿真?
    2 N( [' Y" P6 z& C7 B4 B5 w; m
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