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AD高手帮忙,还是关于违反元件间距规则的问题

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1#
发表于 2012-7-25 03:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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还是关于altium的元件间距违反规则的问题,我的前一贴可能大家没看明白,这回说详细点吧。; K4 E! Q+ G8 j) I' @1 b
每个人肯定都想把元件放的整整齐齐的,并且以最小规则约束间距靠紧,比如像下图,我设置的是0.2mm的元件间距,不是线间距。
8 }+ r9 _8 u. }, v' `% Z, Y! x( y
& F% J: B" x3 p7 e首先说明这是0603的元件,我做的很规整,丝印线0.2mm,宽1.6mm,长3.2mm。可是我在ALTIUM放置元件的时候,发现以0.05mm的GRID移动时,竟然不能以最小元件间距0.2mm放置,就像下图,4个0.05mm的间距明明是0.2mm,可是报告说我违反了component clearance规则,这个在protel99SE里是完全没问题的。" y, a% b( h6 S" x. L1 C- G7 C

: [& R- }3 |: F- `$ Z4 q& S! E+ ~还有更纳闷的事,下图也是4个0.05mm的GRID,可是却报告说间距是0.138mm
. }4 D% R+ @2 [- u( `4 u4 G # L3 S& H& a1 i# v' P
我查了半天才发现,选中上面的元件时其阴影超出了元件封装范围,见下图: A& B1 P: n" `4 y1 N0 g
/ U% S, M8 F0 M2 O  O
所以这里确实要比0.2mm的元件间距要小,我就不明白了超出的阴影范围哪来的,还有我的两个电阻没有这个阴影,可为什么还是报错
- h0 q. g( m! \9 A# g- L ' X6 Q) a6 u- y" Z: b9 P0 E  A4 N

, t1 D- i9 k! G2 O" f# i还有个问题,为什么顶层,底层的元件放一起也会说违反元件间距约束
3 c; c. n. m" V! t! R& s- i+ z
8 n$ I8 D5 P6 o( S
! T, m! [$ u6 R4 \请AD高手帮帮我,非常感激
  d" D2 k, k" v7 A6 _

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2#
发表于 2012-7-25 08:34 | 只看该作者
( D7 y0 N6 ^- D1 g) |9 s
你把你选的那个Infinite选项勾选成Specified试试....

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3#
发表于 2012-7-25 08:39 | 只看该作者
其实想要在在布局的时候把器件摆放的美观没有必要这样...你这样设置器件间距规则是自寻烦恼...你可以将这个规则关闭...布局的时候使用15mil以上的grid进行大致布局...关于容阻的摆放就可以用5mil-10mil的grid就行了....也许是我的个人习惯...我都是这样布局的...器件间距规则我从来不开的....

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wanghanq + 5
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黑驴蹄子 + 5

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4#
发表于 2012-7-25 09:02 | 只看该作者
这个问题就清楚了嘛,其实元件的间距根本不是以元件的丝印来决定的,LZ大概只用AD和protel,所以对这个概念不是很清楚
% r  K' n9 x$ f
; n  x- k. f" ?) ^5 E% T- y如果你用PADS和ALLEGRO的话你就知道了,我拿ALLEGRO封装制作给你说明:
( K6 R& N  \% y# h
* a% a- Z5 n9 |9 k在ALLEGRO制作元件封装的时候,通常CLASS有个Package Geometry项目& g2 {5 o8 P4 H2 }& k0 |
下面SUBCLASS有个Place_Bound_Top,而在这个想添加Bound_Top为的就是来定元件的占地区域3 d4 J  x: o+ Z: @# _7 Q
这个区域一般都要比元件的最外边框要大一点点(当时是根据设计者来的)
. S" E2 a, {) I: `  E) @9 e0 G) v. T% {
在AD中,简化了这些概念而已,其实元件默认的Bound还是有的,只是一般我们不去设计,在封装向导的最后几步,有几个项目,我们一般是直接按默认的点,我也没仔细去研究,其中好像就有元件的外形大小设置,下图是我从AD封装向导截来的
/ \0 [* S# M! f  i- E! T
( {. I& Y# |5 x! |7 S9 B9 o我说了这么多希望你明白了# u# x4 n: q# [" d9 S

" z# a  K! x$ f1 {, x( z# F( F
/ ~( I9 O; X4 ?: l/ h 2 z2 l2 c& S( J1 J0 E. s
" f& x) R7 x: o: Y9 Q* B& l) j
6 \& P" X( \& y& V, B4 M; s  m

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zhengzy + 5
wanghanq + 5
77991338 + 10 确实,用过allegro就知道封装里面Package Ge.

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5#
发表于 2012-7-25 09:05 | 只看该作者
77991338 发表于 2012-7-25 08:34
$ _- [- e7 |( b& L/ y, ]你把你选的那个Infinite选项勾选成Specified试试....
! v6 y3 m; Q6 h
这个是设置垂直间距模式:无限间距模式和指定间距模式

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77991338 + 10

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6#
发表于 2012-7-25 09:49 | 只看该作者
黑驴蹄子 发表于 2012-7-25 09:05 & P4 d/ A; C- r$ w
这个是设置垂直间距模式:无限间距模式和指定间距模式
9 o3 b3 [2 W4 C& \9 V6 L# E
他不是说有些器件分别摆放在TOP和BOTTOM层也会报错么...好像是把这个设置更改下就好了.....

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7#
 楼主| 发表于 2012-7-25 12:49 | 只看该作者
黑驴蹄子 发表于 2012-7-25 09:02 7 c0 H" I2 d2 |3 z9 g. {* r9 ~
这个问题就清楚了嘛,其实元件的间距根本不是以元件的丝印来决定的,LZ大概只用AD和protel,所以对这个概念 ...
3 |+ i- ?8 ?& D& O2 {1 _: E
还是不明白,因为我把那个器件封装重画了一下,原来一条直线是好几条线接起来的,改成一整条线了,其阴影范围不会超出丝印线,但是这样违反元件间距的提示依然存在,而且图上两个电阻上下摆放是绿的,但是左右摆放,也是0.2mm的间距就没有问题,不要说我太较真,只是我认为PROTEL99能做到的ALTIUM肯定可以,但事实不是这样。

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zhengzy + 5 钻研是可好习惯,其实设计室灵活的,有些规.

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8#
发表于 2012-7-25 13:37 | 只看该作者
方便的话就把你PCB传上来吧...大家一起研究下...

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9#
发表于 2012-7-25 23:24 | 只看该作者
还有丝印与焊盘等的间距呀,一般情况建议关闭丝印间距检查, 靠目测是最好的检查。

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10#
发表于 2012-8-15 21:30 | 只看该作者
本帖最后由 wanghanq 于 2012-8-15 21:40 编辑 4 q& h" e) X" ?+ `5 w; N
guantouren 发表于 2012-7-25 12:49
! C  K# l9 V% D  e... 不要说我太较真,只是我认为PROTEL99能做到的ALTIUM肯定可以,但事实不是这样...
- j  q$ B2 @" c9 _
99se能做到的AD基本都能做到,AD能做到的99不能做到(最基本的如 效率的提高),
" b' B% n+ y' M2 K4 A( f, V! c! ^) t6 L$ Y! C5 K: X
你当前的这个现象和你个人操作不当有关,建议带附件提问(这都是简单问题最基本的发问前提),建议楼主在7 \( J" Z* h3 x# h! N' j) \

# S# h* p1 [8 s网上找 提问的艺术、提问的智慧 ...
$ e  b2 D6 `. b5 o3 I% K3 a
8 y, k; k$ v; {2 N2 S7 z; n( v已收录到帖子:. U9 |  C/ E; Z
【给初学】答非所问 杂乱汇总贴 “ 鱼 渔 ”" R4 s6 o3 C2 [$ q
http://forum.pcbbbs.com/forum.ph ... 8&fromuid=63313
: Z5 Q" K% i: M! q9 P# q这个帖子中有篇类似的提问,你可顺便看看

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11#
发表于 2012-8-16 08:50 | 只看该作者
wanghanq 发表于 2012-8-15 21:30 $ }, U& H5 ]9 q2 p+ |1 V6 ?$ Q5 z2 m8 q
99se能做到的AD基本都能做到,AD能做到的99不能做到(最基本的如 效率的提高),+ [) L: e( z3 b% x

9 \. R9 a/ Q7 _' N- m7 M你当前的这个现象和你 ...
  Y5 R3 Y2 F( ]
朋友你是PCB,论坛protel版块的版主啊?以前我也注,册过们后来发现人气不行我没上过了
, C- v2 R! p) u6 [! D8 ]. e+ W9 D/ f+ S, [* H) h" m0 U
刚刚看了,好像又改版了是吧?改版后看着挺不错啊{:soso_e120:}

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12#
发表于 2012-8-16 16:00 | 只看该作者
建议关掉此规则!没多大用!

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13#
发表于 2012-8-17 00:16 | 只看该作者
本帖最后由 wanghanq 于 2012-8-17 00:27 编辑 2 p1 W# n2 N5 i# K/ O; _4 w* }' O
黑驴蹄子 发表于 2012-8-16 08:50 $ n+ [# h' D/ \  I5 f, ?9 s* i! D6 H
朋友你是PCB,论坛protel版块的版主啊?以前我也注,册过们后来发现人气不行我没上过了
: m' m- z7 s# \( P
3 }. D- @& E4 W6 y& z" X刚刚看了,好像 ...

6 [9 ?, u% L8 q; R1 s/ i. b) a/ n/ n( v* Q
人气是相对的,eda365/pcbbbs(还有其它好论坛)里都有很好的经典帖子供大家搜索学习(现在把它俩等同做内容链接),
% `& L. V. s( V! Z新手碰到的问题大多都有答案在里面,. Z# u9 t3 f0 P
可惜现在的新手多只会重新“呐喊”询问,好像只有他是第一个发问的初学者,却耐不下心来自己翻看旧帖2 _3 y% i) ^+ ~' P# [* R
3 ^- H3 _1 x2 i7 W
无意被抬上实习位置,软件操作多是之前的零星记忆,回复多只是起到 提示作用 做操作参考
& a: O- p: u  R, r既然不是专业人士,就整理些对初学者认为有用的帖子整理(也就这点个人能力),专业方面的知识还是要由专业人士来答复

该用户从未签到

14#
发表于 2012-8-17 08:24 | 只看该作者
wanghanq 发表于 2012-8-17 00:16
( m4 n2 `' U& L& S& v! d$ k4 X3 ?人气是相对的,eda365/pcbbbs(还有其它好论坛)里都有很好的经典帖子供大家搜索学习(现在把它俩等同做 ...

8 A5 o, x) a5 x* CPCB BBS有个超级恶心的地方——很多帖子回复才可以浏览,这个我最反感了这个
" s* t! I; C0 M6 D, l. ~5 e' p2 j" M/ e' Q* n
我一般在21,IC

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15#
发表于 2012-8-17 23:14 | 只看该作者
黑驴蹄子 发表于 2012-8-17 08:24
$ m3 D  a- z! h8 R" y- p/ ^& p. cPCB BBS有个超级恶心的地方——很多帖子回复才可以浏览,这个我最反感了这个& s% n9 C3 O! V" l6 D) ?6 |( g1 D
5 q( A, S: v2 f
我一般在21,IC

% d" q  d, _! w; K0 h+ u- r这个超级恶心的地方  应该是发帖人所为,怪不得论坛的(或者是否可让论坛取消这种用户权限)。; G. ]  M* }  m
' H. ]. n" P# _$ ?
感触雷同,所有很少发这种需要回复才能查看的帖子...
" O) k0 N' V, W, c5 l1 \, r
0 O3 _# k8 L, m$ z; m' l! _3 j: h" N( @. ?4 k
蹄子:看看这个帖子:
* p# k, K$ x1 Z0 n$ k$ q# C5 `AD中关于如何设置文件的打印(PDF)
* k+ `2 G" b8 M, s. Q7 {4 I3 a2 vhttps://www.eda365.com/forum.php? ... 06&fromuid=4169
5 p3 ]# f! b3 R) f* H“如果您要查看本帖隐藏内容请回复”
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