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上拉电阻的问题

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发表于 2012-5-21 20:04 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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* Y9 w- D1 p  g0 n6 T: C9 C5 e& ]# e' x) s8 j& G
上拉电压加上FPGA(ttl 3。3v)到端口时总的交流电压会不会是以3.3v为中心在波动# }/ ?, b3 v# y
就是把ttl的电压抬高了* m) O2 a2 m9 p6 t

( v6 ?7 Q6 a/ ^
: A3 Z1 G/ W6 U: b- z. O) E我知道不会 会的话 电路就有问题了 但我想不清楚为什么 不会抬高
- P% g) @$ r" v$ w9 n; |' p7 j( S2 }! N2 r+ i% F5 _7 w
请高手指教
- D. O- `% R; m8 J4 \6 o; U& Z& P' f& [2 p" g
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