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上拉电阻的问题

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发表于 2012-5-21 20:04 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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5 s) i8 u0 P+ \& b( |1 p+ L
. k0 S& B3 B; t4 V2 z/ K
上拉电压加上FPGA(ttl 3。3v)到端口时总的交流电压会不会是以3.3v为中心在波动) O  s/ F9 a  [  F! x
就是把ttl的电压抬高了( L. c. \) C  v6 h. ~5 z7 T% M

* j8 O1 P* A, u* Q* g" I- ^! T0 G' g) I) a  e& d  {  i# Y
我知道不会 会的话 电路就有问题了 但我想不清楚为什么 不会抬高- b' X1 A  C- e8 A
" e. I& K/ s) h( N$ X3 V# J
请高手指教# ^* i6 R  P, W$ H2 t

0 V" X& M2 d: S0 s  ]% j# P% E
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