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[Ansys仿真] HFSS差分过孔仿真为什么阻抗曲线不降反增???

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    2023-10-12 15:48
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    [LV.2]偶尔看看I

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    1#
    发表于 2023-8-1 10:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    本帖最后由 sloth627 于 2023-8-1 10:54 编辑 + U8 g) K6 x/ l$ Q& V: \% I& B
    " L8 K% P! E: l  S( N; o
    按着参数设定完毕以后无论如何也仿真不出下图里这样的结果。而且不太理解,过孔不应该是有明显的阻抗降低吗,怎么还反而阻抗升高了呢?有木有大神给讲讲咋回事(拜托拜托~)
    ( I1 E! ^9 O1 ?- X; d  Y

    W9.jpg (188.78 KB, 下载次数: 0)

    W9.jpg

    该用户从未签到

    2#
    发表于 2023-8-1 11:09 | 只看该作者
    https://www.eda365.com/forum.php ... &highlight=HFSS
      }! p; H. e& R; T! |这个比较详细,你可以看一下

    点评

    谢谢♪(・ω・)ノ  详情 回复 发表于 2023-8-1 18:16
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    2025-6-23 15:52
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    [LV.9]以坛为家II

    3#
    发表于 2023-8-1 14:22 | 只看该作者
    111111111111111111111111
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    2024-2-21 15:59
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    [LV.8]以坛为家I

    4#
    发表于 2023-8-1 17:00 | 只看该作者
    不是孔的阻抗升高了,而是走线阻抗低了

    点评

    哦哦!谢谢解惑~ 再请问一下会是什么原因导致的走线阻抗突变这么多呢?我自己仿真的时候,曲线上只有过孔阻抗降低的过程,似乎并没有看见走线的阻抗升高。。  详情 回复 发表于 2023-8-1 18:21
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    [LV.2]偶尔看看I

    5#
     楼主| 发表于 2023-8-1 18:16 | 只看该作者
    ggfhkl45 发表于 2023-8-1 11:09) x+ _' c* }' I4 E
    https://www.eda365.com/forum.php?mod=viewthread&tid=672593&highlight=HFSS5 z+ {( n$ K- d! c! @# a3 \
    这个比较详细,你可以看一 ...

    * j/ ?: P& p9 Y  Q) e+ }谢谢♪(・ω・)ノ1 E# m* B; n' X8 |
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    [LV.2]偶尔看看I

    6#
     楼主| 发表于 2023-8-1 18:21 | 只看该作者
    dzkcool 发表于 2023-8-1 17:00
    + R9 \( ?" t0 _  x5 c: X不是孔的阻抗升高了,而是走线阻抗低了

    - G1 P" _4 _  d$ P) i: O哦哦!谢谢解惑~ 再请问一下会是什么原因导致的走线阻抗突变这么多呢?我自己仿真的时候,曲线上只有过孔阻抗降低的过程,似乎并没有看见走线的阻抗升高。。; z% M+ U0 A- A+ ^; g
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    [LV.1]初来乍到

    8#
    发表于 2023-8-19 08:24 | 只看该作者
    加不了你好友,HFSS问题可以一起讨论下

    点评

    不好意思。。我现在还没有那个权限,可以加我的QQ:419310159  详情 回复 发表于 2023-8-21 20:31
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    [LV.2]偶尔看看I

    9#
     楼主| 发表于 2023-8-21 20:31 | 只看该作者
    Dc20230818154a 发表于 2023-8-19 08:24
    " f7 r# c0 a& L3 }7 S6 a2 S加不了你好友,HFSS问题可以一起讨论下

    3 k5 N* c9 F. f& i/ ]不好意思。。我现在还没有那个权限,可以加我的QQ:419310159' q5 I, l6 ~; P& b" \- D

    该用户从未签到

    10#
    发表于 2023-9-6 11:27 | 只看该作者
    diff trace 阻抗没有控制好。VIA过孔阻抗,也没有控制好。从图看trace阻抗是85ohm,那via阻抗也应该是控制在这个目标

    点评

    谢谢解答~现在理解了,这里应该用了deemed,前后一段属于走线,中间凸起部分是过孔。过孔不一定会导致阻抗降低,要看各个过孔各个元件的电器属性对过孔阻抗造成的影响。  详情 回复 发表于 2023-9-8 21:04
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    11#
     楼主| 发表于 2023-9-8 21:04 | 只看该作者
    fbish 发表于 2023-9-6 11:27
    + N2 j" A+ s7 o$ I0 F9 fdiff trace 阻抗没有控制好。VIA过孔阻抗,也没有控制好。从图看trace阻抗是85ohm,那via阻抗也应该是控制 ...
    , A% i4 C1 L& ^1 Z- [9 R0 D& r  J! r
    谢谢解答~现在理解了,这里应该用了deemed,前后一段属于走线,中间凸起部分是过孔。过孔不一定会导致阻抗降低,要看各个过孔各个元件的电器属性对过孔阻抗造成的影响。
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