找回密码
 注册
关于网站域名变更的通知
查看: 261|回复: 1
打印 上一主题 下一主题

FPGA | LVDS屏幕接口的应用

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2023-6-5 17:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
今天给大侠带来基于FPGA的LVDS屏幕接口应用,话不多说,上货。1 s0 J+ |1 {4 Q2 x. T  k6 W

# J7 r: C, V. V+ f$ S& O5 V7 W什么是LVDS,LVDS的全称是Low-Voltage Differential Signaling ,即低电压差分信号。LVDS可以实现点对点或一点对多点的连接,具有低功耗、低误码率、低串扰和低辐射等特点。
% ]' z1 R( l+ q4 @5 V# k
3 g5 H. f5 y; x' G: y7 Y

7 R/ R/ u1 i' n& B) @3 S1 X$ o1.LVDS的特点和分类* q% Q6 Y, x+ n; Z
7 R. w: p4 A  \- }& C: H6 G- k
8 x: |! w4 x' M

LVDS为克服以TTL电平方式传输的高码率数据时功耗大、EMI电磁干扰大等缺点而研制的一种数字视频信号传输方式。

# S8 S1 c* O5 Y2 A6 V6 M

LVDS是利用低电压差(典型值为350 mV)进行编码信息的。


: G: T( \3 @! `5 u# ^: O, d

LVDS信号的分为单路6位LVDS,双路6位LVDS,单路8位LVDS和双路8位LVDS,特点对比如下表:

  l$ j2 B$ h; R7 ]8 J9 a


' M" k/ _! {4 _! b* n

1 r* i- g; ?! g) G& [

我们常用的是HDMI高清接口,那么LVDS与HDMI又有哪些区别呢。

0 a$ t( ?9 `# {6 l& t3 d5 i, _

它们都是高清输出接口,LVDS由于采用低压和低电流驱动方式,因此,实现了低噪声和低功耗。


5 @5 i4 M$ _7 _* U8 X7 Z

HDMI的TMDS是3.3V,而DDC电路的电平则是5V。传统的TTL驱动电平带来的噪声和功耗相对较大,要是对产品的EMI和EMC要求比较严格,则应该优选LVDS接口。

" O/ Y, U0 [% g" v' W: g, x

0 |: H6 a6 I. p5 _: `


6 W  q+ ?/ S. J, t3 h% y6 }+ @- ?

2.LVDS的应用

& i/ F- y% |0 w7 W7 z" p/ O

这里来看一个LVDS应用的例子:

7 D4 x: l' ^7 R9 Q) `, K( N" X

( E5 d$ l2 v; o6 `/ o: N0 l/ g, d

% X5 E! {3 \  R  v

1 a. C2 r9 t2 a; T

整个应用分为LVDS输出驱动板和LVDS接收液晶面板,一般主控芯片内部没有集成的LVDS发射模块,只提供6或8 bit RGB接口,传输的是TTL电平,这时候需要加一块TTL转LVDS的转换芯片,然后将LVDS信号传输给液晶面板。液晶面板的LVDS接收器再对信号做转换处理并显示。


( O9 H$ }& q; O5 o8 }" N

另外需要给液晶面板提供液晶的背光,背光电路一般放在驱动板,主控通过PWM信号对面板背光进行调节。若液晶面板带触摸功能,还需要设计触摸控制电路,触摸控制器与主控通过I2C通信,再去驱动液晶面板。

4 `% B' p+ O( C4 @9 @

那么对于产品设计,LVDS接口有单6,双6,单8,双8之分,我们怎么选LVDS接口呢?经过咨询相关屏幕厂家,得到以下回复。


) \# e+ C/ _8 b3 r


- K3 l. k- t8 }' Y


6 }3 A7 o7 t" s/ C( o  L

也就是说,选接口是由屏幕分辨率决定的,你选的屏幕分辨率高了,就得用高位数的,毕竟高分辨率要求基色信号的位数越多,才能在屏幕上显示更多色彩。
/ Z- n, I  O# D1 `- A9 r( P


% r/ R3 R  |# Y' C/ @9 T% K/ u

上面是不集成LVDS的主控的应用方案,如全志的H6,显示接口只有6bit 的RGB接口和HDMI接口,无LVDS接口。但像性能更强大一点的全志T3和瑞芯微RK32x8平台等,就内部集成专门的LVDS接口,不用再桥接一片转换IC。


, p- E( c; i$ ^! z! A


1 E* T; H% r+ Q; `: ^

在实际应用中,通常我们可以调节LVDS转换芯片的RS管脚配置去控制信号的摆幅,低摆幅LVDS输出可以进一步降低系统的EMI,并减小芯片功耗。

: j- W" T  ]1 w) _0 I, L


2 e6 j( B5 A8 m+ T0 [( j- r


' T: `* s; p9 R& H; J' b, h) p! s


, H8 ?9 J$ K! w4 G# n( Y. `

1 c( s/ ]3 M! I& Z  k+ r' g

3.关于LVDS Layout


( X5 ^# h, N. `

; U' x5 W* K$ n! Y+ j+ s

下面介绍一下关于LVDS的PCB 板布线时需要注意的点:
2 v6 t& d' Y+ P( |  v! g

1) 由于差分线较多并为了方便做阻抗匹配,PCB 至少采用四层板设计;

2) 电源滤波电容尽可能的靠近芯片电源 pin;

3) 每组电源都需要通过磁珠进行隔离,且都要增加电源滤波电容;

4) PCB 板尽可能铺设大面积的 GND ;

7 q3 H# v% J, ~( E& K

5 d- Q( u" e2 i7 ?
, \% o1 F  z' @8 I

& `2 B3 R- m* g) I( V
" D! g8 Y; \# y% g* ]% p
1 t3 R2 Q  q+ R2 p
" }( q" P0 F. v' m: L

' ]9 E6 w, Z0 Y

5) LVDS 输出差分信号走线设计成 100Ω差分匹配,走线尽可能保持等长;

6) LVDS 输出差分信号正负通道间隔 S1 尽可能的小;

7) LVDS 各输出差分信号通道间的间隔至少要大于 2 倍 S1;

8) 100Ω终端电阻要尽可能的靠近 LVDS 接收器输入端口;

9) LVDS 输出差分信号通路尽可能的少用通孔,且走线避免设计成 90°弯角。


# Z1 g9 B  R2 _( O

7 u* ?. a: {1 F- H; L3 o  k

该用户从未签到

2#
发表于 2023-6-6 09:50 | 只看该作者
FPGA是并行的,处理速度会更快
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

GMT+8, 2025-7-18 15:49 , Processed in 0.140625 second(s), 26 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表