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MIPI trace上的bypass电容是否有要求?

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1#
发表于 2023-1-29 10:13 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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MIPI trace上的bypass电容是否有要求?4 W$ O3 Q1 B0 n6 l3 o

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2#
发表于 2023-1-29 10:54 | 只看该作者
MIPI trace上的bypass cap最多47 pF。。。

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3#
发表于 2023-1-29 13:18 | 只看该作者
去耦电容和旁路电容都是起到抗干扰的作用,电容所处的位置不同,称呼就不一样了

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4#
发表于 2023-2-8 18:10 | 只看该作者
这多半跟芯片厂商讨论   各家芯片要求不一
7 v& d$ a7 t% k9 Y& |! `除了MIPI   许多控制讯号   像是PCIe
' `7 x  T+ [9 x0 I( L其落地电容值都有规范5 Z5 d, V2 U$ n
因为值太大   会使上升/下降时间拉长( H2 h4 L6 c* B6 J' x
进而影响逻辑判断   导致控制出问题
# T2 c5 {4 Y5 {" E- n- F  g: y9 H% C, u5 X8 s: n5 v# _# L
所以有些厂商  对于走线长度也有规范   即便走内层
7 Z: r& M- i2 j$ c! D9 Y(走表层会有EMI辐射问题  肯定太长不允许)8 P- z( N  R- B2 \+ S7 j7 @
原因在于走线太长   除了Loss大   整体寄生电容也大( v& ~7 ?' C3 ?: Z# [
$ [& f5 @6 P7 H, }* i" l, G$ ~
当然你说寄生电容这么关键的话   要不要联机宽都限制?* T7 m! [' |% t5 `, {+ f5 ~
基本上是没严苛到这样  
' ^4 M/ _5 @; s# ^况且有些控制讯号   像是PCIe   需要阻抗控制  90 Ohm
- {$ c9 G5 K8 e那线宽就不能乱调
' b+ c  `8 f& y% q* H- }  a  ?! d- }

# n1 Q8 i  t: x+ j, g# ?& F9 j
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