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楼主: shg_zhou

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[Cadence Sigrity] 封装模型提取的相关问题

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16^#

发表于 2012-4-10 23:28 | 只看该作者

{:soso_e181:}

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EDA365微信号及QQ群号！

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发表于 2012-4-11 10:38 | 只看该作者

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18^#

发表于 2012-4-20 00:07 | 只看该作者

看看，也是刚开始学，一头雾水

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19^#

发表于 2012-5-10 11:07 | 只看该作者

支持，学习一下啊

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发表于 2012-5-10 11:07 | 只看该作者

方家恩？

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21^#

发表于 2012-5-10 22:06 | 只看该作者

谢谢了

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22^#

发表于 2012-5-14 00:10 | 只看该作者

看一下

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23^#

发表于 2012-5-14 08:09 | 只看该作者

过来学习下，呵呵

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24^#

发表于 2012-5-17 21:13 | 只看该作者

800mhz不高
提S参数的话，若是平面结构，用SIWAVE ，2.5D足矣，可以跑所有的端口。
用HFSS 3D全波虽然精度高，但是会跑死人的，只有在提取个别关键的高速通道才用。
提取IBIS的pak模型，建议用Q3D，准静态，速度比HFSS快很多。

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26^#

发表于 2018-7-12 09:00 | 只看该作者

支持，来学习一下

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TA的每日心情

	衰 2020-3-31 15:45

签到天数: 1 天

[LV.1]初来乍到

29^#

发表于 2018-7-23 13:46 | 只看该作者

好好学习天天向上

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30^#

发表于 2018-8-7 16:51 | 只看该作者

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