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[仿真讨论] 结电容、势垒电容,在高频的时候有什么影响?怎么去解决?

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发表于 2011-12-15 17:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 雙魚Fei 于 2011-12-15 17:35 编辑
$ ?5 H! \: i3 W. T) O  m! G& u# i
  }* D( a3 S2 g- P, q2 c- \, m7 i结电容、势垒电容,在高频的时候有什么影响?请有经验的设计工程师,能通俗的讲解一下!对于结电容的影响,应该有什么方式去解决?
$ K% j3 f9 \. t7 C$ `" s  `

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2#
 楼主| 发表于 2011-12-15 17:46 | 只看该作者
顶啊 !别沉了!还未解决问题就沉了!

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3#
 楼主| 发表于 2011-12-15 17:52 | 只看该作者
研究森!本科森!砖家!都来谈一下自己的见解啊!

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4#
发表于 2011-12-16 08:34 | 只看该作者
电容由于存在寄生电感、电阻,存在谐振频率,谐振频率之上电容表现出电感特性。频域呈阻抗直线上升趋势。所以高频时它对电路有影响。

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5#
 楼主| 发表于 2011-12-16 10:01 | 只看该作者
jomvee 发表于 2011-12-16 08:34 9 x6 I2 G5 |. o* x3 v2 c
电容由于存在寄生电感、电阻,存在谐振频率,谐振频率之上电容表现出电感特性。频域呈阻抗直线上升趋势。所 ...
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哦 请问大师如何解决呢?
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