找回密码
 注册
关于网站域名变更的通知
查看: 1970|回复: 4
打印 上一主题 下一主题

有谁布过SRIO或者其它高速差分串行总线吗?

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2008-6-13 08:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
最近在做一个东西,用的是SRIO,跑3.125G的速率,不知道哪位大侠做过,想请教一下该注意哪些东西?

该用户从未签到

2#
发表于 2008-6-13 17:36 | 只看该作者
在差分走线的终端以Pi型/T型端接实现阻抗匹配。
9 A5 o( q9 u1 s尽量避免走线参考层的切换。
; \& M) I2 }: b/ }$ i6 M4 r) ? $ m' Q3 J3 R4 Z7 I! G: G, Q2 b

0 W) n; R: U3 T' z9 a/ d/ q7 t/ K[ 本帖最后由 forevercgh 于 2008-6-13 18:44 编辑 ]
  • TA的每日心情
    开心
    2019-12-3 15:20
  • 签到天数: 3 天

    [LV.2]偶尔看看I

    3#
    发表于 2008-6-13 17:46 | 只看该作者
    线不要太长,在控制好差分阻抗的前提下,尽量粗些,另外2根线要精确等长,参考平面里尽量避开过孔、连接器的反焊盘。

    该用户从未签到

    4#
    发表于 2008-6-16 11:17 | 只看该作者
    控制好差分阻抗,尽量走在统一层,减少过孔,有一个完整的参考平面,所附为TI 的一个layout guide(Implementing Serial Rapid IO PCB Layout on a TMS320C6455 Hardware Design)

    Implementing Serial Rapid IO PCB Layout on a TMS320C6455 Hardware Design.pdf

    127.99 KB, 下载次数: 75, 下载积分: 威望 -5

    评分

    参与人数 1贡献 +10 收起 理由
    Allen + 10 感谢分享

    查看全部评分

    该用户从未签到

    5#
    发表于 2008-6-19 12:26 | 只看该作者

    感觉你提供的信息太少了,还是做一些分析之后,再交流。
    - c% f  Z7 ]6 \1 N
    ( w$ u8 j' i5 E2 |# S7 D首先,芯片电平,叠层信息,传输距离,连接器和板材选型,多少对差分线,芯片内部的预加重和均衡功能都要给大家分析一下。
    您需要登录后才可以回帖 登录 | 注册

    本版积分规则

    关闭

    推荐内容上一条 /1 下一条

    EDA365公众号

    关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

    GMT+8, 2025-6-16 02:13 , Processed in 0.093750 second(s), 28 queries , Gzip On.

    深圳市墨知创新科技有限公司

    地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

    快速回复 返回顶部 返回列表