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请教 如何读波形

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1#
发表于 2008-6-11 17:43 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请教 从发的波形能看出什么?这个信号是好是坏? 老大说这个信号不好 我却看不出来 请教

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发表于 2013-8-22 14:38 | 只看该作者
时钟信号吧。单从波形就能看出好不好?信号好不好判断的标准是什么?* k6 [9 K0 t( h. X# z% x4 T5 ~

  F  ?' |0 e- b( W' t建议从几个方面仔细查一下:% d$ T8 u. g4 ^8 a
1、接收这个信号的芯片对上下冲的限制。
6 f8 ]4 z2 R/ f+ Z" R7 C* y/ F2、整个产品的EMI要求是否苛刻。2 t& y: }9 j& o) B( L
3、如果是时钟,这个时钟有没有特殊要求,比如抖动指标之类的。如果有,波形上看不出来,测一下频谱和相噪。
+ v, ]4 E/ x; z; d; X0 M2 k) Y4、如果是同步总线里面的时钟,你还是加个大一点的串阻吧,几十兆的频率,边沿缓一点无所谓。
8 P% m* R9 e! R& x5、是否和其他重要信号靠的很近。
, _! |- V& H5 Y( s0 h
( `( h$ Y5 {& k: \4 Y: }* _1 e) U5 f时钟信号不能只看波形的。+ Z8 B# q0 s" x3 t0 Q- Q

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发表于 2013-8-22 13:02 | 只看该作者
看来 过阻欠阻还是要下下功夫才能看懂
  • TA的每日心情

    2019-11-19 16:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    推荐
    发表于 2013-9-9 10:37 | 只看该作者
    我也不懂,进来瞅瞅,没瞅明白。

    该用户从未签到

    2#
    发表于 2008-6-11 19:00 | 只看该作者
    过冲大,欠阻尼。

    该用户从未签到

    3#
    发表于 2008-6-11 19:07 | 只看该作者
    原帖由 hgsky 于 2008-6-11 17:43 发表 + l9 J1 n8 Y: J2 C% J
    请教 从发的波形能看出什么?这个信号是好是坏? 老大说这个信号不好 我却看不出来 请教
    & P$ E% e7 R! C9 v

    9 `* E! q9 S0 s  g+ n: W0 E泰克测的波形?

    该用户从未签到

    4#
    发表于 2008-6-12 14:31 | 只看该作者
    过冲是有点大,但要看实际情况,对其他有没有影响,没影响就没关系

    该用户从未签到

    5#
    发表于 2008-6-12 18:43 | 只看该作者
    只能看出过冲来,怎么看出欠阻尼得

    该用户从未签到

    6#
    发表于 2008-6-12 22:25 | 只看该作者

    问?

    这波行是什么电路里的,哪个点的波形

    该用户从未签到

    7#
     楼主| 发表于 2008-6-13 13:27 | 只看该作者
    原帖由 forevercgh 于 2008-6-11 19:07 发表 , G. n; r; w4 m9 [& Y6 r
    ; |1 W1 m; p1 y% B/ X6 d
    : A8 z6 z( Z: U( ]
    泰克测的波形?

    0 [) K5 e% g% m+ @- s1 O& M恩 高手 能不能解释下 你说的意思 过冲大是什么意思

    该用户从未签到

    8#
    发表于 2008-6-15 09:11 | 只看该作者

    过冲与下冲

    过冲就是上升沿的那尖峰,下冲就是下降沿的那尖峰,这样的波形往往EMC也过不了

    该用户从未签到

    9#
    发表于 2008-6-15 11:54 | 只看该作者
    学习

    该用户从未签到

    10#
    发表于 2008-6-15 15:32 | 只看该作者
    原帖由 FLY 于 2008-6-15 09:11 发表
    0 M3 I- y5 V# j过冲就是上升沿的那尖峰,下冲就是下降沿的那尖峰,这样的波形往往EMC也过不了

    ( R8 b% x* P( g4 P" t, J
    4 N0 {: I2 ]$ w7 K9 L) M: L" R0 x) b6 Z过冲就是第一个峰值或谷值超过设定电压——对于上升沿是指最高电压而对于下降沿是指最低电压。
    * s& P" j2 `2 C! P. [这是在网上收到的解释。$ d) P/ S, r- P' v  s
    到底哪个是对的?

    该用户从未签到

    11#
    发表于 2008-6-16 13:03 | 只看该作者
    波形的好坏要看你的具体要求了。% F4 _: S# d5 R: G$ G- |' A
    第一个图过冲小一些,但clk的上升时间也更长一些。第二个图反之。
    : u8 x- x* b& F; g: ]) {9 F( a: v3 R3 w4 v  \
    如果你的emc紧张,或者芯片的承受过冲能力较差,就用第一个图的端接,
    ( w5 D1 }% W- t4 ^, U$ E4 C如果你的timing紧张,芯片以及emc也能承受,就用第二个图的端接。
    : u, m9 |, o5 ~% E9 M# q5 n# n. \# U, o# f& z  X6 i
    过阻尼和欠阻尼是相对于端接来说的,过阻尼则驱动不够,表现在receiver的waveform上可能信号沿上会有台阶或回勾,信号沿缓慢;欠阻尼就是驱动能力过剩,会造成较大的过冲。

    评分

    参与人数 1贡献 +5 收起 理由
    forevercgh + 5 我很赞同

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    该用户从未签到

    12#
    发表于 2008-6-19 12:22 | 只看该作者

    建议你测量波形对比度时候,横轴的时间刻度要一致。& M0 A( _- }7 |# w) I( ]

    7 f* F* l$ }; \7 H9 z/ m图形2可以再改善一下,毕竟上升沿快,时钟信号就是靠这个边沿,但是EMI就有了,所以再调调。

    该用户从未签到

    13#
    发表于 2008-6-20 13:29 | 只看该作者
    学习!

    该用户从未签到

    14#
    发表于 2008-8-21 23:05 | 只看该作者
    NDK是家晶振厂商吧!
    6 Y: x! M* x5 M/ X) Y8 V. S你是测试的晶振的输出波形吗?! i! J- G5 o! i7 @: [5 w7 M
    怎么不是正旋波啊?
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