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CD14538设计的单稳态电路为什么下降沿时电路又会进入暂稳态?

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发表于 2021-12-30 10:22 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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几个信息:* R& O2 K- k" G. A  i
①用CD14538设计的单稳态电路,采用的是上升沿触发。# {$ ^/ J! @! ?) @- n( O7 y" F
②触发脉冲宽度大于14538的暂稳态时间。
7 d* W/ _8 E/ I③发现一个触发脉冲会引起进入2次暂稳态。如果触发脉冲宽度小于暂稳态时间就不会有这个问题。# ^& ~0 J9 ]$ }3 p! b
) D/ e3 C; W' S. u" z. L1 M0 R  L
" E  s& t2 o- S3 P
疑问:CD14538不是上升沿触发吗,在上升沿时电路进入暂稳态,为什么到下降沿时电路又会进入暂稳态?还是我电路哪里有问题?
1 F) h; W% \% D3 y( h $ g& u" z# @0 e, y& z

" C4 _; t3 D+ h. T$ x! d

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2#
发表于 2021-12-30 10:45 | 只看该作者
如果触发脉冲宽度大于暂稳态时间的需要后沿给短暂触发就不会有这个问题了。

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3#
发表于 2021-12-30 11:10 | 只看该作者
上升沿触发没有问题。+ U! ?4 l. `; S: L; h  S8 E
从波形截图可见,触发信号的下降沿貌似有下降又再上升的状况发生,形成不需要的上升沿触发。
& d% P( x) W1 O& }4 ~# s: X; \检查比较器的输入正弦半波信号质量等问题。

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4#
发表于 2021-12-30 13:56 | 只看该作者
正弦波信号应该不稳定吧

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5#
发表于 2021-12-31 17:57 | 只看该作者
上升沿触发没有问题。
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