IC设计流程介绍

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1.1 从RTL到GDSⅡ的设计流程：
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1 g/ P! q2 o* b, F" n1 }2 G7 k. d这个可以理解成半定制的设计流程，一般用来设计数字电路。
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! D# A5 u0 D- x# _整个流程如下（左侧为流程，右侧为用到的相应EDA工具）：
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$ b* A: m. N: Y7 r  一个完整的半定制设计流程应该是：RTL代码输入、功能仿真、逻辑综合、形式验证、时序/功耗/噪声分析，布局布线（物理综合）、版图验证。
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8 U: T5 K' j0 U2 |8 a5 c$ m4 y4 C( |  至于FPGA设计，开发起来更加简单，结合第三方软件（像Modelsim和SynplIFy Pro），两大FPGA厂商altera和xilinx自带的QuartusⅡ和ISE开发平台完全可以应付与之有关的开发。
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前端的主要任务是将HDL语言描述的电路进行仿真验证、综合和时序分析，最后转换成基于工艺库的门级网表。

3 ~& T0 z7 h) L; ?' s! Q1 g后端的主要任务是：

（1）将netlist实现成版图（自动布局布线APR）

（2）证明所实现的版图满足时序要求、符合设计规则（DRC）、layout与netlist一致（LVS）。

7 @3 S! }( p# q. J5 r  j（3）提取版图的延时信息（RC Extract），供前端做post－layout 仿真。

1.2从schematic到GDSⅡ的设计流程：

    这个可以理解成全定制的设计流程，一般用于设计模拟电路和数模混合电路。

0 s0 K! q4 g; f0 @, P   一个完整的全定制设计流程应该是：电路图输入、电路仿真、版图设计、版图验证（DRC和LVS）、寄生参数提取、后仿真、流片。
1 j& X& |1 B( C9 [4 W# P. w6 [      一个完整的半定制设计流程应该是：RTL代码输入、功能仿真、逻辑综合、形式验证、时序/功耗/噪声分析，布局布线（物理综合）、版图验证。
& ~2 q4 i% G2 Y      至于FPGA设计，开发起来更加简单，结合第三方软件（像Modelsim和Synplify Pro），两大FPGA厂商Altera和Xilinx自带的QuartusⅡ和ISE开发平台完全可以应付与之有关的开发。
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一个完整的全定制设计流程应该是：电路图输入、电路仿真、版图设计、版图验证（DRC和LVS）、寄生参数提取、后仿真、流片

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一个完整的半定制设计流程应该是：RTL代码输入、功能仿真、逻辑综合、形式验证、时序/功耗/噪声分析，布局布线（物理综合）、版图验证
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学习了！学习了！